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基于FPGA的視頻處理硬件平臺(tái)設(shè)計(jì)與實(shí)現(xiàn)

基于FPGA的視頻處理硬件平臺(tái)設(shè)計(jì)與實(shí)現(xiàn)

為了滿足機(jī)載顯示器畫面顯示多元化的要求，提出了一種基于FPGA的視頻轉(zhuǎn)換與疊加技術(shù)，該技術(shù)以FPGA為核心，搭配解碼電路及信號(hào)轉(zhuǎn)換電路等外圍電路，可實(shí)現(xiàn)XGA與PAL模擬視頻信號(hào)轉(zhuǎn)換為RGB數(shù)字視頻信號(hào)，并且與數(shù)字圖像信號(hào)疊加顯示，具有很強(qiáng)的通用性和靈活性。實(shí)驗(yàn)結(jié)果表明，視頻轉(zhuǎn)換與疊加技術(shù)能夠滿足機(jī)載顯示器畫面顯示的穩(wěn)定可靠、高度集成等要求，具備較高的應(yīng)用價(jià)值。

基于賽靈思Virtex-5 FPGA實(shí)現(xiàn)LTE仿真器

功能強(qiáng)大的可編程邏輯平臺(tái)使得Prisma Engineering公司能夠針對(duì)所有蜂窩網(wǎng)絡(luò)提供可重配置無(wú)線測(cè)試設(shè)備。長(zhǎng)期演進(jìn)(LTE)是移動(dòng)寬帶的最3GPP標(biāo)準(zhǔn)，它打破了現(xiàn)有蜂窩網(wǎng)絡(luò)的固有模式。LTE與前代UMTS和GSM標(biāo)準(zhǔn)相比，除采用高頻譜效率的射頻技術(shù)外，其架構(gòu)還得到了大幅簡(jiǎn)化。LTE系統(tǒng)的無(wú)線接入部分Node-B，是連接無(wú)線電和整個(gè)互聯(lián)網(wǎng)協(xié)議核心網(wǎng)絡(luò)之間的邊緣設(shè)備。這種架構(gòu)無(wú)法監(jiān)測(cè)和測(cè)試等效于UMTS中間鏈路上的元件。必須通過(guò)無(wú)線電接口，才能有效地測(cè)試LTE網(wǎng)絡(luò)元件。

發(fā)表于：5/10/2011

基于CPLD 的矩陣鍵盤掃描模塊設(shè)計(jì)

為了在不增加CPU 工作負(fù)擔(dān)的前提下，實(shí)現(xiàn)標(biāo)準(zhǔn)鍵盤和矩陣鍵盤雙鍵盤同時(shí)工作，提出了一種基于復(fù)雜可編邏輯器件（CPLD）的矩陣鍵盤掃描方案，實(shí)現(xiàn)了在矩陣鍵盤狀態(tài)控制下CPLD 自動(dòng)完成鍵盤掃描、編碼、輸出的功能，CPU 通過(guò)定時(shí)器中斷服務(wù)程序定時(shí)查詢矩陣鍵盤狀態(tài)，并將按鍵值直接送入鍵盤緩沖區(qū)，供其他程序使用。

發(fā)表于：5/10/2011

基于VHDL +FPGA 的自動(dòng)售貨機(jī)控制模塊的設(shè)計(jì)與實(shí)現(xiàn)

EDA技術(shù)是以計(jì)算機(jī)為工具完成數(shù)字系統(tǒng)的邏輯綜合、布局布線和設(shè)計(jì)仿真等工作。電路設(shè)計(jì)者只需要完成對(duì)系統(tǒng)功能的描述,就可以由計(jì)算機(jī)軟件進(jìn)行系統(tǒng)處理,最后得到設(shè)計(jì)結(jié)果,并且修改設(shè)計(jì)方案如同修改軟件一樣方便。利用EDA工具可以極大地提高設(shè)計(jì)效率。

發(fā)表于：5/10/2011

DWT域數(shù)字水印算法的FPGA實(shí)現(xiàn)

根據(jù)離散小波變換原理的特點(diǎn)，提出了一種基于DWT域的數(shù)字水印算法，并用FPGA硬件實(shí)現(xiàn)其中關(guān)鍵部分的DWT變換。詳細(xì)介紹了相關(guān)模塊的設(shè)計(jì)和時(shí)序，并對(duì)整個(gè)系統(tǒng)進(jìn)行了綜合仿真，驗(yàn)證了設(shè)計(jì)的正確性。分析與仿真結(jié)果表明，與軟件實(shí)現(xiàn)相比，用FPGA實(shí)現(xiàn)水印算法具有高速實(shí)時(shí)處理的優(yōu)點(diǎn)。

發(fā)表于：5/9/2011

基于FPGA的精密離心機(jī)光柵信號(hào)細(xì)分系統(tǒng)

介紹一種基于FPGA的精密離心機(jī)光柵信號(hào)細(xì)分系統(tǒng)。說(shuō)明了光柵信號(hào)的產(chǎn)生過(guò)程和基本處理方法，提出了一種綜合EDA技術(shù)與光柵莫爾條紋電子學(xué)細(xì)分技術(shù)的設(shè)計(jì)方案。通過(guò)VerilogHDL實(shí)現(xiàn)該系統(tǒng)的主要設(shè)計(jì)，并利用ISE軟件進(jìn)行了仿真試驗(yàn)。試驗(yàn)表明,該系統(tǒng)具有捕捉速度快、跟蹤精度高、相位誤差小、成本低廉等特點(diǎn)。

發(fā)表于：5/5/2011

基于FPGA的語(yǔ)音信號(hào)實(shí)時(shí)處理

介紹一種在語(yǔ)音識(shí)別系統(tǒng)中運(yùn)用FPGA技術(shù)對(duì)語(yǔ)音信號(hào)進(jìn)行前期實(shí)時(shí)處理的方法。利用DSP Builder設(shè)計(jì)信號(hào)處理算法的圖形化電路模塊，運(yùn)用硬件環(huán)（HIL Hardware in the Loop）技術(shù)對(duì)模塊進(jìn)行軟硬件協(xié)同仿真。滿足設(shè)計(jì)要求后，再用Signal Compiler 將模塊轉(zhuǎn)換成VHDL語(yǔ)言和Quartus II工程文件下載至目標(biāo)芯片。結(jié)果表明此方法可以快速靈活地設(shè)計(jì)出語(yǔ)音處理模塊，語(yǔ)音數(shù)據(jù)能在要求的時(shí)間范圍內(nèi)處理完畢，達(dá)到了實(shí)時(shí)處理的目的。

發(fā)表于：5/5/2011

基于模塊化設(shè)計(jì)方法實(shí)現(xiàn)FPGA動(dòng)態(tài)部分重構(gòu)

本文針對(duì)Xilinx公司的FPGA進(jìn)行研究，支持模塊化動(dòng)態(tài)部分重構(gòu)的器件族有Virtex/-II/-E和Virtex-II Pro。 Xilinx公司FPGA是基于SRAM工藝的，包括配置邏輯塊（CLBs），輸入輸出塊（IOBs），塊RAMs，時(shí)鐘資源和編程布線等資源[2]。CLBs是構(gòu)造用戶所需邏輯的功能單元，IOBs提供封裝引腿與內(nèi)部信號(hào)引線的接口?？删幊袒ミB資源提供布線通道連接可配置元件的輸入和輸出到相應(yīng)的網(wǎng)絡(luò)。

發(fā)表于：5/3/2011

基于FPGA的三相函數(shù)信號(hào)發(fā)生器設(shè)計(jì)

基于FPGA的三相函數(shù)信號(hào)發(fā)生器以DDS為核心，在Altera公司CycloneⅡ系列EP2C8T144C8上實(shí)現(xiàn)正弦波、方波、三角波和鋸齒波信號(hào)的產(chǎn)生，利用單片機(jī)PICl8F4550控制波形的頻率及相位差。同時(shí)單片機(jī)通過(guò)DAC0832控制波形數(shù)據(jù)轉(zhuǎn)換DAC902參考電壓實(shí)現(xiàn)在波形幅度的控制，D／A輸出的波形經(jīng)過(guò)放大、濾波后輸出。波形參數(shù)的輸入輸出通過(guò)觸摸屏和液晶屏實(shí)現(xiàn)，測(cè)試結(jié)果顯示該系統(tǒng)具有較高的精度和穩(wěn)定性。

發(fā)表于：5/3/2011

基于DSP+CPLD的異步電動(dòng)機(jī)控制系統(tǒng)開發(fā)平臺(tái)設(shè)計(jì)

DSP結(jié)合CPLD構(gòu)建的電機(jī)開發(fā)平臺(tái)，適合異步電動(dòng)機(jī)控制算法的實(shí)現(xiàn)，以DSP作為主控制器，CPLD輔助功能擴(kuò)展，使得整個(gè)控制系統(tǒng)開發(fā)平臺(tái)具有較強(qiáng)的擴(kuò)展功能和較高的靈活性，不僅節(jié)約了成本，縮短了系統(tǒng)開發(fā)周期，而且提高了開發(fā)性能。

發(fā)表于：5/1/2011

基于DAC芯片AD9248和CY7C09449的PCI高速數(shù)據(jù)采集

數(shù)據(jù)采集向高精度和高速度兩個(gè)方向發(fā)展。高精度數(shù)據(jù)采集依賴于A/D器件的精度，高速度數(shù)據(jù)采集不僅...

發(fā)表于：4/30/2011