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AMD慶祝賽靈思成立40周年

AMD慶祝賽靈思成立40周年

40 年前，賽靈思（Xilinx）推出了一種革命性的設(shè)備，讓工程師可以在辦公桌上使用邏輯編程。賽靈思開發(fā)的現(xiàn)場可編程門陣列（FPGA）使工程師能夠?qū)⒕哂凶远x邏輯的比特流下載到臺式編程器中立即運行，而無需等待數(shù)周才能從晶圓廠返回芯片。如果出現(xiàn)錯誤或問題，設(shè)備可以在那里重新編程。

SOPC中NiosII的LCD顯示驅(qū)動IP設(shè)計

針對SOPC Builder系統(tǒng)沒有提供128064液晶模塊驅(qū)動的問題，以CBGl28064液晶模塊為例，采用有限狀態(tài)機，用Verilog HDL語言設(shè)計了顯示驅(qū)動IP核，并構(gòu)建了基于NiosII嵌入式處理器的片上系統(tǒng)。通過把顯示驅(qū)動IP核下載到Cyclone系列FPGA上，驗證了該設(shè)計的可行性。

發(fā)表于：9/2/2011

賽靈思中國電子展西部論壇做主題演講同時榮膺“2011年最佳FPGA技術(shù)獎”

全球可編程平臺領(lǐng)導(dǎo)廠商賽靈思公司（Xilinx, Inc. (NASDAQ:XLNX)）宣布在近期在西安曲江國際會展中心舉行的中國(西安)電子展西部論壇上，賽靈思亞太區(qū)市場與銷售總監(jiān)張宇清代表賽靈思做“可編程加速西部‘中國智造’”的主題演講，并與出席開幕式的陜西省委常委、常務(wù)副省長婁勤儉，中國電子學(xué)會副理事長兼秘書長劉汝林、工業(yè)和信息化部總經(jīng)濟師周子學(xué)、中國科學(xué)院院士李未等領(lǐng)導(dǎo)及業(yè)界知名人士會面。與此同時，賽靈思還參與了中國電子報同期主辦的“2011中國FPGA產(chǎn)業(yè)發(fā)展論壇及頒獎儀式?！睘楸碚?011年賽靈思在28nm工藝節(jié)點所做出的諸多技術(shù)創(chuàng)新，中國電子報把“2011年最佳FPGA技術(shù)獎”授予賽靈思公司。　

發(fā)表于：9/2/2011

基于ARM和FPGA架構(gòu)的三維圖形加速系統(tǒng)

本文設(shè)計了基于ARM和FPGA的嵌入式圖形系統(tǒng)，使用FPGA在硬件上實現(xiàn)三維圖形處理，緩解嵌入式CPU在處理三維圖形時因計算量過大而導(dǎo)致系統(tǒng)效率降低的問題。圖像顯示符合人眼對圖像連續(xù)性的要求。

發(fā)表于：9/1/2011

Premier Farnell與SemiSouth簽署全球分銷協(xié)議

Premier Farnell plc（倫敦證券交易所股票代碼：pfl）于今日宣布與SemiSouth Laboratories, Inc.簽署全球庫存分配協(xié)議。SemiSouth 是領(lǐng)先的碳化硅 (SiC) 二極管和晶體管技術(shù)制造商，可進行高功率、高效率、苛刻環(huán)境下的電源管理和轉(zhuǎn)換應(yīng)用。

發(fā)表于：9/1/2011

在FPGA上建立一個UWB脈沖發(fā)生器

用大多數(shù)FPGA都可以實現(xiàn)一個數(shù)字UWB（超寬帶）脈沖發(fā)生器。本設(shè)計可以創(chuàng)建一個兩倍于FPGA時鐘頻率的脈沖信號。以前的設(shè)計要采用異步延遲，才能制造出所需頻率的脈沖。不過該設(shè)計需要一只支持三態(tài)上拉的FPGA，如Xilinx公司的Virtex2。這種方案亦需要手工布局與布線。今天的FPGA都不支持三態(tài)上拉。

發(fā)表于：9/1/2011

基于FPGA的智能超聲波功率源的設(shè)計

本文介紹了一種基于直接數(shù)字合成(Direct Digital Synthesis，DDS)技術(shù)的超聲波功率源的設(shè)計。詳細介紹了基于現(xiàn)場可編程邏輯門陣列(FPGA)的DDS信號產(chǎn)生電路、功率放大電路以及超聲波功率源與換能器的匹配設(shè)計，與傳統(tǒng)的DDS相比，本系統(tǒng)的功率已經(jīng)達到工業(yè)應(yīng)用的水平。

發(fā)表于：9/1/2011

脫機的LED顯示控制系統(tǒng)設(shè)計

LED顯示屏作為高科技產(chǎn)品廣泛應(yīng)用于諸多領(lǐng)域，但在應(yīng)用中也逐漸暴露出不足，如每臺LED文字顯示屏需要一臺計算機控制等。提出了一種不攜帶計算機的低成本LED文字顯示屏的控制系統(tǒng)，并給出完整可行的系統(tǒng)硬件設(shè)計方案。

發(fā)表于：9/1/2011

WirelessHART成功實現(xiàn)控制功能在氣提塔和吸收塔上進行的測試顯示，無線儀表與有線儀表具有相同的性能

近幾年奧斯汀德克薩斯大學(xué)一直在進行分離（Separation）實驗項目的研究，當涉及工藝流程修改時，對相關(guān)過程設(shè)備需要增加新的測點并對工藝流程進行測試。在實驗中發(fā)現(xiàn)，增加或改變測點時，過程的啟動和停車所用的時間要比真正運行的時間多三倍，因此降低儀表安裝時間和工廠的停機時間是最重要的。由于無需敷設(shè)電纜或重新布線，無線變送器為過程測點的重新配置提供了極大的靈活性，

發(fā)表于：8/31/2011

基于FPGA的二次群數(shù)字信號分接部分功能實現(xiàn)

本文對二次群的分接處理，提出了一種基于FPGA的方案，介紹了二次群的幀結(jié)構(gòu)，給出了幀頭捕獲、幀丟失告警、負碼速調(diào)整等VHDL語言的關(guān)鍵程序。在QUART UART即為Universal Asynchronous Receiver/Transmitter，譯為通用異步收發(fā)器。UART是設(shè)備間進行異步通信的關(guān)鍵模塊，用于控制計算機與串行設(shè)備的芯片。它提供了RS-232C數(shù)據(jù)終端設(shè)備接口，這樣計算機就可以和調(diào)制解調(diào)器或其它使用RS-232C接口的串行設(shè)備通信了。

發(fā)表于：8/29/2011

基于CPLD和ARM的異步LED顯示屏控制系統(tǒng)設(shè)計

在控制電路中，數(shù)據(jù)總線將CPLD與ARM之間連接起來，S3C44B0X通過芯片2選通CPLD中的數(shù)據(jù)緩沖區(qū)，所以ARM輸出數(shù)據(jù)的基地址為0x40000000。ARM首先將FLASH中保存的圖像數(shù)據(jù)復(fù)制到SDRAM中，經(jīng)過相關(guān)處理后，調(diào)用不同的動態(tài)顯示效果程序?qū)DRAM中的圖像數(shù)據(jù)循環(huán)寫入CPLD緩沖區(qū)，CPLD生成相應(yīng)的時序轉(zhuǎn)換，串行輸出至LED驅(qū)動電路。

發(fā)表于：8/29/2011