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英特爾正式宣布出售Altera 51%股份

英特爾正式宣布出售Altera 51%股份

4 月 14 日消息，英特爾北京時(shí)間 20:30 正式宣布同私募股權(quán)企業(yè) Silver Lake 銀湖資本達(dá)成 FPGA 子公司 Altera 股份出售協(xié)議。Silver Lake 將以 87.5 億美元的估值買下 Altera 51% 的股份，英特爾繼續(xù)持有剩余 49% 股份。

Xilinx榮膺Cisco供應(yīng)鏈安全冠軍

All Programmable 技術(shù)和器件的全球領(lǐng)先企業(yè)賽靈思公司（Xilinx, Inc. (NASDAQ:XLNX)）今天宣布榮膺Cisco公司供應(yīng)鏈安全冠軍獎(jiǎng)。

發(fā)表于：10/16/2013

Altera起價(jià)只有49美元的開(kāi)發(fā)套件擴(kuò)展了低成本系列產(chǎn)品

Altera公司 (Nasdaq: ALTR)今天宣布，新增五款基于其Cyclone V FPGA的低成本開(kāi)發(fā)套件。這些新開(kāi)發(fā)套件入門價(jià)格只有49美元，方便了設(shè)計(jì)人員以高性價(jià)比方式開(kāi)始FPGA開(kāi)發(fā)。Altera為業(yè)界提供了最全面的系列低成本解決方案，考慮客戶獨(dú)特的設(shè)計(jì)需求而優(yōu)化了功耗和性能。系列產(chǎn)品包括CPLD、FPGA和SoC，均由Quartus® II開(kāi)發(fā)環(huán)境提供支持。Altera系列產(chǎn)品的密度范圍在業(yè)界最廣，封裝選擇最多，適用于多種大批量應(yīng)用和系統(tǒng)。

發(fā)表于：10/16/2013

基于ARC算法的數(shù)據(jù)壓縮技術(shù)和實(shí)現(xiàn)

針對(duì)無(wú)損壓縮技術(shù)在航天遙測(cè)系統(tǒng)中的應(yīng)用情況，提出了基于現(xiàn)場(chǎng)可編程門陣列（FPGA）和數(shù)字信號(hào)處理器（DSP）硬件結(jié)構(gòu)的遙測(cè)噪聲數(shù)據(jù)實(shí)時(shí)無(wú)損壓縮系統(tǒng)的方案。結(jié)合Shannon信息論中信息熵的概念，研究了數(shù)據(jù)壓縮的本質(zhì)和算法評(píng)估標(biāo)準(zhǔn)。通過(guò)PC仿真試驗(yàn)對(duì)多種算法的壓縮效果進(jìn)行了比較，最終選擇算術(shù)編碼(ARC)作為無(wú)損壓縮的算法。測(cè)試結(jié)果表明,該方案能夠?qū)崟r(shí)采集并壓縮遙測(cè)噪聲數(shù)據(jù)，有效地提高壓縮去除率和壓縮速度，優(yōu)化壓縮性能。

發(fā)表于：10/12/2013

Altera更新28 nm器件IP系列產(chǎn)品

Altera公司(Nasdaq: ALTR)今天宣布，完成了對(duì)28 nm FPGA和SoC IP內(nèi)核系列產(chǎn)品的更新。在過(guò)去一年中，Altera發(fā)布的新協(xié)議接口IP內(nèi)核數(shù)量超過(guò)了15個(gè)，適用于多種應(yīng)用和市場(chǎng)領(lǐng)域。此外，更新了IP內(nèi)核，有15%的時(shí)序余量，產(chǎn)品設(shè)計(jì)能夠快速實(shí)現(xiàn)時(shí)序收斂，支持客戶在其設(shè)計(jì)中快速集成多個(gè)IP內(nèi)核，產(chǎn)品更迅速面市。

發(fā)表于：10/10/2013

Altera支持中國(guó)移動(dòng)研究院下一代無(wú)線網(wǎng)絡(luò)的研發(fā)

Altera公司(Nasdaq：ALTR)今天宣布，公司與中國(guó)移動(dòng)研究院（CMRI）合作，開(kāi)展基于C-RAN體系結(jié)構(gòu)的下一代無(wú)線網(wǎng)絡(luò)研發(fā)。Altera FPGA和IP為中國(guó)移動(dòng)研究院的無(wú)線系統(tǒng)解決方案提供平臺(tái)和技術(shù)支持，用于驗(yàn)證中國(guó)移動(dòng)蜂窩網(wǎng)絡(luò)未來(lái)使用的無(wú)線體系結(jié)構(gòu)，該網(wǎng)絡(luò)是世界上最大的網(wǎng)絡(luò)，擁有7億多用戶。

發(fā)表于：10/8/2013

全新的自動(dòng)化在線多項(xiàng)目晶圓（MPW）報(bào)價(jià)系統(tǒng)提供即時(shí)報(bào)價(jià)

全球最大的獨(dú)立半導(dǎo)體設(shè)計(jì)和制造服務(wù)提供商eSilicon公司日前宣布：該公司全新自動(dòng)化多項(xiàng)目晶圓（MPW）批次流片服務(wù)即時(shí)網(wǎng)上報(bào)價(jià)系統(tǒng)上線。這項(xiàng)可通過(guò)用戶友好型網(wǎng)頁(yè)或者智能手機(jī)界面接入的服務(wù)，能即時(shí)生成可執(zhí)行的MPW服務(wù)報(bào)價(jià)，而通常通過(guò)人工處理需要長(zhǎng)達(dá)一個(gè)星期的時(shí)間才能獲得一項(xiàng)報(bào)價(jià)。

發(fā)表于：10/8/2013

基于FPGA的數(shù)字下變頻器設(shè)計(jì)

設(shè)計(jì)和實(shí)現(xiàn)了基于FPGA的可編程數(shù)字下變頻器（DDC），用于寬帶數(shù)字中頻軟件無(wú)線電接收機(jī)中，主要完成了數(shù)字下變頻、數(shù)據(jù)抽取等功能。采用自頂向下的模塊化設(shè)計(jì)方法，將整個(gè)下變頻器劃分為基本單元，實(shí)現(xiàn)這些功能模塊并組成模塊庫(kù)。在具體應(yīng)用時(shí)，優(yōu)化配置各個(gè)模塊來(lái)滿足具體無(wú)線通信系統(tǒng)性能的要求。

發(fā)表于：9/30/2013

基于以太網(wǎng)PHY的高速可靠數(shù)據(jù)傳輸方法實(shí)現(xiàn)

介紹了一種在成熟以太網(wǎng)物理層技術(shù)的基礎(chǔ)上使用硬件協(xié)議實(shí)現(xiàn)的高速可靠數(shù)據(jù)傳輸方法。該方法不同于一般采用的TCP機(jī)制，它利用FPGA實(shí)現(xiàn)數(shù)據(jù)分組打包和差錯(cuò)控制，用硬件的方法在保證了數(shù)據(jù)可靠傳輸?shù)耐瑫r(shí)實(shí)現(xiàn)了軟件協(xié)議無(wú)法實(shí)現(xiàn)的高數(shù)據(jù)率。經(jīng)過(guò)測(cè)試證明，該方法相對(duì)于TCP協(xié)議具有帶寬利用率高、傳輸速度穩(wěn)定、CPU占用率低的優(yōu)點(diǎn)，適用于點(diǎn)到點(diǎn)的高速可靠數(shù)據(jù)傳輸，同時(shí)還支持網(wǎng)絡(luò)的擴(kuò)展應(yīng)用。

發(fā)表于：9/30/2013

Mentor Graphics工具被納入臺(tái)積電16納米FinFET制程技術(shù)參考流程

Mentor Graphics公司（納斯達(dá)克代碼：MENT）日前宣布它已完成其用于臺(tái)積電16納米FinFET制程的數(shù)字成套工具。臺(tái)積電16納米參考流程包含一些新功能，用于Olympus-SoC?布局與布線系統(tǒng)的16納米設(shè)計(jì)，以及Calibre®物理驗(yàn)證和可制造性設(shè)計(jì)（DFM）平臺(tái)。臺(tái)積電和Mentor完成了V0.5設(shè)計(jì)規(guī)則手冊(cè)（DRM）及SPICE 16納米FinFET認(rèn)證，并將繼續(xù)進(jìn)行V1.0的認(rèn)證。

發(fā)表于：9/27/2013

Mentor Graphics工具被納入臺(tái)積電真正3D堆疊集成的3D-IC參考流程

Mentor Graphics 公司宣布其解決方案已由臺(tái)積電使用真正3D堆疊測(cè)試方法進(jìn)行了驗(yàn)證，可用于臺(tái)積電3D-IC參考流程。該流程將對(duì)硅中介層產(chǎn)品的支持?jǐn)U展到也支持基于TSV的、堆疊的die設(shè)計(jì)。具體的Mentor®貢獻(xiàn)包括：金屬布線和凹凸實(shí)施功能、多芯片物理驗(yàn)證與連通性檢查、芯片界面與TSV寄生參數(shù)提取、熱學(xué)模擬和全面的封裝前及封裝后測(cè)試。

發(fā)表于：9/27/2013