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AMD慶祝賽靈思成立40周年

AMD慶祝賽靈思成立40周年

40 年前，賽靈思（Xilinx）推出了一種革命性的設(shè)備，讓工程師可以在辦公桌上使用邏輯編程。賽靈思開發(fā)的現(xiàn)場可編程門陣列（FPGA）使工程師能夠?qū)⒕哂凶远x邏輯的比特流下載到臺式編程器中立即運(yùn)行，而無需等待數(shù)周才能從晶圓廠返回芯片。如果出現(xiàn)錯誤或問題，設(shè)備可以在那里重新編程。

宏力半導(dǎo)體發(fā)布其0.13微米鋁制程邏輯及混合信號工藝

中國上海，2010年7月8日——上海宏力半導(dǎo)體制造有限公司 (宏力半導(dǎo)體)，專注于差異化技術(shù)的半導(dǎo)體制造業(yè)領(lǐng)先企業(yè)，發(fā)布其低本高效的0.13微米鋁制程邏輯及混合信號工藝。

發(fā)表于：7/9/2010

使用Xilinx FPGA適應(yīng)不斷變化的廣播視頻潮流

　Xilinx高級資深應(yīng)用工程師John Snow意識到，這兩種數(shù)據(jù)速率用單個Virtex-II Pro MGT即可支持，由此而發(fā)現(xiàn)了將多個ASSP芯片集成到單個Xilinx FPGA中的良機(jī)。該集成將大大降低接口的成本費(fèi)用，尤其是對于含有多個視頻流的視頻切換器和主控制器的設(shè)計(jì)。

發(fā)表于：7/9/2010

Altera將在亞洲16座城市舉辦2010系列技術(shù)巡展

2010年7月8日，北京—— 　　事件：Altera®公司今天宣布其將與代理商聯(lián)手合作在2010年8月至11月期間在亞太地區(qū)16座城市舉辦免費(fèi)的技術(shù)研討會。此次研討會將在以下國家和地區(qū)舉辦，其中主要包括：中國、韓國、馬來西亞、新加坡、臺灣和印度。

發(fā)表于：7/8/2010

基于FPGA的多路視頻通道控制

視頻監(jiān)控以其直觀、方便、信息內(nèi)容豐富而廣泛應(yīng)用于許多場合。視頻監(jiān)控成為人們生活中不可缺少的技術(shù)。在一些危險場所，用視頻監(jiān)控代替人工監(jiān)視，可以保證人們的生命安全。鑒于一路視頻的視野范圍有限，要充分收集目標(biāo)的信息，就需要有多路視頻來對同一個物體在不同方位進(jìn)行監(jiān)控。因此需要有一個良好的控制手段，確保多路視頻控制穩(wěn)定，可靠。針對織布機(jī)告警系統(tǒng)的需求，提出一種基于FPGA的多路視頻通道控制系統(tǒng)，本系統(tǒng)設(shè)計(jì)利用FPGA間接控制2塊MAX4312選通所需要的視頻通道，實(shí)現(xiàn)各個視頻通道間相互切換。根據(jù)開關(guān)控制信號的設(shè)計(jì)思想在FPGA中對撥動開關(guān)輸入信號做去抖動處理，然后對不同的開關(guān)操作進(jìn)行編碼，最后將信號送給DSP進(jìn)行處理。

發(fā)表于：7/8/2010

Altera Quartus II軟件10.0版為高端FPGA提供前所未有的性能和生產(chǎn)效率

2010年7月7日，北京——Altera公司 (NASDAQ: ALTR) 今天宣布推出可編程邏輯業(yè)界的頂級軟件Quartus® II開發(fā)軟件10.0版，為其CPLD、FPGA以及HardCopy® ASIC設(shè)計(jì)提供最高的性能和生產(chǎn)效率。Quartus II軟件10.0版可以為高密度設(shè)計(jì)提供比主要競爭對手快2到3倍的編譯時間，從而能夠繼續(xù)保持業(yè)界領(lǐng)先的生產(chǎn)效率優(yōu)勢。最新的軟件版本可支持Altera 28-nm Stratix® V FPGA系列并擁有許多新的生產(chǎn)效率特性，這些特性使廣大設(shè)計(jì)團(tuán)隊(duì)能夠獲得更快速的時序逼近，從而縮短產(chǎn)品推出市場的時間。

發(fā)表于：7/7/2010

Actel亞洲研討會探討SmartFusion智能混合信號FPGA的功能和技術(shù)

愛特公司(Actel Corporation)將于六月及七月在韓國首爾、中國上海、臺北和印度班加羅爾舉辦一系列研討會，探討SmartFusion智能混合信號FPGA的主要特性和優(yōu)勢。為期一天的研討會活動內(nèi)容包括詳細(xì)的產(chǎn)品介紹，以及使用SmartFusion評測工具套件和愛特公司開發(fā)軟件進(jìn)行的各種設(shè)計(jì)流程演示。

發(fā)表于：6/24/2010

基于FPGA的K9F4G08 Flash控制器設(shè)計(jì)

設(shè)計(jì)了一種能使FPGA的主狀態(tài)機(jī)直接管理Flash的控制器，該控制器具有自己的指令集和中斷管理方式。用戶可以根據(jù)FPGA的系統(tǒng)時鐘對控制器進(jìn)行操作，無需關(guān)心Flash對指令和數(shù)據(jù)的時序要求?？刂破鹘⒘俗约旱膲膲K管理機(jī)制，合并了一些Flash的常用關(guān)聯(lián)指令，方便了用戶對FPGA主狀態(tài)機(jī)的設(shè)計(jì)。

發(fā)表于：6/23/2010

Altera為HD WDR監(jiān)視攝像機(jī)提供業(yè)界第一款單芯片解決方案

2010年6月23號，北京——Altera公司 (NASDAQ: ALTR)今天發(fā)布業(yè)界第一款單片F(xiàn)PGA高清晰(HD)互聯(lián)網(wǎng)協(xié)議(IP)監(jiān)視攝像機(jī)參考設(shè)計(jì)，進(jìn)一步為監(jiān)視市場提供擴(kuò)展FPGA解決方案。這一獨(dú)特的解決方案采用了Altera低成本Cyclone® III或者Cyclone IV FPGA以及Eyelytics和Apical的知識產(chǎn)權(quán)，支持AltaSens的1080p60 A3372E3-4T和Aptina的720p60 MT9M033 HD寬動態(tài)范圍(WDR) CMOS圖像傳感器。與使用傳統(tǒng)數(shù)字信號處理器和ASSP的現(xiàn)有體系結(jié)構(gòu)相比，這一全集成解決方案幫助監(jiān)視設(shè)備生產(chǎn)商減小電路板面積，降低功耗，提高了靈活性，縮短了開發(fā)時間。

發(fā)表于：6/23/2010

賽靈思“第二屆開放源碼硬件與嵌入式大賽”鳴鑼收金！有圖有真相

?6月17、18日，歷時一年的賽靈思“第二屆開放源碼硬件與嵌入式大賽總決賽及頒獎典禮”在北京工業(yè)大學(xué)鳴鑼收金！本次大賽共有來自中國大陸和中國臺灣200多個隊(duì)參加了比賽，并有19隊(duì)最終入圍決賽。17日所有入圍的參賽隊(duì)在北工大建國賓館進(jìn)行了項(xiàng)目演示，18日上午入圍隊(duì)分兩組進(jìn)行答辯，下午舉行頒獎典禮。此次大賽皆大歡喜，入圍隊(duì)隊(duì)隊(duì)有獎，共評出一等獎1名，二等獎2名，三等獎5名，最佳人氣獎1名，最佳創(chuàng)意獎1名，企業(yè)優(yōu)勝獎9名。

發(fā)表于：6/22/2010

基于Nios II的雙網(wǎng)傳真機(jī)系統(tǒng)的研究與開發(fā)

基于Nios-II設(shè)計(jì)和實(shí)現(xiàn)了支持PSTN網(wǎng)絡(luò)、Internet網(wǎng)絡(luò)的雙網(wǎng)傳真機(jī)系統(tǒng)，利用FPGA實(shí)現(xiàn)了傳真機(jī)系統(tǒng)的多個電路模塊，包括A/D采樣控制邏輯、二值化圖像處理模塊、MH編碼模塊、MH譯碼模塊和CIS掃描、TPH打印、電機(jī)控制模塊?；趗C/OS-II、Niche TCP/IP實(shí)現(xiàn)了T30協(xié)議通信、非實(shí)時網(wǎng)絡(luò)傳真通信、Tiff文件創(chuàng)建、Tiff文件解析模塊。使用Altera Cyclone EP1C20開發(fā)板實(shí)現(xiàn)和驗(yàn)證了整機(jī)系統(tǒng)，經(jīng)過軟硬件聯(lián)調(diào)，達(dá)到了系統(tǒng)設(shè)計(jì)指標(biāo)和功能。

發(fā)表于：6/22/2010