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銀湖資本完成對(duì)Altera的51%股權(quán)收購(gòu)

銀湖資本完成對(duì)Altera的51%股權(quán)收購(gòu)

北京時(shí)間9月15日晚間，全球 FPGA 創(chuàng)新技術(shù)領(lǐng)導(dǎo)者 Altera 宣布，全球技術(shù)投資巨頭銀湖資本（Silver Lake）已完成對(duì) Altera 51% 股權(quán)的收購(gòu)，該股權(quán)原由英特爾公司持有。同時(shí)，英特爾將保留 Altera 49% 的股權(quán)，此舉也彰顯了雙方對(duì) Altera 未來(lái)良好發(fā)展充滿信心。

MSK信號(hào)檢測(cè)識(shí)別的FPGA實(shí)現(xiàn)

MSK信號(hào)檢測(cè)識(shí)別的FPGA實(shí)現(xiàn),采用MSK調(diào)制的跳頻通信具有主瓣能量集中、旁瓣衰落滾降快、頻譜利用率高和抗干擾能力強(qiáng)等優(yōu)點(diǎn)，在軍事通信中應(yīng)用廣泛。如美軍現(xiàn)役的聯(lián)合戰(zhàn)術(shù)信息分發(fā)系統(tǒng)采用的通信信號(hào)，工作帶寬969~1206MHz，跳頻速率為70000多

發(fā)表于：6/14/2011

基于雙FPGA的刀閘接口控制箱的設(shè)計(jì)

摘要：現(xiàn)有變電站改造成數(shù)字化變電站時(shí)需要增加過(guò)程層設(shè)備，其中對(duì)刀閘接口控制箱的動(dòng)作可靠性提出了極高的要求。提出一種基于雙FPGA實(shí)現(xiàn)多重邏輯閉鎖的刀閘接口控制箱實(shí)現(xiàn)方案。設(shè)計(jì)了FPGA電源和時(shí)鐘實(shí)現(xiàn)電路，兩塊

發(fā)表于：6/14/2011

紅色颶風(fēng)FPGA高級(jí)技術(shù)研討會(huì)（第4期）

高速千兆位互連必然會(huì)成為今后芯片間(chip-to-chip)、電路板間(board-to-board) 或設(shè)備間(box-to-box) 通信的發(fā)展方向。同時(shí)，隨著芯片因工藝的提升而進(jìn)一步縮小，在芯片中能有效地實(shí)現(xiàn)可以作為高速串行干線連接網(wǎng)關(guān)的高速串行解串器(SERDEs)和驅(qū)動(dòng)器。FPGA將成為快速驗(yàn)證、采納某種標(biāo)準(zhǔn)和將最新的串行互連協(xié)議生產(chǎn)化及實(shí)用化的可編程平臺(tái)。

發(fā)表于：6/13/2011

Xilinx 第三屆OpenHW開源硬件與嵌入式設(shè)計(jì)大賽專題報(bào)道

“第三屆OpenHW開源硬件與嵌入式設(shè)計(jì)大賽”隆重開幕。本次大賽由中國(guó)電子學(xué)會(huì)主辦，美國(guó)賽靈思公司和北京工業(yè)大學(xué)承辦。

發(fā)表于：6/13/2011

PSoC3內(nèi)部模擬布線和管腳選擇

本文首先介紹了PSoC3內(nèi)部的模擬總線分布，說(shuō)明了PSoC Creator的模擬布線功能以及在設(shè)計(jì)中需要遵守的一些應(yīng)用規(guī)則，在模擬資源使用較多或?qū)δM性能要求較高的應(yīng)用中，設(shè)計(jì)者要遵照這些規(guī)則以達(dá)到高性能和高資源的使用。

發(fā)表于：6/13/2011

一種跳頻MSK信號(hào)檢測(cè)算法及FPGA實(shí)現(xiàn)

該文提出了一種FPGA 可實(shí)現(xiàn)的跳頻MSK 信號(hào)實(shí)時(shí)截獲和識(shí)別的設(shè)計(jì)方案，經(jīng)過(guò)試驗(yàn)證明，可以對(duì)寬帶跳頻信號(hào)進(jìn)行實(shí)時(shí)的截獲，并能夠?qū)ζ渲械腗SK 目標(biāo)信號(hào)完成準(zhǔn)確識(shí)別，可應(yīng)用于針對(duì)特定目標(biāo)的通信偵察系統(tǒng)，具有較高的應(yīng)用價(jià)值。

發(fā)表于：6/13/2011

松耦合式可編程復(fù)雜SoC的設(shè)計(jì)實(shí)現(xiàn)

隨著科技的發(fā)展，信號(hào)處理系統(tǒng)不僅要求多功能、高性能，而且要求信號(hào)處理系統(tǒng)的開發(fā)、生產(chǎn)周期短，可編程式專用處理器無(wú)疑是實(shí)現(xiàn)此目的的最好途徑。可編程專用處理器可分為松耦合式(協(xié)處理器方式，即MCU+協(xié)處理器)和緊耦合式(專用指令方式，即ASIP)，前者較后者易于實(shí)現(xiàn)，應(yīng)用較廣。本文就是介紹一款松耦合式可編程專用復(fù)雜SoC設(shè)計(jì)實(shí)現(xiàn)，選用LEON3處理器作為MCU，Speed處理器作為CoProcessor。

發(fā)表于：6/13/2011

SuVolta推出PowerShrink?平面CMOS平臺(tái) 有效降低集成電路功耗

2011年6月8日，中國(guó)——SuVolta今天宣布推出 PowerShrink?低功耗平臺(tái)。該平臺(tái)可以有效降低CMOS集成電路2倍以上的功耗，同時(shí)保持性能并提高良率。SuVolta和富士通半導(dǎo)體有限公司(Fujitsu Semiconductor Limited)今天還共同宣布，富士通已獲得授權(quán)使用SuVolta創(chuàng)新型PowerShrink?低功耗技術(shù)。

發(fā)表于：6/8/2011

What’s New In OpenHW2011？

第三屆OpenHW開源硬件與嵌入式設(shè)計(jì)大賽”隆重開幕。本次大賽由中國(guó)電子學(xué)會(huì)主辦，美國(guó)賽靈思公司和北京工業(yè)大學(xué)承辦，提出了“FPGA助力中國(guó)智造，擁抱嵌入式計(jì)算新時(shí)代”的響亮口號(hào)。

發(fā)表于：6/8/2011

侯義斌：賽靈思助力“卓越工程師培養(yǎng)計(jì)劃” 碩果累累

北京工業(yè)大學(xué)已是第二次承辦“第三屆OpenHW開源硬件與嵌入式設(shè)計(jì)大賽”，開幕式上北工大副校長(zhǎng)、全國(guó)政協(xié)委員侯義斌教授盛贊賽靈思開源硬件與嵌入式設(shè)計(jì)大賽對(duì)中國(guó)“卓越工程師培養(yǎng)計(jì)劃”的積極作用，并就2009年成立的“北工大——賽靈思軟件工程（嵌入式系統(tǒng)方向）應(yīng)用人才聯(lián)合培養(yǎng)模式創(chuàng)新實(shí)驗(yàn)區(qū)”在“卓越工程師教育培養(yǎng)計(jì)劃”的具體實(shí)施做了介紹。

發(fā)表于：6/8/2011