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AMD慶祝賽靈思成立40周年

AMD慶祝賽靈思成立40周年

40 年前，賽靈思（Xilinx）推出了一種革命性的設(shè)備，讓工程師可以在辦公桌上使用邏輯編程。賽靈思開發(fā)的現(xiàn)場可編程門陣列（FPGA）使工程師能夠?qū)⒕哂凶远x邏輯的比特流下載到臺式編程器中立即運(yùn)行，而無需等待數(shù)周才能從晶圓廠返回芯片。如果出現(xiàn)錯誤或問題，設(shè)備可以在那里重新編程。

Virtex4在VxWorks下的UDP千兆網(wǎng)通信

由于FPGA中嵌入了PowerPC處理器及用于千兆網(wǎng)通信的Ethernet MAC，這樣，為利用FPGA實(shí)現(xiàn)高速網(wǎng)絡(luò)通信奠定了基礎(chǔ)。本文在VxWorks操作系統(tǒng)下實(shí)現(xiàn)了UDP的千兆網(wǎng)通信，實(shí)測速度達(dá)到294.68 Mb/s，吞吐量達(dá)到近30％。

發(fā)表于：6/30/2011

基于CPLD系統(tǒng)的信號發(fā)生器設(shè)計

本文介紹了用CPLD開發(fā)板結(jié)合D／A芯片輸出模擬信號，實(shí)現(xiàn)了信號發(fā)生器功能。作為信號發(fā)生器時，能夠產(chǎn)生三角波、正弦波、鋸齒波和方波四種不同的波形，并可以通過開發(fā)板上的按鍵來控制頻率和波幅的調(diào)節(jié)。本設(shè)計通過VGA顯示，用戶界面友好，操作便捷，有較強(qiáng)的實(shí)用性。

發(fā)表于：6/30/2011

基于FPGA的紅外遙控信號接收模塊的設(shè)計

用HDL和可編程邏輯器件(FPGA／CPLD)設(shè)計數(shù)字系統(tǒng)有傳統(tǒng)方法無可比擬的優(yōu)越性，它已經(jīng)成為大規(guī)模集成電路設(shè)計最有效的一種手段。本文采用VerilogHDL設(shè)計了紅外遙控信號接收模塊電路。為簡單起見，本設(shè)計中只對遙控傳輸?shù)臄?shù)據(jù)部分進(jìn)行解碼，不失一般性。本文提出的基于FPGA的紅外遙控信號接收模塊的設(shè)計方案經(jīng)過電路仿真、FPGA實(shí)現(xiàn)及應(yīng)用測試驗(yàn)證該模塊完全符合紅外遙控通信協(xié)議的要求。

發(fā)表于：6/30/2011

基于SOPC的數(shù)據(jù)采集系統(tǒng)設(shè)計

本文介紹了基于SOPC的多通道數(shù)據(jù)采集系統(tǒng)設(shè)計，可以對多種關(guān)心的環(huán)境參數(shù)進(jìn)行采集并研究其特性。利用MicroBlaze微處理器搭建數(shù)據(jù)此采集與存儲的嵌入式可編程片上系統(tǒng)，可以由單個芯片完成整個系統(tǒng)的主要邏輯功能。便于系統(tǒng)實(shí)現(xiàn)小型化，集成化。這種靈活的設(shè)計方式可隨意擴(kuò)展系統(tǒng)功能。在此基礎(chǔ)上嵌入操作系統(tǒng)，可以進(jìn)一步開發(fā)功能更強(qiáng)大的實(shí)時數(shù)據(jù)采集設(shè)備。

發(fā)表于：6/30/2011

基于FPGA的指紋識別系統(tǒng)的設(shè)計與實(shí)現(xiàn)

為了提高指紋識別系統(tǒng)的實(shí)時性和處理速度，設(shè)計和實(shí)現(xiàn)了一種基于FPGA的嵌入式指紋識別系統(tǒng)。該系統(tǒng)采用處理器結(jié)合自定義硬件邏輯的方法，以下載到FPGA的MICOBLAZE嵌入式軟核為系統(tǒng)控制模塊，運(yùn)用FPGA路基單元實(shí)現(xiàn)指紋圖像的處理。在設(shè)計中，指紋圖像處理的算法通過SG(System Generator)軟件設(shè)計，采用Matlab語言和Verilog語音混合編寫的方式實(shí)現(xiàn)專用的處理模塊，較大地提高了系統(tǒng)的處理速度。

發(fā)表于：6/29/2011

基于DM642的高分辨率紅外熱像儀設(shè)計與實(shí)現(xiàn)

提出了一種基于DM642處理器和DSP/BIOS操作系統(tǒng)的紅外熱像儀設(shè)計方案。通過PHOTON640紅外探測器機(jī)芯實(shí)現(xiàn)熱輻射到電信號的轉(zhuǎn)換，轉(zhuǎn)換后的信號通過FPGA采集并調(diào)整時序后直接輸出到DSP的采集VP口。DM642對原始數(shù)據(jù)進(jìn)行校正、測溫等處理后通過網(wǎng)絡(luò)輸出未壓縮的高分辨率紅外圖像，同時通過顯示VP口輸出紅外模擬視頻。

發(fā)表于：6/29/2011

基于FPGA的高速寬帶跳頻發(fā)射機(jī)的中頻設(shè)計

結(jié)合軟件無線電思想和架構(gòu)，利用Altera EP3C16F4 84C6作為中頻信號處理器，設(shè)計了一種基于統(tǒng)一硬件架構(gòu)的數(shù)字化高速寬帶跳頻發(fā)射機(jī)，實(shí)現(xiàn)跳頻速率125kHops/s，跳頻帶寬320MHz。

發(fā)表于：6/29/2011

直接數(shù)字頻率合成器的FPGA實(shí)現(xiàn)

直接數(shù)字頻率合成(DDS)技術(shù)屬第三代頻率合成技術(shù)，與第二代基于鎖相環(huán)頻率合成技術(shù)相比，利用DDS技術(shù)合成的輸出波形具有良好的性能指標(biāo)本。設(shè)計采用Xilinx公司Spartan-3系列的XC3S200芯片和高速16位D／A轉(zhuǎn)換器MAX5885。在DDS的工作原理的基礎(chǔ)上，介紹基于FPGA實(shí)現(xiàn)DDS的設(shè)計方法。通過設(shè)置參數(shù)可以靈活控制輸出頻率和分辨率。設(shè)計出具有精度高，選擇參數(shù)控制輸出信號，產(chǎn)生一個理想的波形。從測試結(jié)果可看出，該系統(tǒng)工作穩(wěn)定、可靠，并具有較好的參考與實(shí)用價值。

發(fā)表于：6/29/2011

基于FPGA的OFDM水聲通信系統(tǒng)定時同步

OFDM系統(tǒng)自身的正交多載波調(diào)制特點(diǎn)，決定了其對同步誤差十分敏感。能否實(shí)現(xiàn)準(zhǔn)確的符號定時同步和載波頻率同步，將直接影響到OFDM通信系統(tǒng)的性能。由于線性調(diào)頻(Linear Frequency Modula-tion，LFM)信號具有良好的時頻聚集性，使得LFM信號適合作為OFDM水聲通信系統(tǒng)的定時同步信號。在接收端，利用LFM信號的自相關(guān)特性檢測其相關(guān)峰的位置，可以實(shí)現(xiàn)OFDM水聲通信系統(tǒng)的定時同步。

發(fā)表于：6/29/2011

基于賽靈思FPGA的硬件加速技術(shù)打造高速系統(tǒng)

設(shè)計人員時常需要通過增加計算能力或額外輸入（或兩者）延長現(xiàn)有的嵌入式系統(tǒng)的壽命。而可編程系統(tǒng)平臺在這里大有用武之地。我們曾經(jīng)希望用安全網(wǎng)絡(luò)連接功能升級一套網(wǎng)絡(luò)可編程系統(tǒng)。安全網(wǎng)絡(luò)連接功能需要加密才能運(yùn)行安全外殼 (SSH)、傳輸層安全 (TLS)、安全套接層(SSL) 或虛擬專用網(wǎng) (VPN) 等協(xié)議。這種安全需求與把各種系統(tǒng)接入因特網(wǎng)的需求同步增長，例如，為了啟用遠(yuǎn)程管理與分布式控制系統(tǒng)。

發(fā)表于：6/29/2011