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設(shè)計(jì)應(yīng)用

精餾過程提餾段溫度的前饋和免疫PID-P串級(jí)控制研究

精餾過程提餾段溫度的前饋和免疫PID-P串級(jí)控制研究[測(cè)試測(cè)量][工業(yè)自動(dòng)化]

借鑒生物免疫反饋響應(yīng)過程的調(diào)節(jié)規(guī)律，針對(duì)精餾過程內(nèi)部機(jī)理復(fù)雜、參數(shù)動(dòng)態(tài)變化的特點(diǎn)，提出一種前饋補(bǔ)償和免疫PID-P串級(jí)控制方法。內(nèi)環(huán)采用P控制器以快速消除再沸器蒸汽壓力不穩(wěn)定波動(dòng)，外環(huán)采用免疫PID控制器以保證提餾段溫度穩(wěn)定在給定值，同時(shí)前饋控制器用于克服外界不可控干擾。結(jié)果表明，該控制策略優(yōu)于常規(guī)控制，具有較強(qiáng)的魯棒性和抗干擾能力。

發(fā)表于：8/2/2018 3:03:23 PM

基于FPGA的CompactPCI Express通信接口模塊設(shè)計(jì)研究與實(shí)現(xiàn)

基于FPGA的CompactPCI Express通信接口模塊設(shè)計(jì)研究與實(shí)現(xiàn)[可編程邏輯][工業(yè)自動(dòng)化]

通信接口模塊用于擴(kuò)展CompactPCI Express總線工業(yè)控制計(jì)算機(jī)系統(tǒng)的通信接口。模塊采用FPGA固核實(shí)現(xiàn)PCI Express接口，并且在FPGA內(nèi)部實(shí)現(xiàn)各種總線接口的IP核，使電路設(shè)計(jì)高度集成化。在電路設(shè)計(jì)過程中通過仿真保證了高速串行電路的信號(hào)完整性。模塊已經(jīng)投入使用，在應(yīng)用過程中性能穩(wěn)定

發(fā)表于：8/2/2018 2:58:30 PM

MIMO系統(tǒng)中低復(fù)雜度的MCMC迭代檢測(cè)算法

MIMO系統(tǒng)中低復(fù)雜度的MCMC迭代檢測(cè)算法 [通信與網(wǎng)絡(luò)][通信網(wǎng)絡(luò)]

針對(duì)多輸入多輸出（MIMO）系統(tǒng)中現(xiàn)行的馬爾科夫鏈蒙特卡洛（MCMC）檢測(cè)算法復(fù)雜度較高的問題，提出了一種SIC-MMSE算法輔助的MCMC檢測(cè)算法，信號(hào)的預(yù)估計(jì)值和軟信息均作為軟輸入軟輸出(SISO)檢測(cè)器的輸入，提高了吉布斯采樣值的可信度，進(jìn)而減少采樣點(diǎn)數(shù)。仿真結(jié)果表明，同樣的信噪比情況下，達(dá)到相同誤碼率時(shí)，與傳統(tǒng)MCMC算法相比，改進(jìn)MCMC算法的復(fù)雜度明顯降低。

發(fā)表于：8/2/2018 2:47:28 PM

基于改進(jìn)加權(quán)航跡關(guān)聯(lián)的異步融合算法與仿真

基于改進(jìn)加權(quán)航跡關(guān)聯(lián)的異步融合算法與仿真[通信與網(wǎng)絡(luò)][航空航天]

在分布式多傳感器信息融合系統(tǒng)中，來自各傳感器的局部航跡往往是不同步的。針對(duì)分布式多傳感器異步航跡關(guān)聯(lián)與融合問題，文中提出一種基于改進(jìn)加權(quán)航跡關(guān)聯(lián)的異步航跡順序融合算法。把多傳感器異步航跡外推校準(zhǔn)到同一時(shí)刻，實(shí)現(xiàn)異步航跡的同步化，再用改進(jìn)的加權(quán)航跡關(guān)聯(lián)算法進(jìn)行航跡關(guān)聯(lián)，并利用順序融合算法對(duì)已關(guān)聯(lián)航跡進(jìn)行融合。仿真結(jié)果表明了該算法的有效性。

發(fā)表于：8/2/2018 2:43:22 PM

高效率線性功率放大器設(shè)計(jì)

高效率線性功率放大器設(shè)計(jì)[模擬設(shè)計(jì)][通信網(wǎng)絡(luò)]

3G信號(hào)的高峰均比和快速的包絡(luò)變化為基站功率放大器的設(shè)計(jì)提出了新的挑戰(zhàn)。結(jié)合Doherty技術(shù)與基帶多項(xiàng)式預(yù)失真技術(shù), 設(shè)計(jì)了一款高效率線性功率放大器。仿真分析得到，放大器在輸出為P1dB到回退6 dB的范圍內(nèi)，效率超過38.4% 。使用碼率為3.686 4 Mcps的CDMA2000信號(hào)源測(cè)試，在輸入功率為38.5 dBm時(shí)，其輸出信號(hào)的ACPR達(dá)到-45 dBc。本設(shè)計(jì)在線性放大的條件下實(shí)現(xiàn)了從P1 dB處回退6 dB范圍的高效率放大器。

發(fā)表于：8/2/2018 2:39:08 PM

基于蟻群算法的可信網(wǎng)絡(luò)路由

基于蟻群算法的可信網(wǎng)絡(luò)路由[通信與網(wǎng)絡(luò)][通信網(wǎng)絡(luò)]

針對(duì)不同的網(wǎng)絡(luò)實(shí)際條件，提出一種基于蟻群算法的可信網(wǎng)絡(luò)路由算法，以尋找網(wǎng)絡(luò)中任意2個(gè)節(jié)點(diǎn)間的最優(yōu)路由。在將鏈路帶寬使用情況作為影響路由重組結(jié)果可信度的因素時(shí)，同時(shí)考慮了路由中節(jié)點(diǎn)間鏈路上的耗費(fèi)和延時(shí)這兩個(gè)因素，實(shí)現(xiàn)了可信的網(wǎng)絡(luò)路由重組。仿真結(jié)果顯示，該方法在較快地找到較低耗費(fèi)和延時(shí)路由的同時(shí)，能夠有效地提高路由重組結(jié)果的可信度。

發(fā)表于：8/2/2018 2:34:47 PM

有源電力濾波器控制器

有源電力濾波器控制器[可編程邏輯][工業(yè)自動(dòng)化]

有源電力濾波器(APF)控制器是APF的關(guān)鍵部分，決定了APF的性能指標(biāo)和補(bǔ)償效果。提出一種新的多環(huán)控制策略和控制器結(jié)構(gòu)，控制器由4個(gè)控制環(huán)組成,分別實(shí)現(xiàn)諧波抑制和無功補(bǔ)償控制、抑制電網(wǎng)與有源濾波器高頻振蕩、有源濾波器的直流母線電壓控制。設(shè)計(jì)了一種基于數(shù)字信號(hào)處理器(DSP)、現(xiàn)場可編程門陣列(FPGA)和復(fù)雜可編程邏輯器件(CPLD)芯片的全數(shù)字控制器,詳細(xì)闡述了控制器的硬件電路及軟件設(shè)計(jì)。實(shí)驗(yàn)結(jié)果表明，該裝置濾波和無功補(bǔ)償效果較好,而且這種控制器的實(shí)時(shí)性和精度比較高。

發(fā)表于：8/2/2018 2:21:17 PM

便攜式時(shí)域反射儀硬件系統(tǒng)設(shè)計(jì)

便攜式時(shí)域反射儀硬件系統(tǒng)設(shè)計(jì) [測(cè)試測(cè)量][工業(yè)自動(dòng)化]

介紹了用于土壤參數(shù)測(cè)量的時(shí)域反射儀硬件系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn)方案，并研制出樣機(jī)TDR-I。該樣機(jī)使用DSP做主控板，利用階躍恢復(fù)二極管(SRD)產(chǎn)生140 ps上升沿的快沿發(fā)射脈沖，采用快慢斜波比較法獲得等效采樣步進(jìn)精度為8.7 ps的取樣脈沖。經(jīng)過實(shí)驗(yàn)數(shù)據(jù)獲取驗(yàn)證，該系統(tǒng)測(cè)量效果良好。

發(fā)表于：8/2/2018 2:15:07 PM

基于TDC的微小電容測(cè)量電路的設(shè)計(jì)

基于TDC的微小電容測(cè)量電路的設(shè)計(jì)[測(cè)試測(cè)量][工業(yè)自動(dòng)化]

提出一種基于TDC（時(shí)間數(shù)字轉(zhuǎn)換）的微小電容測(cè)量電路的設(shè)計(jì)方案。該電路具有功耗低、體積小、抗干擾性強(qiáng)、分辨力高、刷新率高的特點(diǎn)。詳細(xì)闡述了測(cè)量電路的基本原理、具體實(shí)現(xiàn)、參數(shù)配置、標(biāo)定和抗干擾設(shè)計(jì)，并且通過測(cè)量0 pF~3 pF范圍的固定電容和動(dòng)態(tài)電容驗(yàn)證了電路的性能。試驗(yàn)表明電路在10 Hz刷新頻率下分辨力為6 aF；電路在13 kHz刷新頻率下分辨力為610 aF；ENOB（有效精度位）最高可達(dá)22位。

發(fā)表于：8/2/2018 2:09:51 PM

基于生物特征識(shí)別的自動(dòng)勤務(wù)系統(tǒng)設(shè)計(jì)

基于生物特征識(shí)別的自動(dòng)勤務(wù)系統(tǒng)設(shè)計(jì)[可編程邏輯][安防電子]

提出一種基于生物指紋特征提取的小型企事業(yè)單位勤務(wù)系統(tǒng)。介紹了該系統(tǒng)各模塊引入的相關(guān)算法。將這些算法的原理應(yīng)用到系統(tǒng)設(shè)計(jì)中，設(shè)計(jì)出系統(tǒng)各模塊的電路結(jié)構(gòu)，并在FPGA芯片上進(jìn)行了仿真，驗(yàn)證了該系統(tǒng)的可行性。最后提出了該系統(tǒng)的改進(jìn)方案。

發(fā)表于：8/2/2018 1:45:12 PM