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多核DSP與FPGA高速數(shù)據(jù)傳輸系統(tǒng)設(shè)計與實現(xiàn)[可編程邏輯][通信網(wǎng)絡(luò)]

針對嵌入式圖像處理系統(tǒng)中大數(shù)據(jù)量、高傳輸速度及和高實時運算性能的需求，提出一種以多核DSP TMS320C6678為核心的高速數(shù)據(jù)傳輸存儲系統(tǒng)，基于DSP高速串行Rapid IO(SRIO)模塊進行圖像數(shù)據(jù)高速傳輸，使用SRIO模塊的Direct I/O傳輸模式，采用4x接口模式配置，每路接口傳輸速率為3.125 Gb/s，理論傳輸速率為10 Gb/s，同時使用DDR3控制器模塊擴展存儲空間，實現(xiàn)光學(xué)及雷達圖像的共享存儲。通過實驗結(jié)果表明，設(shè)計的SRIO高速傳輸系統(tǒng)傳輸速度超過8 Gb/s，達到理論值的80%以上，滿足大數(shù)據(jù)高速傳輸需求，有效實現(xiàn)了多處理器之間的數(shù)據(jù)傳輸和共享存儲。

發(fā)表于：12/14/2018 1:57:00 PM

基于STM32和PCL6045BL的經(jīng)編機電子橫移系統(tǒng)設(shè)計[嵌入式技術(shù)][工業(yè)自動化]

設(shè)計了一種基于嵌入式微控制器和專用運動控制芯片相結(jié)合的經(jīng)編機電子橫移系統(tǒng)。系統(tǒng)以STM32和PCL6045BL為控制核心，工控機為系統(tǒng)管理支持，交流伺服系統(tǒng)、伺服電動缸及導(dǎo)紗梳櫛為執(zhí)行機構(gòu)，絕對值編碼器為主軸檢測裝置，實現(xiàn)了經(jīng)編機梳櫛橫移運動的穩(wěn)定、準(zhǔn)確執(zhí)行，具備花型變換周期短、花型可在線修改、花型信息存儲空間大、實時檢測與控制等諸多優(yōu)勢。經(jīng)現(xiàn)場實際應(yīng)用表明，該系統(tǒng)達到設(shè)計目的，滿足雙針床拉舍爾經(jīng)編機800橫列/分鐘的生產(chǎn)能力。

發(fā)表于：12/14/2018 1:43:00 PM

基于LoRa無線傳輸技術(shù)的電氣火災(zāi)監(jiān)控系統(tǒng)設(shè)計[通信與網(wǎng)絡(luò)][通信網(wǎng)絡(luò)]

為預(yù)警建筑物尤其是文物古建電氣火災(zāi)的發(fā)生，設(shè)計了一種基于LoRa無線傳輸技術(shù)的電氣火災(zāi)監(jiān)控系統(tǒng)。該系統(tǒng)中探測器通過監(jiān)測線路溫度及剩余電流的數(shù)值大小，采用LoRa無線傳輸技術(shù)將報警信息上傳給監(jiān)控主機通知值班人員，從而預(yù)防電氣火災(zāi)的發(fā)生。在古建內(nèi)的現(xiàn)場測試表明，該系統(tǒng)傳輸距離遠、穿墻效果好。此研究為實現(xiàn)電氣火災(zāi)的無線監(jiān)控報警在文物建筑中的應(yīng)用提供了理論與技術(shù)支撐。

發(fā)表于：12/13/2018 1:13:00 PM

一種基于嵌入式平臺的單兵戰(zhàn)術(shù)訓(xùn)練考核系統(tǒng)[嵌入式技術(shù)][其他]

單兵戰(zhàn)術(shù)動作是士兵在戰(zhàn)斗中的基本動作。傳統(tǒng)的單兵戰(zhàn)術(shù)動作訓(xùn)練考核由人工實現(xiàn)計時及動作判定，存在主觀因素強、檢測準(zhǔn)確率低、數(shù)據(jù)采集存儲效率低等問題，并且尚無有效的解決方法。基于FPGA/MCU平臺設(shè)計并實現(xiàn)了一種單兵戰(zhàn)術(shù)訓(xùn)練考核系統(tǒng)，該系統(tǒng)采用多對主動式對射紅外線光探測器，對訓(xùn)練考核過程中的違規(guī)觸碰信號進行采集，并利用手持終端實現(xiàn)數(shù)據(jù)的無線傳輸。后臺通過對數(shù)據(jù)進行分析給出指導(dǎo)性建議。測試表明，該系統(tǒng)可以較好地解決當(dāng)前單兵戰(zhàn)術(shù)訓(xùn)練考核中存在的問題。

發(fā)表于：12/13/2018 1:05:00 PM

一種應(yīng)用于電網(wǎng)中電力監(jiān)測高精度ADC設(shè)計[模擬設(shè)計][智能電網(wǎng)]

為了滿足電力系統(tǒng)監(jiān)測的需求，設(shè)計實現(xiàn)了一款3 bit 5階sigma-delta ADC，測試結(jié)果表明系統(tǒng)的動態(tài)范圍大于100 dB，有效位數(shù)大于16位，能夠滿足現(xiàn)代電網(wǎng)系統(tǒng)對變壓器AC輸出的測量需求。

發(fā)表于：12/12/2018 1:41:00 PM

基于LM算法的腦電信號分類研究[通信與網(wǎng)絡(luò)][醫(yī)療電子]

為實現(xiàn)運動想象腦電信號的精準(zhǔn)分類，提出以Levenberg－Marquardt算法（LM）替代BP神經(jīng)網(wǎng)絡(luò)構(gòu)造分類器來提高分類識別率。實驗以2008年BCI競賽信號采集模式為標(biāo)準(zhǔn)，使用Emotive Epoc＋采集四類運動想象腦電信號，對采集的信號進行濾波去燥后，利用主成分分析提取特征值；然后分別用LM算法和BP神經(jīng)網(wǎng)路進行分類識別做對比；最后基于MATLAB GUI設(shè)計串口通信界面與Arduino智能車鏈接驗證算法的可行性。結(jié)果證明：該方法訓(xùn)練平均誤差為5.630 6×10-7，分類準(zhǔn)確率為86%，BP算法相對應(yīng)為0.001 4、56%。相對比可知LM算法分類效果良好，驗證過程中，智能車運行與算法識別方向一致，運行良好。此方法切實可行，為后期進一步開發(fā)腦機接口奠定了基礎(chǔ)。

發(fā)表于：12/12/2018 1:29:00 PM

基于SiP技術(shù)的微系統(tǒng)設(shè)計與實現(xiàn)[嵌入式技術(shù)][工業(yè)自動化]

介紹了系統(tǒng)級封裝（System in Package，SiP）技術(shù)，基于SiP技術(shù)設(shè)計了一款由FPGA、ARM、SRAM等裸芯片組成的微系統(tǒng)，介紹了微系統(tǒng)的工作原理，描述了產(chǎn)品的實現(xiàn)流程。該系統(tǒng)具有重量輕、體積小、功能齊全等優(yōu)點。

發(fā)表于：12/11/2018 9:09:00 AM

一種并發(fā)雙頻段CMOS LNA的分析與設(shè)計[模擬設(shè)計][通信網(wǎng)絡(luò)]

基于0.13 μm CMOS工藝，設(shè)計了一種應(yīng)用于WLAN IEEE 802.11 a/b/g標(biāo)準(zhǔn)的并發(fā)雙頻段低噪聲放大器(LNA)。為了在功耗限制下同時實現(xiàn)噪聲系數(shù)和輸入阻抗的匹配，采用共源共柵電感退化拓撲結(jié)構(gòu)。該LNA在2.4 GHz和5.2 GHz下，輸入發(fā)射系數(shù)分別為-16.7 dB和-19.5 dB，正向增益分別為16.8 dB和17.2 dB。而且在2.4 GHz和5.2 GHz下，噪聲系數(shù)分別取得了3.1 dB和3.2 dB，輸入三階截止點分別為-18.5 dBm和-16.5 dBm。該LNA在1.2 V電壓供電下，所消耗的功耗為2.64 mW。

發(fā)表于：12/11/2018 8:54:00 AM

可重構(gòu)陣列處理器中分布式Cache設(shè)計[嵌入式技術(shù)][其他]

隨著片上集成的處理器核數(shù)日益增多，可重構(gòu)陣列處理器中的“存儲墻”問題日益加劇，而傳統(tǒng)采用多級共享Cache硬件設(shè)計復(fù)雜度高，并行訪問度有限，難以滿足可重構(gòu)陣列處理器的訪存需求。設(shè)計了一種本地優(yōu)先、全局共享的“物理分布、邏輯統(tǒng)一”分布式Cache結(jié)構(gòu)，該結(jié)構(gòu)硬件開銷小，并行訪問性高。通過Xilinx公司的Virtex-6系列xc6vlx550T開發(fā)板對設(shè)計進行測試，實驗結(jié)果表明,該結(jié)構(gòu)相比于同類結(jié)構(gòu)，平均延遲減少最高達30%，硬件開銷僅為Cache容量的5%，最高可提供10.512 GB/s的訪存帶寬。

發(fā)表于：12/10/2018 11:35:00 AM

帶隙基準(zhǔn)源單粒子敏感性分析[模擬設(shè)計][其他]

基于一款0.18 μm工藝下常規(guī)設(shè)計帶隙基準(zhǔn)源，使用單粒子瞬態(tài)脈沖電流模型分析了常見CMOS兩級放大器的單粒子敏感性。對于帶隙基準(zhǔn)源中使用的垂直型PNP管使用TCAD軟件建立了三維模型，并通過仿真驗證了其應(yīng)用在帶隙基準(zhǔn)源中的單粒子敏感性。最后，針對帶隙基準(zhǔn)源單粒子敏感特性，提出了整體加固建議。

發(fā)表于：12/10/2018 11:25:00 AM