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開啟工業(yè)4.0：集成EtherCAT和萊迪思FPGA實(shí)現(xiàn)高級(jí)自動(dòng)化

開啟工業(yè)4.0：集成EtherCAT和萊迪思FPGA實(shí)現(xiàn)高級(jí)自動(dòng)化

　　隨著工業(yè)領(lǐng)域向?qū)崿F(xiàn)工業(yè)4.0的目標(biāo)不斷邁進(jìn)，市場(chǎng)對(duì)具備彈性連接、低功耗、高性能和強(qiáng)大安全性的系統(tǒng)需求與日俱增。　　然而，實(shí)施數(shù)字化轉(zhuǎn)型并非總是一帆風(fēng)順。企業(yè)必須在現(xiàn)有環(huán)境中集成這些先進(jìn)系統(tǒng)，同時(shí)應(yīng)對(duì)軟件孤島、互聯(lián)網(wǎng)時(shí)代前的老舊設(shè)備以及根深蒂固的工作流程等挑戰(zhàn)。它們需要能夠在這些限制條件下有針對(duì)性地應(yīng)用高性能軟硬件的解決方案。

Altera StratixIV 100G開發(fā)方案

Altera公司的StratixIV 40nmFPGA包括StratixIVE,StratixIVGX和StratixIVGT三個(gè)系列,具有最高的密度(680K邏輯單元(LE),22.4Mbits嵌入式存儲(chǔ)器和1,360個(gè)18x18乘法器),最佳的性能以及最低的功耗,系統(tǒng)帶寬(8.5Gbps的48個(gè)高速收發(fā)器，以及1,067Mbps(533MHz)DDR3存儲(chǔ)器接口)達(dá)到了前所未有的水平，并具有優(yōu)異的信號(hào)完整性,非常適合無線通信,固網(wǎng),軍事,廣播等其他最終市場(chǎng)中的高端數(shù)字應(yīng)用。本文介紹了StratixIV

發(fā)表于：2/29/2012

實(shí)現(xiàn)基于ARM的嵌入式系統(tǒng)的SoC方法

本文討論用于實(shí)現(xiàn)基于ARM的嵌入式系統(tǒng)的Altera可編程芯片系統(tǒng)（SoC）方法。對(duì)于面臨產(chǎn)品及時(shí)面市、成本、性能、設(shè)計(jì)重用和產(chǎn)品長(zhǎng)壽命等苛刻要求的嵌入式系統(tǒng)開發(fā)人員而言，單芯片方案是非常有價(jià)值的方法。

發(fā)表于：2/29/2012

基于層次型AdaBoost檢測(cè)算法的快速人臉檢測(cè)在FPGA上的實(shí)現(xiàn)

FPGA有著規(guī)整的內(nèi)部邏輯陣列和豐富的連線資源，特別適合于數(shù)字信號(hào)處理，且有良好的并行性和可擴(kuò)展性。因此，特別適用于人臉檢測(cè)中多個(gè)窗口并行處理以及弱特征的并行運(yùn)算。

發(fā)表于：2/28/2012

IPTV系統(tǒng)中FPGA供電要求的復(fù)雜性及其解決方案分析

目前越來越多的家用電器從低速的撥號(hào)上網(wǎng)向?qū)拵Щヂ?lián)網(wǎng)接入或互聯(lián)網(wǎng)協(xié)議電視(IPTV)轉(zhuǎn)移，尤其是IPTV有望在中國(guó)獲得快速的發(fā)展。比較而言，IPTV的基礎(chǔ)設(shè)施成本相當(dāng)?shù)停驗(yàn)檫@種方法不需要銅軸電纜，而是采用DSL或?qū)拵ф溄雍蜋C(jī)頂盒將節(jié)目流傳送到家用電器。

發(fā)表于：2/28/2012

基于CPLD的低功耗爆炸場(chǎng)溫度測(cè)試系統(tǒng)

本次設(shè)計(jì)的溫度測(cè)試系統(tǒng)，采用集成度高、可靠性強(qiáng)、功耗較低的CPLD作為主控單元，運(yùn)用耐高溫高壓、響應(yīng)時(shí)間快的熱電偶作為溫度傳感器，匹配先進(jìn)的電源管理模塊實(shí)現(xiàn)了測(cè)試系統(tǒng)的低功耗，并結(jié)合動(dòng)態(tài)存儲(chǔ)測(cè)試技術(shù)，能夠應(yīng)用于環(huán)境條件比較差的惡劣環(huán)境中，在可靠可信、微功耗的基礎(chǔ)上能得到較好的實(shí)驗(yàn)數(shù)據(jù)。

發(fā)表于：2/27/2012

中頻軟件無線電系統(tǒng)的FPGA實(shí)現(xiàn)方案

本文研究了中頻軟件無線電的實(shí)現(xiàn)方案，并設(shè)計(jì)了基于FPGA的通用硬件平臺(tái)。在此平臺(tái)上，通過PC機(jī)下載軟件，實(shí)時(shí)實(shí)現(xiàn)了軟件無線電中頻至基帶的波形處理和多種不同的調(diào)制解調(diào)方式。

發(fā)表于：2/27/2012

HDTV接收機(jī)呂Viterbi譯碼器的FPGA實(shí)現(xiàn)

本文的FPGA實(shí)現(xiàn)是基于Altera公司Quartus和Maxplus II電路仿真環(huán)境和該公司APEX TM EP20K600EBC652-1XES系列芯片來完成的。應(yīng)用于高精晰度數(shù)字電視COFDM傳輸系統(tǒng)的接收機(jī)頂盒的設(shè)計(jì)中，經(jīng)過性能測(cè)試，達(dá)到了系統(tǒng)指標(biāo)要求。同時(shí)，該設(shè)計(jì)也為HDTV機(jī)頂盒的ASIC設(shè)計(jì)奠定了良好的基礎(chǔ)。

發(fā)表于：2/27/2012

車用FPGA解決方案

汽車電子工程師傳統(tǒng)上利用微控制器、定制ASIC和體積龐大的電線束來引進(jìn)和控制電子系統(tǒng)，并隨著汽車的更新?lián)Q代而擴(kuò)展功能。但是，隨著元件數(shù)量不斷增多、上市時(shí)間壓力日益增大，加上性能要求不斷提升，在在都正促使新型技術(shù)的出現(xiàn)。

發(fā)表于：2/27/2012

FPGA一體化高級(jí)設(shè)計(jì)方法

本文介紹的一體化高級(jí)設(shè)計(jì)方法是通過發(fā)揮 FPGA 主機(jī)的可再編程功能實(shí)現(xiàn)的。所有應(yīng)用的層和接口以及功能設(shè)計(jì)本身都自動(dòng)包含在 FPGA 系統(tǒng)中。因此，與適用于“固定”ASIC 類 SoC 設(shè)計(jì)的傳統(tǒng)流程不同，功能相當(dāng)?shù)母呒?jí) FPGA 能在不嚴(yán)重影響設(shè)計(jì)方案其他部分的情況下動(dòng)態(tài)探索不同的硬件設(shè)計(jì)選擇。

發(fā)表于：2/27/2012

基于FPGA的數(shù)字示波器設(shè)計(jì)

設(shè)計(jì)的數(shù)字示波器系統(tǒng)主要使用了Xilinx系統(tǒng)的開發(fā)環(huán)境，并在此環(huán)境內(nèi)部建立了AD采樣控制模塊、鍵盤控制模塊、VGA顯示模塊等多個(gè)模塊，從很大程度上減少了硬件電路的搭建，也因此提高了系統(tǒng)的穩(wěn)定性和可靠性

發(fā)表于：2/27/2012