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基于FPGA的視頻處理硬件平臺(tái)設(shè)計(jì)與實(shí)現(xiàn)

基于FPGA的視頻處理硬件平臺(tái)設(shè)計(jì)與實(shí)現(xiàn)

為了滿足機(jī)載顯示器畫(huà)面顯示多元化的要求，提出了一種基于FPGA的視頻轉(zhuǎn)換與疊加技術(shù)，該技術(shù)以FPGA為核心，搭配解碼電路及信號(hào)轉(zhuǎn)換電路等外圍電路，可實(shí)現(xiàn)XGA與PAL模擬視頻信號(hào)轉(zhuǎn)換為RGB數(shù)字視頻信號(hào)，并且與數(shù)字圖像信號(hào)疊加顯示，具有很強(qiáng)的通用性和靈活性。實(shí)驗(yàn)結(jié)果表明，視頻轉(zhuǎn)換與疊加技術(shù)能夠滿足機(jī)載顯示器畫(huà)面顯示的穩(wěn)定可靠、高度集成等要求，具備較高的應(yīng)用價(jià)值。

Altera采用Intel的14 nm三柵極技術(shù)開(kāi)發(fā)下一代高性能FPGA

Altera公司和Intel公司今天宣布，雙方已經(jīng)達(dá)成協(xié)議，未來(lái)將采用Intel的14 nm三柵極晶體管技術(shù)制造Altera FPGA。這些下一代產(chǎn)品主要面向軍事、固網(wǎng)通信、云網(wǎng)絡(luò)以及計(jì)算和存儲(chǔ)應(yīng)用等超高性能系統(tǒng)，將突破目前其他技術(shù)無(wú)法解決的性能和功效瓶頸問(wèn)題。

發(fā)表于：2013/2/26

Altera和TSMC繼續(xù)長(zhǎng)期合作

Altera公司(NASDAQ: ALTR)和TSMC (TWSE: 2330, NYSE: TSM)今天再次強(qiáng)調(diào)雙方將繼續(xù)長(zhǎng)期合作，為FPGA創(chuàng)新設(shè)立新里程碑。TSMC是Altera的主要代工線，提供多種工藝技術(shù)實(shí)現(xiàn)Altera的系列產(chǎn)品，包括，即將面市的20 nm產(chǎn)品、現(xiàn)有的主流產(chǎn)品，以及傳統(tǒng)的長(zhǎng)壽命周期元器件等。

發(fā)表于：2013/2/26

Altera為智能電網(wǎng)自動(dòng)化設(shè)備推出基于FPGA的HSR/PRP參考設(shè)計(jì)

Altera公司(NASDAQ: ALTR)今天發(fā)布面向智能電網(wǎng)子站自動(dòng)化設(shè)備的高可用性無(wú)縫冗余(HSR)和并行冗余協(xié)議(PRP)參考設(shè)計(jì)，進(jìn)一步擴(kuò)展了智能能源系統(tǒng)基于FPGA的解決方案。與無(wú)線和固網(wǎng)應(yīng)用網(wǎng)絡(luò)設(shè)備和技術(shù)供應(yīng)商Flexibilis Oy聯(lián)合開(kāi)發(fā)，這一符合IEC 62439-3的參考設(shè)計(jì)包括了Flexibilis冗余交換(FRS)知識(shí)產(chǎn)權(quán)(IP)，在一片Altera®低功耗、低成本Cyclone®FPGA或者Cyclone V SoC中實(shí)現(xiàn)。參考設(shè)計(jì)簡(jiǎn)化了智能電網(wǎng)子站高可靠性關(guān)鍵任務(wù)通信系統(tǒng)的開(kāi)發(fā)和實(shí)現(xiàn)。

發(fā)表于：2013/2/26

英飛凌生產(chǎn)的300毫米薄晶圓通過(guò)質(zhì)量檢驗(yàn) 首個(gè)CoolMOS?家族芯片現(xiàn)已開(kāi)始面向全球發(fā)貨

英飛凌科技股份公司（FSE代碼：IFX / OTCQX代碼：IFNNY）已在生產(chǎn)基于300毫米薄晶圓的功率半導(dǎo)體方面取得了重大突破。今年2月，從奧地利費(fèi)拉赫工廠的300毫米生產(chǎn)線走下來(lái)的英飛凌CoolMOS?家族產(chǎn)品，得到了第一批客戶的首肯。從始至終，基于這項(xiàng)新技術(shù)的生產(chǎn)工藝業(yè)已完成徹底的質(zhì)量檢驗(yàn)，并獲得了客戶認(rèn)可。

發(fā)表于：2013/2/25

賽靈思針對(duì)回程應(yīng)用推出完全自適應(yīng)千兆位級(jí)點(diǎn)對(duì)點(diǎn)微波調(diào)制解調(diào)器IP

All Programmable技術(shù)和器件的全球領(lǐng)先企業(yè)賽靈思公司（Xilinx, Inc. (NASDAQ:XLNX) ）今天宣布推出面向回程應(yīng)用的全新千兆位級(jí)1024QAM點(diǎn)對(duì)點(diǎn)（PtP）微波調(diào)制解調(diào)器IP。這款調(diào)制解調(diào)器解決方案在設(shè)計(jì)過(guò)程中充分采納了一級(jí)OEM廠商的寶貴意見(jiàn)，并采用賽靈思的28nm All Programmable器件。對(duì)于無(wú)線OEM廠商來(lái)說(shuō)，這個(gè)調(diào)制解調(diào)器方案代表了一個(gè)巨大的機(jī)會(huì)，可以支持他們?cè)谄涞统杀靖咝阅芪⒉ɑ爻唐脚_(tái)中集成差異化、靈活性以及可編程等功能。

發(fā)表于：2013/2/25

Achronix開(kāi)始交付其22納米Speedster22i系列FPGA

AchronixSemiconductor公司今日宣布：公司已開(kāi)始將其業(yè)界領(lǐng)先的Speedster®22i HD1000可編程邏輯器件（FPGA）發(fā)運(yùn)給客戶。該器件采用英特爾領(lǐng)先的22納米3D Tri-Gate晶體管技術(shù)，其功耗是競(jìng)爭(zhēng)對(duì)手同類器件的一半。是業(yè)內(nèi)唯一內(nèi)嵌10/40/100G以太網(wǎng)MAC、100Gbps Interlaken、PCI Express Gen1/2/3和2.133 Gbps DDR3控制器硬核的FPGA器件。它能幫助用戶的高帶寬解決方案降低一半成本.

發(fā)表于：2013/2/21

賽靈思針對(duì)大批量應(yīng)用大幅提升設(shè)計(jì)生產(chǎn)力

All Programmable技術(shù)和器件的全球領(lǐng)先企業(yè)賽靈思公司（Xilinx, Inc. (NASDAQ:XLNX) ）今天宣布Artix?-7 FPGA AC701評(píng)估套件正式推出，專門支持開(kāi)發(fā)滿足低成本、低功耗應(yīng)用需求的高性能系統(tǒng)。這款最新評(píng)估套件配套提供All Programmable Artix-7 200T器件，并包括設(shè)計(jì)人員所需的工具、IP和參考設(shè)計(jì)，不僅可以幫助他們快速啟動(dòng)開(kāi)發(fā)工作，同時(shí)又能使其充分利用業(yè)界領(lǐng)先FPGA的單位功耗系統(tǒng)性能優(yōu)勢(shì)。

發(fā)表于：2013/2/20

Synopsys通過(guò)提供經(jīng)生產(chǎn)驗(yàn)證的設(shè)計(jì)工具與IP來(lái)推進(jìn)對(duì)FinFET技術(shù)的采用

為芯片和電子系統(tǒng)加速創(chuàng)新提供軟件、知識(shí)產(chǎn)權(quán)（IP）及服務(wù)的全球性領(lǐng)先供應(yīng)商新思科技公司（Synopsys, Inc.，納斯達(dá)克股票市場(chǎng)代碼：SNPS）日前宣布：即日起提供其基于FinFET技術(shù)的半導(dǎo)體設(shè)計(jì)綜合解決方案。

發(fā)表于：2013/2/19

基于CPLD的ГОСТ18977總線收發(fā)系統(tǒng)設(shè)計(jì)與實(shí)現(xiàn)

針對(duì)現(xiàn)有俄式ГОСТ18977總線的實(shí)現(xiàn)方式中傳輸速率不兼容的問(wèn)題，設(shè)計(jì)并實(shí)現(xiàn)了一種基于CPLD的ГОСТ18977總線收發(fā)系統(tǒng)。該系統(tǒng)利用CPLD進(jìn)行分頻，可兼容不同的總線傳輸速率；并通過(guò)CPLD實(shí)現(xiàn)系統(tǒng)的邏輯設(shè)計(jì)與收發(fā)控制，能夠?qū)崟r(shí)完成總線數(shù)據(jù)的發(fā)送、接收、顯示和存儲(chǔ)功能。

發(fā)表于：2013/2/5

賽靈思領(lǐng)航20nm，繼續(xù)保持領(lǐng)先一代優(yōu)勢(shì)

繼28nm遙遙領(lǐng)先業(yè)界，賽靈思又持續(xù)發(fā)力20nm市場(chǎng)。賽靈思20nm產(chǎn)品系列建立在其業(yè)經(jīng)驗(yàn)證的28nm突破性技術(shù)基礎(chǔ)之上，在系統(tǒng)性能、低功耗和可編程系統(tǒng)集成方面擁有著領(lǐng)先一代的優(yōu)勢(shì)。其20nm產(chǎn)品系列不僅能滿足下一代各種各樣系統(tǒng)的廣泛需求，而且還可為ASIC與ASSP提供極具吸引力的可編程替代方案。

發(fā)表于：2013/2/4