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開啟工業(yè)4.0：集成EtherCAT和萊迪思FPGA實(shí)現(xiàn)高級(jí)自動(dòng)化

開啟工業(yè)4.0：集成EtherCAT和萊迪思FPGA實(shí)現(xiàn)高級(jí)自動(dòng)化

　　隨著工業(yè)領(lǐng)域向?qū)崿F(xiàn)工業(yè)4.0的目標(biāo)不斷邁進(jìn)，市場(chǎng)對(duì)具備彈性連接、低功耗、高性能和強(qiáng)大安全性的系統(tǒng)需求與日俱增。　　然而，實(shí)施數(shù)字化轉(zhuǎn)型并非總是一帆風(fēng)順。企業(yè)必須在現(xiàn)有環(huán)境中集成這些先進(jìn)系統(tǒng)，同時(shí)應(yīng)對(duì)軟件孤島、互聯(lián)網(wǎng)時(shí)代前的老舊設(shè)備以及根深蒂固的工作流程等挑戰(zhàn)。它們需要能夠在這些限制條件下有針對(duì)性地應(yīng)用高性能軟硬件的解決方案。

Perl在ESD保護(hù)電路中研究與應(yīng)用

研究了Perl在ESD保護(hù)電路中的應(yīng)用?；赑erl語(yǔ)言的強(qiáng)大功能，在海量的數(shù)字電路仿真數(shù)據(jù)中準(zhǔn)確地抓取需要的數(shù)據(jù)，并生成文件報(bào)表。同時(shí)為數(shù)字仿真電路的驗(yàn)證提供了一種全新、快速、準(zhǔn)確的方式。

發(fā)表于：4/2/2014

Xilinx推出業(yè)界首款“軟”定義網(wǎng)絡(luò)（SDNet）解決方案

All Programmable技術(shù)和器件的全球領(lǐng)先企業(yè)賽靈思公司(NASDAQ: XLNX) 今天在拉斯維加斯舉行的Interop2014 網(wǎng)絡(luò)通訊展會(huì)上宣布推出業(yè)界首款“軟”定義網(wǎng)絡(luò)(“Softly”Defined Networks)解決方案，將可編程能力和智能化功能從控制層擴(kuò)展至數(shù)據(jù)層。全新SDNet軟件定義規(guī)范環(huán)境可實(shí)現(xiàn)可編程數(shù)據(jù)層功能設(shè)計(jì)，而且功能規(guī)范可自動(dòng)編譯到賽靈思的All Programmable FPGA和SoC中。

發(fā)表于：4/2/2014

華中科技大學(xué)與Synopsys攜手建立ARC處理器聯(lián)合培訓(xùn)中心

為加速芯片和電子系統(tǒng)創(chuàng)新而提供軟件、知識(shí)產(chǎn)權(quán)（IP）及服務(wù)的全球領(lǐng)先供應(yīng)商新思科技公司（Synopsys, Inc.，納斯達(dá)克股票市場(chǎng)代碼：SNPS）日前宣布：Synopsys和華中科技大學(xué)達(dá)成合作協(xié)議，雙方攜手建立“華中科技大學(xué)---Synopsys ARC處理器聯(lián)合培訓(xùn)中心”。

發(fā)表于：3/31/2014

基于PSoC的數(shù)字電壓表設(shè)計(jì)

采用Cypress公司生產(chǎn)的PSoC3芯片實(shí)現(xiàn)了一個(gè)數(shù)字電壓表的設(shè)計(jì)。設(shè)計(jì)使用芯片集成的A/D轉(zhuǎn)換模塊完成模數(shù)轉(zhuǎn)換，并且通過(guò)程序調(diào)用讀取相應(yīng)的數(shù)字量及芯片強(qiáng)大的LCD顯示模塊，將轉(zhuǎn)換后的數(shù)字量和相應(yīng)的模擬量顯示出來(lái)。本設(shè)計(jì)具有硬件設(shè)計(jì)簡(jiǎn)單、軟件設(shè)計(jì)圖形化、可以充分利用PSoC提供的固件元件的優(yōu)點(diǎn)。

發(fā)表于：3/31/2014

紅色颶風(fēng)來(lái)襲，F(xiàn)PGA開發(fā)板Nano2免費(fèi)試用

紅色颶風(fēng)NANO二代嵌入式開發(fā)套件核心芯片采用Xilinx Spartan6系列XC6SLX16 作為核心處理器，板卡集成10/100M百兆網(wǎng)PHY、 DDR3存儲(chǔ)、USB2.0接口，包含PMOD擴(kuò)展，和RM3通用擴(kuò)展接口，方便用戶進(jìn)行Verilog設(shè)計(jì)和Microblaze軟核系統(tǒng)級(jí)開發(fā)。硬件設(shè)計(jì)精小，非常適合于多媒體、自動(dòng)化控制、通信領(lǐng)域以及高校教育領(lǐng)域。ChinaAET特聯(lián)合北京威視銳科技有限公司為該開發(fā)套件提供測(cè)評(píng)！由招募的5名測(cè)評(píng)志愿者進(jìn)行測(cè)評(píng)。

發(fā)表于：3/31/2014

Altera與Intel進(jìn)一步加強(qiáng)合作，開發(fā)多管芯器件

Altera與Intel一起工作開發(fā)多管芯器件，在一個(gè)封裝中高效的集成了單片14 nm Stratix 10 FPGA和SoC與其他先進(jìn)組件，包括DRAM、SRAM、ASIC、處理器和模擬組件。使用高性能異構(gòu)多管芯互聯(lián)技術(shù)來(lái)實(shí)現(xiàn)集成。Altera的異構(gòu)多管芯器件具有傳統(tǒng)2.5和3D方法的優(yōu)勢(shì)，而且成本更低。器件將解決性能、存儲(chǔ)器帶寬和散熱等影響通信、高性能計(jì)算、廣播和軍事領(lǐng)域高端應(yīng)用所面臨的難題。

發(fā)表于：3/27/2014

基于FPGA和單片機(jī)的守時(shí)系統(tǒng)設(shè)計(jì)

介紹守時(shí)系統(tǒng)的重要作用及其發(fā)展現(xiàn)狀，分析了守時(shí)系統(tǒng)發(fā)展過(guò)程中遇到的一些問(wèn)題，設(shè)計(jì)了一個(gè)以GPS/北斗信號(hào)作為時(shí)標(biāo)的守時(shí)系統(tǒng)。采用雙恒溫槽的恒溫晶振MV180作為系統(tǒng)的輸入時(shí)鐘，使用單片機(jī)控制DAC7512對(duì)其頻率進(jìn)行調(diào)整。首先，系統(tǒng)對(duì)調(diào)整后的本地時(shí)鐘信號(hào)進(jìn)行分頻處理，再與GPS/北斗接收到的標(biāo)準(zhǔn)秒信號(hào)進(jìn)行比較，通過(guò)FPGA和單片機(jī)對(duì)分頻后的信號(hào)進(jìn)行相位的調(diào)整，最終輸出標(biāo)準(zhǔn)秒脈沖信號(hào)，從而快速獲得高精度的時(shí)間基準(zhǔn)，并能在GPS/北斗失鎖后對(duì)該信號(hào)進(jìn)行保持，實(shí)現(xiàn)時(shí)間同步。

發(fā)表于：3/26/2014

Altera加入IBM OpenPOWER聯(lián)盟，支持下一代數(shù)據(jù)中心的開發(fā)

Altera公司(Nasdaq: ALTR)今天宣布加入IBM OpenPOWER聯(lián)盟——基于IBM POWER微處理器體系結(jié)構(gòu)的開放開發(fā)聯(lián)盟。Altera將與IBM以及其他OpenPOWER聯(lián)盟成員合作，開發(fā)高性能計(jì)算解決方案，這些方案集成了用于下一代數(shù)據(jù)中心的IBM POWER CPU和Altera基于FPGA的加速技術(shù)。

發(fā)表于：3/26/2014

基于CY7C68013A的USB2.0高速接口設(shè)計(jì)

為了充分利用USB2.0的帶寬，解決數(shù)據(jù)傳輸時(shí)存在的速度瓶頸問(wèn)題，提出了一種基于CY7C68013A的USB2.0高速接口設(shè)計(jì)方法。采用CY7C68013A的SLAVE FIFO工作模式，芯片內(nèi)部CPU不參與數(shù)據(jù)傳輸，F(xiàn)PGA設(shè)計(jì)的外部控制電路直接讀寫芯片內(nèi)部FIFO，有效避免了內(nèi)部CPU參與數(shù)據(jù)傳輸時(shí)帶來(lái)的時(shí)間開銷，從而提高了傳輸速度。

發(fā)表于：3/25/2014

基于FPGA的激光陀螺信號(hào)高速解調(diào)濾波設(shè)計(jì)

在FPGA中實(shí)現(xiàn)DSP和計(jì)算機(jī)常用的IEEE單精度32位浮點(diǎn)表示方式，通過(guò)模塊化設(shè)計(jì)，能夠進(jìn)行相關(guān)的浮點(diǎn)加法和乘法操作。利用內(nèi)部邏輯單元、乘法器、ROM、RAM等資源，經(jīng)過(guò)正確的邏輯控制和可靠的時(shí)序設(shè)計(jì)，設(shè)計(jì)了一個(gè)能對(duì)激光陀螺信號(hào)進(jìn)行高速、精確濾波的專用濾波器，并且更簡(jiǎn)便實(shí)現(xiàn)后續(xù)DSP或計(jì)算機(jī)對(duì)濾波數(shù)據(jù)的格式處理。

發(fā)表于：3/20/2014