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Altera被曝將易主銀湖資本

Altera被曝將易主銀湖資本

2 月 19 日消息，彭博社今天（2 月 19 日）發(fā)布博文，報(bào)道稱私募巨頭銀湖資本（Silver Lake Management）正與英特爾進(jìn)行深入談判，計(jì)劃收購(gòu)其可編程芯片部門 Altera 的多數(shù)股權(quán)。

【0元試用】免費(fèi)申請(qǐng)Altera DE2開發(fā)板

Altera DE2 多媒體開發(fā)平臺(tái)，是學(xué)習(xí)數(shù)字邏輯、計(jì)算機(jī)組織和FPGA方面的一個(gè)理想工具。該板非常適合各大學(xué)課程在實(shí)驗(yàn)室環(huán)境下的一系列設(shè)計(jì)項(xiàng)目和復(fù)雜尖端的數(shù)字系統(tǒng)的開發(fā)和應(yīng)用。

發(fā)表于：8/13/2015

2015亞洲創(chuàng)新設(shè)計(jì)大賽─進(jìn)化?專注完美

由 Altera 和友晶科技連續(xù)舉辦 11 年的『亞洲創(chuàng)新設(shè)計(jì)大賽』，不僅是亞太區(qū)最頂尖的 FPGA 設(shè)計(jì)競(jìng)賽，更是理工學(xué)生視為最高榮譽(yù)的競(jìng)技場(chǎng)。今年總獎(jiǎng)項(xiàng)高達(dá)美金十萬(wàn)元，參加大賽的隊(duì)伍將有機(jī)會(huì)獲得首獎(jiǎng)獎(jiǎng)金 $1,000 美元，以及價(jià)值高達(dá) $8,000 美元，搭載 Altera 最新 Stratix V FPGA 的 DE5-Net 開發(fā)板，作品的技術(shù)文稿也將刊登於『亞太FPGA應(yīng)用工程期刊』及全球線上資料庫(kù)，創(chuàng)造全球曝光的機(jī)會(huì)！

發(fā)表于：8/7/2015

西門子發(fā)布Sirius 3SK2用戶友好型安全繼電器

?Sirius 3SK2最多可實(shí)現(xiàn)六項(xiàng)安全功能，能夠利用軟件進(jìn)行參數(shù)配置 ?用戶友好型軟件界面，只需簡(jiǎn)單的拖放操作即可創(chuàng)建復(fù)雜的安全應(yīng)用 ?市場(chǎng)上最纖巧、可通過軟件配置參數(shù)的安全繼電器

發(fā)表于：8/7/2015

一種易于硬件實(shí)現(xiàn)的LZW算法的應(yīng)用

實(shí)測(cè)表明，遙測(cè)系統(tǒng)傳輸?shù)臄?shù)據(jù)冗余度高達(dá)90％，這嚴(yán)重降低了遙測(cè)系統(tǒng)的工作性能，而目前還沒有針對(duì)遙測(cè)數(shù)據(jù)硬件壓縮系統(tǒng)而設(shè)定的數(shù)據(jù)無(wú)損壓縮的統(tǒng)一標(biāo)準(zhǔn)。為了實(shí)現(xiàn)遙測(cè)數(shù)據(jù)硬件系統(tǒng)的無(wú)損壓縮，通過適當(dāng)增加字典的分配空間，優(yōu)化LZW算法的查找方式，改進(jìn)LZW算法的字典更新方法，調(diào)試出了一種易于硬件實(shí)現(xiàn)的LZW算法。最終，通過軟件仿真及實(shí)際測(cè)試，結(jié)果表明，遙測(cè)數(shù)據(jù)壓縮比達(dá)1.8:1以上，完成了設(shè)計(jì)的預(yù)期目標(biāo)。

發(fā)表于：8/4/2015

基于優(yōu)化DA算法濾波器的設(shè)計(jì)及其FPGA實(shí)現(xiàn)

由于傳統(tǒng)MAC方法在設(shè)計(jì)數(shù)字濾波器時(shí)頻繁使用乘法器，導(dǎo)致整個(gè)系統(tǒng)運(yùn)行速率下降，而一般DA算法在設(shè)計(jì)高階濾波器時(shí)存在查找表規(guī)模過大以至于難以實(shí)現(xiàn)的問題。提出一種優(yōu)化的DA算法來克服這一缺陷，為此設(shè)計(jì)了一個(gè)18階的線性相位結(jié)構(gòu)的FIR低通濾波器，并用Verilog HDL語(yǔ)言在FPGA上實(shí)現(xiàn)，在第三方仿真平臺(tái)Modelsim工具上仿真。仿真結(jié)果與MATLAB計(jì)算的理論值進(jìn)行對(duì)比，驗(yàn)證了此優(yōu)化算法的正確性。

發(fā)表于：8/4/2015

自適應(yīng)壓縮感知的語(yǔ)音壓縮重構(gòu)算法研究

根據(jù)傳統(tǒng)語(yǔ)音信號(hào)的處理過程和語(yǔ)音信號(hào)的特征，提出了利用自適應(yīng)冗余字典KSVD算法、自適應(yīng)觀測(cè)矩陣和SAMP重構(gòu)算法的壓縮重構(gòu)方法，通過仿真分析，并與普通壓縮感知對(duì)比平均幀重構(gòu)信噪比、相對(duì)誤差，驗(yàn)證了壓縮感知自適應(yīng)算法的優(yōu)越性。

發(fā)表于：8/3/2015

基于PCIe總線的多路實(shí)時(shí)傳輸系統(tǒng)設(shè)計(jì)

針對(duì)多路圖像數(shù)據(jù)的傳輸及處理帶寬需求，使用Virtex-6 FPGA設(shè)計(jì)實(shí)現(xiàn)了基于PCIe總線的多路實(shí)時(shí)傳輸系統(tǒng)。該系統(tǒng)主要包括仲裁控制多設(shè)備對(duì)DDR3的訪問，采用PCIe Bus Master DMA方式實(shí)現(xiàn)與PC之間的高速傳輸，以及對(duì)全雙工傳輸過程中存在的擁堵問題進(jìn)行優(yōu)化。實(shí)驗(yàn)結(jié)果表明，該實(shí)時(shí)傳輸系統(tǒng)最高的傳輸速率可以達(dá)到單工寫1 632 MB/s，讀1 557 MB/s，全雙工寫1 478 MB/s，讀1 439 MB/s，并且性能穩(wěn)定，完全滿足多路圖像采集后的高速傳輸處理需求。

發(fā)表于：8/2/2015

基于FPGA的高頻視覺刺激控制器的設(shè)計(jì)

研究穩(wěn)態(tài)視覺誘發(fā)電位需要視覺刺激器生成高頻刺激信號(hào)。而傳統(tǒng)的刺激器在產(chǎn)生高頻圖像刺激時(shí)的準(zhǔn)確性和同步性極差，并且使用不便、刺激模式單一。鑒于此，設(shè)計(jì)了一個(gè)高頻視覺刺激控制器，以FPGA為控制器并采用硬件描述語(yǔ)言Verilog HDL設(shè)計(jì)程序，實(shí)現(xiàn)圖像刺激的生成。實(shí)驗(yàn)結(jié)果顯示，設(shè)計(jì)的視覺刺激控制器具備時(shí)間精度高、準(zhǔn)確性高和同步性好的優(yōu)點(diǎn)，能有效地生成高頻刺激信號(hào)。

發(fā)表于：8/1/2015

TI發(fā)布32位ADC實(shí)現(xiàn)同類產(chǎn)品中最佳性能和特性并具備兩者兼具的設(shè)計(jì)

2015年7月28日，北京訊日前，德州儀器 (TI) 推出了一對(duì)32位增量-累加模數(shù)轉(zhuǎn)換器 (ADC)，這兩款器件將高分辨率、低噪聲和集成故障檢測(cè)組合在一起，這成功解決了過去在器件評(píng)估和選型時(shí)，所需的性能和特性無(wú)法兼得的問題。此外，ADS1262和ADS1263具備高集成度且傳感器即時(shí)可用，還免除了那些會(huì)增加系統(tǒng)成本、降低噪聲和漂移性能的外部組件。

發(fā)表于：7/29/2015

美高森美推出汽車等級(jí)SoC FPGA和FPGA器件

致力于在電源、安全、可靠和性能方面提供差異化半導(dǎo)體技術(shù)方案的領(lǐng)先供應(yīng)商美高森美公司(Microsemi Corporation，紐約納斯達(dá)克交易所代號(hào)：MSCC) 宣布提供全新汽車等級(jí)現(xiàn)場(chǎng)可編程門陣列(FPGA)和系統(tǒng)級(jí)芯片(SoC) FPGA器件。基于閃存的下一代低功率 FPGA和ARM® Cortex®-M3使能SoC FPGA器件已經(jīng)獲得AEC-Q100等級(jí)2認(rèn)證，這是概述電子元器件標(biāo)準(zhǔn)以期確保最終系統(tǒng)可滿足汽車可靠性水平要求的行業(yè)標(biāo)準(zhǔn)規(guī)范。新的汽車等級(jí)合格 SmartFusion®2和 IGLOO®2 器件是提供對(duì)于汽車應(yīng)用至關(guān)重要的先進(jìn)安全性和高可靠性的業(yè)界唯一器件。

發(fā)表于：7/29/2015