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頭條

英偉達官宣：CUDA將全面支持RISC-V架構！

早在2024年10月，英偉達在RISC-V北美峰會上透露，其在2015年就選定將RISC-V選定為其專有Falcon微控制器（MCU）的繼任架構。由于 MCU 內核是通用的，因此可以在英偉達的產(chǎn)品中廣泛使用。根據(jù)英偉達當時的預計，2024年英偉達將交付10億個內置于其 GPU、CPU、SoC 和其他產(chǎn)品中的 RISC-V 處理器，這也凸顯了定制 RISC-V 內核在英偉達硬件中的普遍性和重要性。在此次RISC-V中國峰會上，F(xiàn)rans Sijstermanns也指出，英偉達是RVI和RISE的董事會成員和技術委員會代表，也是相關規(guī)范的貢獻者。英偉達產(chǎn)品中的微控制器都是基于RISC-V架構，具有可配置、可擴展和安全保護功能，并且也被集成在30多個IP中，每年出貨量超過10億個RISC-V MCU。

學子專區(qū)—ADALM2000實驗：心跳監(jiān)測電路

　　本實驗活動通過旨在獲取心跳信息的實際范例，介紹了如何使用放大器鏈實現(xiàn)增益和濾波。系統(tǒng)的結果提供相關輸出，使用Scopy軟件工具可顯示該輸出。

發(fā)表于：7/17/2023

第三屆中國集成電路設計創(chuàng)新大會暨IC應用博覽會舉行

7月13日，以“應用引領集成電路產(chǎn)業(yè)高質量發(fā)展”為主題的第三屆中國集成電路設計創(chuàng)新大會暨IC應用博覽會（ICDIA 2023）舉行?？萍疾恐卮髮ｍ椝靖彼鹃L邱鋼，省科技廳二級巡視員楊小平，副市長周文棟，國家01專項技術總師、中國集成電路設計創(chuàng)新聯(lián)盟理事長、清華大學教授魏少軍，高新區(qū)黨工委副書記、管委會副主任、新吳區(qū)委副書記、區(qū)長章金偉，區(qū)領導顧國棟、劉成參加相關活動。

發(fā)表于：7/17/2023

基于阻抗匹配器的二極管幅-相檢測電路設計

半導體芯片領域的競爭很大程度上取決于半導體裝備以及核心零部件的競爭，如射頻電源、阻抗匹配器等。設備的抗干擾能力以及穩(wěn)定性等特性是衡量設備優(yōu)劣的重要標準。對于阻抗匹配器而言，控制回路的精準、穩(wěn)定以及快速響應是決定阻抗匹配器這款產(chǎn)品性能好壞的重要指標。因此，基于電容分壓采樣、電流互感器采樣以及運放電路等相關原理，設計了一款純硬件電路的阻抗幅值、相位檢測回路，并用仿真軟件ADS2021進行模擬仿真實驗，得到表征射頻電源和負載之間阻抗匹配程度的模擬量Urms。通過實驗測試表明，Urms越大表征射頻源與負載之間失配越嚴重，功率傳輸效率越低；Urms越小表征射頻源和負載之間的匹配程度越好，功率傳輸效率越高。同時，通過改變母線信號的輸入功率，得到Urms與輸入功率具有較高的線性相關性，因此該檢測回路具有很好的穩(wěn)定性，能夠適用于寬范圍匹配器阻抗的幅值、相位檢測。關鍵詞：阻抗匹配,Urms,幅值-相位信號,線性相關

發(fā)表于：7/11/2023

一種通用的底層驅動程序設計

提出了一種通用的底層驅動程序設計方法，適用于不同架構的芯片驅動的開發(fā)。這是一種自上而下的軟件結構，采用C語言進行編寫。在確立好頂層框架后，可以多人協(xié)作完成各個模塊驅動程序的開發(fā)，從而快速進入調試階段，大大縮短了驅動程序的開發(fā)流程，節(jié)約了時間，提升了工作效率。在這種驅動程序的基礎上可以進一步開發(fā)芯片的測試程序以及應用程序。

發(fā)表于：7/11/2023

控制系統(tǒng)中智能計算的設計與實現(xiàn)方法

在SCADA組態(tài)軟件系統(tǒng)中，智能計算是必不可少的一個環(huán)節(jié)。它在處理各個采集點之間的邏輯關系、一些時序類采集點的累計、平均、積分等以及一些熱工領域的蒸汽表函數(shù)時體現(xiàn)了極大的優(yōu)越性和便利性。描述了一種控制系統(tǒng)中智能計算的設計和實現(xiàn)方法，首先提出了組合宏和組態(tài)Tag的嵌套調用概念，然后分別介紹了計算模塊處理流程、組合宏基本定義、軟件模塊劃分及調用、計算組態(tài)工具的設計、內存索引表設計、全局和局部變量設計、計算負荷均分設計、在線處理的計算類設計以及計算處理的接口函數(shù)設計等。該系統(tǒng)設計思想先進，實時性高，組態(tài)便捷快速，計算準確無誤，已經(jīng)廣泛應用于多個領域的工業(yè)控制系統(tǒng)。

發(fā)表于：7/11/2023

基于模糊特征選擇的電子鼻陣列優(yōu)化算法研究

電子鼻傳感器陣列具有維數(shù)高、交叉敏感性強等特點，不恰當?shù)膫鞲衅鹘M合易導致選擇重疊、性能下降。目前，基于信息論的陣列優(yōu)化算法往往依賴個體判別能力進行特征選擇，在估計特征多相關關系時存在一定困難，且缺乏對特征互補性和依賴性的考量。針對這些問題，提出了一種基于模糊互信息的陣列優(yōu)化算法（Sensor Array Optimization Algorithm Based On Fuzzy Mutual Information， FMI-SAO），通過模糊聯(lián)合矩陣估計特征冗余，利用前向迭代選擇策略挖掘具有高相關、低冗余、高互補、高依賴的特征。實驗證明，F(xiàn)MI-SAO獲得的傳感器陣列在不同的模式識別算法中均可獲得更高的精度。

發(fā)表于：7/11/2023

支持多協(xié)議的可配置通信引擎設計

針對國內對于專用通信引擎的研究空缺，實現(xiàn)了一種支持多協(xié)議的可配置通信引擎設計，并以典型的數(shù)據(jù)鏈路層協(xié)議——高級數(shù)據(jù)鏈路控制（High 1evel Data Link Control， HDLC）協(xié)議的引擎塊實現(xiàn)為例，采用System Verilog搭建仿真平臺，通過C語言編寫測試case，以回環(huán)驗證的方式保證設計正確性?？膳渲靡鎵K以自研RSIC核為核心，采用AHB總線互連，內部集成HDLC、UART等通信協(xié)議以及DMA、TDM、GPIO等通用外設，實現(xiàn)通信協(xié)議的處理及數(shù)據(jù)傳輸，有助于解放處理器負載，提高數(shù)據(jù)處理效率，同時將HDLC與可配置通信引擎相結合，解決了多路信號的HDLC對處理器資源的占用率高等問題。

發(fā)表于：7/11/2023

一種小型化可復用的接收前端的設計與實現(xiàn)

設計了一款衛(wèi)星通信領域的小型化可復用的接收前端，將950 MHz~2 150 MHz射頻信號經(jīng)過預選濾波、放大、混頻等過程，下變頻至720 MHz中頻輸出。首先介紹了電路的設計方案，并對主要技術指標進行了分析。接收前端的尺寸為105 mm×55 mm×9.5 mm。實現(xiàn)了小型化、通用化設計，可以復用在多種衛(wèi)星通信設備。

發(fā)表于：7/11/2023

W頻段波導氣密結構的功率合成放大器設計

針對3 mm頻段功率合成的需要，設計了一種波導氣密結構的4合1放大器，用來實現(xiàn)W頻段瓦級的氣密功率合成輸出。本設計引入硅基結構實現(xiàn)了W頻段組件的氣密，解決了傳統(tǒng)3 mm頻段波導組件難以氣密的難題。本設計基于波導合路原理，運用高頻結構仿真軟件對氣密波導合路結構進行了建模與仿真。通過對比模型的仿真結果與樣機實測數(shù)據(jù)，表明該W頻段波導氣密功率合成放大器的指標可滿足設計要求。

發(fā)表于：7/11/2023

S頻段500 W高穩(wěn)相固態(tài)功放設計

介紹了一種S頻段500 W高穩(wěn)相固態(tài)功放的工程實現(xiàn)。根據(jù)實際工程需求，采用4片功率芯片進行大功率合成，在2 025 MHz~2 120 MHz頻率范圍內實現(xiàn)輸出功率大于600 W的固態(tài)功率放大器。采用了低附加相移電路設計、微波板材模塊化設計、功率回退等措施，實現(xiàn)了在0℃~30℃的環(huán)境溫度條件下，輸出功率在1 W~500 W功率范圍內，功放輸出端相位變化小于11.5°，滿足了厘米級擴頻測控系統(tǒng)對S頻段固態(tài)功放的工程技術要求。

發(fā)表于：7/11/2023