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AMD慶祝賽靈思成立40周年

AMD慶祝賽靈思成立40周年

40 年前，賽靈思（Xilinx）推出了一種革命性的設備，讓工程師可以在辦公桌上使用邏輯編程。賽靈思開發(fā)的現(xiàn)場可編程門陣列（FPGA）使工程師能夠將具有自定義邏輯的比特流下載到臺式編程器中立即運行，而無需等待數(shù)周才能從晶圓廠返回芯片。如果出現(xiàn)錯誤或問題，設備可以在那里重新編程。

如何用插值查找表簡便實現(xiàn)FPGA的DSP功能

值查找表是實施賽靈思FPGA的DSP功能的簡便而強大的方法。插值查找表可幫助您在保持面積占用相對較低的情況下實現(xiàn)極高數(shù)值精度 (SNR) 和高數(shù)據(jù)速率。

發(fā)表于：12/5/2010

基于FPGA的SPI總線接口的實現(xiàn)

在現(xiàn)代EDA外圍電子器件的接口中存在多種標準，已知的一些接口協(xié)議存在速度慢、協(xié)議復雜等問題。SPI總線是能夠克服上述缺點的一種外圍串行總線，其能很好地滿足要求。通過使用Lattice公司的FPGA芯片以及工程開發(fā)軟件，特別是在線邏輯分析儀這一先進的EDA工具，實現(xiàn)了基于FPGA的SPI接口的連接。將FPGA編程的靈活性和SPI總線的易用性結合，實現(xiàn)了FLASH的存取功能。同時也為同類型接口的芯片應用提供了一個原型，為進一步的工程設計提供了支持。

發(fā)表于：12/5/2010

基于CPLD的壓電生物傳感器檢測電路設計

介紹了一種基于復雜可編程邏輯器件(CPLD)的壓電生物傳感器檢測電路。該檢測電路以高性能CPLD(MAX7128)為核心，實現(xiàn)了對壓電生物傳感器10MHz高頻信號的測量與采集，以及所采集的頻率數(shù)據(jù)動態(tài)、實時顯示以及頻率數(shù)據(jù)串行通信等功能。

發(fā)表于：12/5/2010

基于FPGA 的低成本長距離高速傳輸系統(tǒng)的設計與實現(xiàn)

為解決目前高速信號處理中的數(shù)據(jù)傳輸速度瓶頸以及傳輸距離的問題，設計并實現(xiàn)了一種基于FPGA 的高速數(shù)據(jù)傳輸系統(tǒng)，本系統(tǒng)借助Altera Cyclone III FPGA 的LVDS I/O 通道產生LVDS 信號，穩(wěn)定地完成了數(shù)據(jù)的高速、遠距離傳輸。系統(tǒng)所需的8B/10B 編解碼、數(shù)據(jù)時鐘恢復(CDR)、串/并行轉換電路、誤碼率計算模塊均在FPGA 內利用VHDL 語言設計實現(xiàn)，大大降低了系統(tǒng)互聯(lián)的復雜度和成本，提高了系統(tǒng)集成度和穩(wěn)定性。

發(fā)表于：12/4/2010

美研發(fā)出“混沌門” 對半導體工業(yè)意義重大

美國亞利桑那州立大學的研究人員表示，他們研發(fā)出了能夠取代傳統(tǒng)邏輯門的“混沌門”（chaogates），該成果對半導體工業(yè)的發(fā)展具有十分重要的意義。相關論文發(fā)表在美國物理學會出版的《混沌》雜志上。對于何

發(fā)表于：12/3/2010

Fusion混合信號FPGA推出擴展溫度等級型款

美高森美公司(Microsemi Corporation)宣布提供100% 通過 -55°C至 +100°C溫度范圍測試的Fusion混合信號FPGA器件。這一項性能提升使美高森美能夠將Fusion器件獨特的混合信號綜合優(yōu)勢帶至必須在極端溫度下保持高可靠性運作的軍事、航空和防御行業(yè)。設計人員能夠利用Fusion器件固有的可重編程、高可靠性和非易失性等特性，以及固件錯誤免疫能力的附加優(yōu)勢。另外，F(xiàn)usion混合信號FPGA在單芯片中集成了模擬和數(shù)字部件，更能顯著減少電路板空間。

發(fā)表于：12/2/2010

基于FPGA的卷積編譯碼器的設計與實現(xiàn)

摘要：為了解決傳統(tǒng)的維特比譯碼器結構復雜、譯碼速度慢、消耗資源大的問題，提出一種新型的適用于FPGA特點，路徑存儲與譯碼輸出并行工作，同步存儲路徑矢量和狀態(tài)矢量的譯碼器設計方案。該設計方案通過在ISE9.2i中仿

發(fā)表于：12/2/2010

Micrium RTOS支持賽普拉斯PSoC 5開發(fā)平臺

PSoC5中獨特的可編程模擬和數(shù)字外設與高性能的32-bitARMCortex-M3處理器，使之能夠適應工業(yè)、醫(yī)療、汽車以及消費電子設備的嚴苛要求。PSoC5器件具有業(yè)界領先的集成模擬資源以及強大的基于PLD的通用數(shù)字模塊，可以構建標準和定制化的數(shù)字外設。

發(fā)表于：12/1/2010

基于CPLD的多路選擇器在舞臺吊桿控制系統(tǒng)中的應用

給出了基于Altera公司的MAXⅡ系列芯片EPM570T144C5設計的多路選擇器，介紹了多路選擇器的應用、硬件結構、串行通信協(xié)議及軟件設計，并給出了調試的結果。

發(fā)表于：11/29/2010

基于多DSP+FPGA的衛(wèi)星遙感圖像壓縮系統(tǒng)設計

目前的衛(wèi)星遙感圖像壓縮系統(tǒng)硬件方案大多基于高性能可編程邏輯器件FPGA[2-4]。但這種方案整系統(tǒng)成本居高不下，且FPGA存在單粒子翻轉效應。因此，筆者提出一種多DSP+FPGA的硬件設計結構，使用DSP取代FPGA完成核心算法，而僅用一個FPGA進行管理和控制。該硬件設計成本較低。1基于雙正交疊式變換的低復雜度圖像壓縮方法1.1雙正交重疊變換的快速整數(shù)實現(xiàn)在有損壓縮中，通常先對圖像矩陣進行正交/雙正交變換，使能量分布集中，表示更為稀疏。離散余弦變換(DCT)由于具有良好的去相關效果，并且存在相應的快速算法，應用廣泛。雙正交重疊變換繼承了DCT計算簡便、存儲要求低的特點，同時克服了DCT的塊效應。這里以LBT為藍本提出雙正交重疊變換的快速整數(shù)實現(xiàn)算法，所有系數(shù)均采用分母為2的冪、分子為整數(shù)的分數(shù)近似，從而使整個變換過程只需要整數(shù)加法和位移運算。圖1給出了一維binLBT的實現(xiàn)流程，二維變換按先行后列的順序分別進行一維變換。1.2零樹編碼的簡化與改進SPIHT作為一種高效零樹編碼方法，對位平面進行了集合劃分，將大量的非重要位0集中到幾個具有特定模式的集合里面，并對含有重要位的此類集合進行劃分，直至將集合劃分為具

發(fā)表于：11/29/2010