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開啟工業(yè)4.0：集成EtherCAT和萊迪思FPGA實(shí)現(xiàn)高級(jí)自動(dòng)化

開啟工業(yè)4.0：集成EtherCAT和萊迪思FPGA實(shí)現(xiàn)高級(jí)自動(dòng)化

　　隨著工業(yè)領(lǐng)域向?qū)崿F(xiàn)工業(yè)4.0的目標(biāo)不斷邁進(jìn)，市場(chǎng)對(duì)具備彈性連接、低功耗、高性能和強(qiáng)大安全性的系統(tǒng)需求與日俱增。　　然而，實(shí)施數(shù)字化轉(zhuǎn)型并非總是一帆風(fēng)順。企業(yè)必須在現(xiàn)有環(huán)境中集成這些先進(jìn)系統(tǒng)，同時(shí)應(yīng)對(duì)軟件孤島、互聯(lián)網(wǎng)時(shí)代前的老舊設(shè)備以及根深蒂固的工作流程等挑戰(zhàn)。它們需要能夠在這些限制條件下有針對(duì)性地應(yīng)用高性能軟硬件的解決方案。

基于FPGA的高速高精度頻率測(cè)量的研究

常用的直接測(cè)頻方法在實(shí)用中有較大的局限性，其測(cè)量精度隨著被測(cè)信號(hào)頻率的下降而降低，并且對(duì)被測(cè)信號(hào)的計(jì)數(shù)要產(chǎn)生±1個(gè)數(shù)字誤差。采用等精度頻率測(cè)量方法具有測(cè)量精度，測(cè)量精度保持恒定，不隨所測(cè)信號(hào)的變化而變化.

發(fā)表于：10/29/2010

賽靈思堆疊硅片技術(shù)常見問題解答

賽靈思堆疊硅片互聯(lián)技術(shù)超越摩爾定律，為FPGA帶來全新密度、帶寬和功耗優(yōu)勢(shì)。

發(fā)表于：10/28/2010

賽靈思全球首發(fā)堆疊硅片互聯(lián)技術(shù)將應(yīng)用于28nm Virtex-7產(chǎn)品中

日前，全球可編程平臺(tái)領(lǐng)導(dǎo)廠商賽靈思公司（Xilinx, Inc. (NASDAQ:XLNX) ）宣布推出業(yè)界首項(xiàng)堆疊硅片互聯(lián)技術(shù)，即通過在單個(gè)封裝中集成多個(gè)FPGA 芯片，實(shí)現(xiàn)突破性的容量、帶寬和功耗優(yōu)勢(shì)，以滿足那些需要高密度晶體管和邏輯，以及需要極大的處理能力和帶寬性能的市場(chǎng)應(yīng)用。

發(fā)表于：10/28/2010

基于ZigBee與紅外的家居監(jiān)控系統(tǒng)

在介紹了ZigBee技術(shù)的興起背景及優(yōu)勢(shì)的基礎(chǔ)上，重點(diǎn)探討了ZigBee無線技術(shù)在家居監(jiān)控系統(tǒng)中的應(yīng)用，并給出了一套基于ZigBee和紅外技術(shù)的無線家居監(jiān)控系統(tǒng)的設(shè)計(jì)方案。系統(tǒng)以CC2430為核心控制器并結(jié)合紅外技術(shù)實(shí)現(xiàn)了對(duì)紅外遙控型家電的兼容，能夠監(jiān)測(cè)家居環(huán)境并控制多種類型終端家電。測(cè)試表明：在250m2的房間里，該系統(tǒng)的ZigBee信號(hào)能有效覆蓋。系統(tǒng)擴(kuò)展性強(qiáng)，可靠性高，具有非常廣闊的市場(chǎng)應(yīng)用前景。

發(fā)表于：10/28/2010

基于CPLD技術(shù)的槍械電磁扳機(jī)控制儀設(shè)計(jì)

針對(duì)目前靶場(chǎng)測(cè)試領(lǐng)域尤其是外彈道測(cè)試通常采用人工擊發(fā)槍械的方式，存在安全性差、無法精確控制等問題，設(shè)計(jì)一種基于CPLD技術(shù)的槍械電磁扳機(jī)控制儀。采用步進(jìn)電機(jī)作為執(zhí)行單元，CPLD作為主控制器實(shí)現(xiàn)邏輯控制、通信功能。設(shè)計(jì)中著重考慮了電磁兼容及安全性，通過機(jī)械及電氣兩部分聯(lián)鎖確保控制儀無誤觸發(fā)。通過靶場(chǎng)試驗(yàn)，該控制儀能夠適應(yīng)靶場(chǎng)電磁環(huán)境，而且對(duì)其他儀器無干擾，其通信功能還可實(shí)現(xiàn)整體測(cè)試系統(tǒng)的同步性、自動(dòng)化、網(wǎng)絡(luò)化及遠(yuǎn)程控制。

發(fā)表于：10/27/2010

可重配置FPGA使創(chuàng)新器件更易實(shí)現(xiàn)

由于系統(tǒng)日趨復(fù)雜，在成本、開發(fā)板容量及功耗均面臨嚴(yán)苛限制的今天，設(shè)計(jì)人員往往需要以更少的資源實(shí)現(xiàn)更高的目標(biāo)，而FPGA的可配置能力加上其固有的可編程性，使其成為設(shè)計(jì)人員的一項(xiàng)重要選擇。

發(fā)表于：10/27/2010

基于FPGA的復(fù)數(shù)浮點(diǎn)協(xié)方差矩陣實(shí)現(xiàn)

本文以空間譜估計(jì)作為研究背景，研究了復(fù)數(shù)據(jù)運(yùn)算和浮點(diǎn)運(yùn)算的特點(diǎn)，提出了一種適用于任何陣列流型、任意陣元的基于復(fù)數(shù)浮點(diǎn)運(yùn)算的協(xié)方差矩陣的FPGA實(shí)現(xiàn)方案。

發(fā)表于：10/27/2010

一種基于FPGA和單片機(jī)的掃頻儀設(shè)計(jì)與實(shí)現(xiàn)

一個(gè)網(wǎng)絡(luò)的頻率特性包括幅頻特性和相頻特性，在系統(tǒng)設(shè)計(jì)時(shí)，各個(gè)網(wǎng)絡(luò)的頻率特性對(duì)該系統(tǒng)的穩(wěn)定性、工作頻帶、傳輸特性等都具有重要影響。實(shí)際操作中，掃頻儀大大簡(jiǎn)化了測(cè)量操作，提高了工作效率，達(dá)到了測(cè)量過程快速、直觀、準(zhǔn)確、方便的目的，在生產(chǎn)、科研、教學(xué)上得到廣泛運(yùn)用。本設(shè)計(jì)采用數(shù)字頻率合成技術(shù)產(chǎn)生掃頻信號(hào)，以單片機(jī)和FPGA為控制核心，通過A／D和D／A轉(zhuǎn)換器等接口電路，實(shí)現(xiàn)掃頻信號(hào)頻率的步進(jìn)調(diào)整、數(shù)字顯示及被測(cè)網(wǎng)絡(luò)幅頻特性與相頻特性參數(shù)的顯示

發(fā)表于：10/26/2010

一種基于FPGA的三軸伺服控制器的設(shè)計(jì)優(yōu)化

目前伺服控制器的設(shè)計(jì)多以DSP或MCU為控制核心，但DSP的靈活性不如FPGA，且在某些環(huán)境比較惡劣的條件如高溫...

發(fā)表于：10/26/2010

基于異步FIFO和PLL的雷達(dá)數(shù)據(jù)采集系統(tǒng)

結(jié)合高速嵌入式數(shù)據(jù)采集系統(tǒng)，提出一種基于CvcloneⅢFPGA實(shí)現(xiàn)的異步FIFO和鎖相環(huán)(PLL)結(jié)構(gòu)來實(shí)現(xiàn)高速緩存，該結(jié)構(gòu)可成倍提高數(shù)據(jù)流通速率，增加數(shù)據(jù)采集系統(tǒng)的實(shí)時(shí)性。

發(fā)表于：10/22/2010