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開(kāi)啟工業(yè)4.0：集成EtherCAT和萊迪思FPGA實(shí)現(xiàn)高級(jí)自動(dòng)化

開(kāi)啟工業(yè)4.0：集成EtherCAT和萊迪思FPGA實(shí)現(xiàn)高級(jí)自動(dòng)化

　　隨著工業(yè)領(lǐng)域向?qū)崿F(xiàn)工業(yè)4.0的目標(biāo)不斷邁進(jìn)，市場(chǎng)對(duì)具備彈性連接、低功耗、高性能和強(qiáng)大安全性的系統(tǒng)需求與日俱增。　　然而，實(shí)施數(shù)字化轉(zhuǎn)型并非總是一帆風(fēng)順。企業(yè)必須在現(xiàn)有環(huán)境中集成這些先進(jìn)系統(tǒng)，同時(shí)應(yīng)對(duì)軟件孤島、互聯(lián)網(wǎng)時(shí)代前的老舊設(shè)備以及根深蒂固的工作流程等挑戰(zhàn)。它們需要能夠在這些限制條件下有針對(duì)性地應(yīng)用高性能軟硬件的解決方案。

基于FPGA與USB2.0的實(shí)時(shí)數(shù)據(jù)采集與處理系統(tǒng)

介紹了一種基于FPGA與USB2.0的雙通道實(shí)時(shí)數(shù)據(jù)采集與處理系統(tǒng)。該系統(tǒng)采用XC3S1200E芯片作為核心處理芯片，CY7C68013作為USB接口芯片，通過(guò)FPGA內(nèi)部的控制模塊控制A/D數(shù)據(jù)轉(zhuǎn)換和USB的數(shù)據(jù)傳輸，并在FPGA內(nèi)部完成數(shù)據(jù)的處理。實(shí)驗(yàn)證明，該系統(tǒng)基本能滿足設(shè)計(jì)的要求，計(jì)算出所求粒子的直徑。

發(fā)表于：12/12/2011

基于STM32和CPLD的等精度測(cè)頻設(shè)計(jì)

本文中提出一種基于ARM與CPLD寬頻帶的數(shù)字頻率計(jì)的設(shè)計(jì)，以微控器STM32作為核心控制芯片，利用CPLD可編程邏輯器件，實(shí)現(xiàn)閘門測(cè)量技術(shù)的等精度測(cè)頻。

發(fā)表于：12/10/2011

賽靈思客戶喜獲首批Zynq-7000 器件 — 全球第一款可擴(kuò)展處理平臺(tái)

全球可編程平臺(tái)領(lǐng)導(dǎo)廠商賽靈思公司 (Xilinx, Inc. (NASDAQ:XLNX) ) 今天宣布向客戶交付首批 Zynq?-7000 可擴(kuò)展處理平臺(tái) (EPP)，這是其完整嵌入式處理平臺(tái)發(fā)展戰(zhàn)略的一個(gè)重大里程碑，率先為開(kāi)發(fā)人員提供堪比ASIC 的性能與功耗，F(xiàn)PGA 的靈活性以及微處理器的可編程性。那些先期采用 Zynq-7000 EPP 仿真平臺(tái)、賽靈思早期試用硬件工具以及 ARM® Connected Community社區(qū)支持的標(biāo)準(zhǔn)軟件工具已經(jīng)進(jìn)行系統(tǒng)開(kāi)發(fā)的客戶，現(xiàn)在就可以將他們的應(yīng)用移植到這些器件上，并開(kāi)始下一階段的產(chǎn)品開(kāi)發(fā)工作。

發(fā)表于：12/9/2011

基于FPGA實(shí)現(xiàn)的高速等效采集系統(tǒng)

基于FPGA設(shè)計(jì)一個(gè)高速等效采集系統(tǒng), 采樣速率高達(dá)1 GHz。通過(guò)對(duì)被測(cè)信號(hào)的周期進(jìn)行測(cè)量，動(dòng)態(tài)配置鎖相環(huán)，使采樣時(shí)鐘的周期剛好比被測(cè)信號(hào)的周期大1 ns，從而完成對(duì)被測(cè)信號(hào)的等效采樣。系統(tǒng)采用Quartus II軟件進(jìn)行系統(tǒng)模塊設(shè)計(jì)，使用NIOS IDE II軟件完成軟件代碼的實(shí)現(xiàn)。該系統(tǒng)在以Cyclone III FPGA芯片為核心的DE0開(kāi)發(fā)板上實(shí)現(xiàn)，達(dá)到了設(shè)計(jì)要求。

發(fā)表于：12/9/2011

基于FPGA的動(dòng)力電池管理系統(tǒng)研究與開(kāi)發(fā)

構(gòu)建了基于單片機(jī)芯片MC9S12DG128與FPGA的電池管理系統(tǒng)，實(shí)現(xiàn)了數(shù)據(jù)監(jiān)測(cè)、電池均衡、安全管理、荷電狀態(tài)（SOC）估計(jì)、局域網(wǎng)（CAN）通信等功能。詳細(xì)介紹了使用該系統(tǒng)模塊的電池包的分布式結(jié)構(gòu)特點(diǎn)，電池管理模塊的CAN總線接口及硬件和軟件功能設(shè)計(jì)。

發(fā)表于：12/8/2011

萊迪思發(fā)運(yùn)了7千5百萬(wàn)片MachXO可編程邏輯器件

萊迪思半導(dǎo)體公司（NASDAQ: LSCC）今日宣布MachXO? PLD（可編程邏輯器件）自量產(chǎn)起已經(jīng)發(fā)運(yùn)了超過(guò)7千5百萬(wàn)片。全球客戶采用結(jié)合了易于使用、靈活性、系統(tǒng)集成和價(jià)格各方面創(chuàng)新優(yōu)勢(shì)的MachXO PLD，廣泛應(yīng)用于各種大批量、成本敏感的應(yīng)用。

發(fā)表于：12/8/2011

Microsemi推出SmartFusion® cSoC與FPGA自有品牌計(jì)劃

致力于提供幫助功率管理、安全、可靠與高性能半導(dǎo)體技術(shù)產(chǎn)品的領(lǐng)先供應(yīng)商美高森美公司(Microsemi Corporation，紐約納斯達(dá)克交易所代號(hào)：MSCC) 今天為其SmartFusion®可定制化系統(tǒng)單芯片(cSoC)和廣泛的閃存型與反熔絲型(antifuse-based)FPGA解決方案組合推出自有品牌計(jì)劃(private labeling program)。主要的計(jì)劃內(nèi)容包括：

發(fā)表于：12/8/2011

富士通半導(dǎo)體與SuVolta展示~0.4伏超低電壓工作的SRAM

富士通半導(dǎo)體有限公司和SuVolta，Inc今日宣布，通過(guò)將SuVolta的PowerShrink?低功耗CMOS與富士通半導(dǎo)體的低功耗工藝技術(shù)集成，已經(jīng)成功地展示了在0.425V超低電壓下，SRAM(靜態(tài)隨機(jī)存儲(chǔ))模塊可以正常運(yùn)行。這些技術(shù)降低能耗，為即將出現(xiàn)的終極“生態(tài)”產(chǎn)品鋪平道路。技術(shù)細(xì)節(jié)和結(jié)果將會(huì)在12月5日開(kāi)始在華盛頓召開(kāi)的2011年國(guó)際電子器件會(huì)議（IEDM）上發(fā)表。　　

發(fā)表于：12/7/2011

基于數(shù)字鎖相環(huán)的晶振頻率同步模塊設(shè)計(jì)

為滿足現(xiàn)代通信技術(shù)、雷達(dá)技術(shù)、電子測(cè)量以及光電應(yīng)用領(lǐng)域?qū)Ω叻€(wěn)定度高準(zhǔn)確度時(shí)鐘的要求，設(shè)計(jì)了一種基于數(shù)字鎖相環(huán)的晶振同步系統(tǒng)。系統(tǒng)以基于FPGA數(shù)字延遲線的高分辨率鑒頻鑒相器以及在MicroBlaze核中實(shí)現(xiàn)的卡爾曼數(shù)字環(huán)路濾波器為核心，通過(guò)16 bit DAC微調(diào)本地晶振振蕩頻率，使其同步于GPS秒脈沖，從而獲得了高準(zhǔn)確度高、穩(wěn)定度的本地時(shí)鐘。

發(fā)表于：12/7/2011

基于FPGA的多通道SSI通信控制器設(shè)計(jì)

采用VHDL硬件描述語(yǔ)言，以Xilinx公司的FPGA為設(shè)計(jì)平臺(tái)，設(shè)計(jì)實(shí)現(xiàn)了以開(kāi)源軟核MC8051為核心的控制單元，控制4路SSI協(xié)議模塊的SoPC架構(gòu)的通信控制器，并對(duì)通信控制器進(jìn)行了功能仿真與驗(yàn)證。該控制器可靈活進(jìn)行IP核模塊擴(kuò)展，并可作為外圍處理機(jī)與TI公司TMS320C6000系列DSP進(jìn)行互連通信，將慢速串行通信任務(wù)進(jìn)行分離，從而減輕DSP的負(fù)擔(dān)，提高系統(tǒng)的整體性能。

發(fā)表于：12/6/2011