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開(kāi)啟工業(yè)4.0：集成EtherCAT和萊迪思FPGA實(shí)現(xiàn)高級(jí)自動(dòng)化

開(kāi)啟工業(yè)4.0：集成EtherCAT和萊迪思FPGA實(shí)現(xiàn)高級(jí)自動(dòng)化

　　隨著工業(yè)領(lǐng)域向?qū)崿F(xiàn)工業(yè)4.0的目標(biāo)不斷邁進(jìn)，市場(chǎng)對(duì)具備彈性連接、低功耗、高性能和強(qiáng)大安全性的系統(tǒng)需求與日俱增。　　然而，實(shí)施數(shù)字化轉(zhuǎn)型并非總是一帆風(fēng)順。企業(yè)必須在現(xiàn)有環(huán)境中集成這些先進(jìn)系統(tǒng)，同時(shí)應(yīng)對(duì)軟件孤島、互聯(lián)網(wǎng)時(shí)代前的老舊設(shè)備以及根深蒂固的工作流程等挑戰(zhàn)。它們需要能夠在這些限制條件下有針對(duì)性地應(yīng)用高性能軟硬件的解決方案。

賽靈思隆重發(fā)布嵌入式FPGA程序員雙認(rèn)證項(xiàng)目

全球可編程平臺(tái)領(lǐng)導(dǎo)廠商賽靈思（Xilinx, Inc.; NASDAQ: XLNX）在上海市職業(yè)技能鑒定中心的支持下，針對(duì)雙方聯(lián)合打造的計(jì)算機(jī)程序員（嵌入式FPGA方向）（三級(jí)）雙認(rèn)證項(xiàng)目，在市北高新技術(shù)服務(wù)業(yè)園區(qū)舉行了主題為“FPGA加速中國(guó)‘智’造，擁抱嵌入式計(jì)算新紀(jì)元”的新聞發(fā)布會(huì)。該項(xiàng)目將國(guó)家證書(shū)的權(quán)威性與FPGA發(fā)明者美國(guó)賽靈思公司的嵌入式計(jì)算平臺(tái)的前瞻性完美結(jié)合，開(kāi)辟了嵌入式計(jì)算創(chuàng)新型人才培訓(xùn)的嶄新模式。

發(fā)表于：1/12/2012

CPLD在三相PFC矩陣變換器中的應(yīng)用

CPLD的多個(gè)通道可以并行工作的這一特點(diǎn)，使得控制三相功率因數(shù)校正(PFC)矩陣變換器的6只雙向開(kāi)關(guān)同步、協(xié)調(diào)地工作。在此，介紹的XC95108型CPLD用于矩陣變換器，可以實(shí)現(xiàn)驅(qū)動(dòng)脈沖分配、換相及橋臂死區(qū)的生成等功能。

發(fā)表于：1/12/2012

嵌入式系統(tǒng)中DRAM控制器的CPLD解決方案

嵌入式系統(tǒng)中DRAM控制器的CPLD解決方案,介紹怎樣在嵌入式CPU 80C186XL DRAM刷新控制單元的基礎(chǔ)上，利用CPLD技術(shù)和80C196XL的時(shí)序特征設(shè)計(jì)一個(gè)低價(jià)格、功能完整的DRAM控制器的方法，并采用VHDL語(yǔ)言編程實(shí)現(xiàn)。

發(fā)表于：1/12/2012

晶體硅生產(chǎn)一般工藝流程【圖】

硅材料是當(dāng)前最重要的半導(dǎo)材料，目前常用的太陽(yáng)能電池是硅電池。其中晶體硅包括單晶硅和多晶硅，具有基本完整的點(diǎn)陣結(jié)構(gòu)的晶體。

發(fā)表于：1/12/2012

一種多功能正弦信號(hào)發(fā)生器的設(shè)計(jì)

介紹了一種以FPGA和單片機(jī)為控制核心，基于調(diào)制原理配合使用DDS專用芯片AD9851，實(shí)現(xiàn)了一種多功能正弦信號(hào)發(fā)生器。實(shí)現(xiàn)了在30 Hz～12 MHz頻率范圍內(nèi)正弦信號(hào)的無(wú)失真輸出，且在輸出端接50 Ω功率電阻的條件下，輸出電壓峰峰值在5.8 V~6 V范圍內(nèi)。系統(tǒng)還具有AM、FM、ASK、FSK、PSK調(diào)制的功能，整體工作穩(wěn)定，界面友好，操作簡(jiǎn)單。

發(fā)表于：1/12/2012

利用FPGA實(shí)現(xiàn)原型板原理圖的驗(yàn)證

首次流片成功取決于整個(gè)系統(tǒng)硬件和相關(guān)軟件的驗(yàn)證，有些公司提供的快速原型生成平臺(tái)具有許多調(diào)試功能，但這些平臺(tái)的價(jià)格非常高，因此最流行的做法是根據(jù)DUT和具體應(yīng)用設(shè)計(jì)復(fù)合FPGA板，驗(yàn)證這些板的原理圖通常是很麻煩的，本文提出一種利用FPGA實(shí)現(xiàn)原型板原理圖驗(yàn)證的新方法。

發(fā)表于：1/11/2012

基于FPGA的多種形式分頻的設(shè)計(jì)與實(shí)現(xiàn)

本文利用VHDL硬件描述語(yǔ)言，通過(guò)QuartusⅡ3.0開(kāi)發(fā)平臺(tái)，使用Altera公司的FPGA，設(shè)計(jì)了一種能夠滿足上述各種要求的較為通用的分頻器。

發(fā)表于：1/11/2012

在FPGA上實(shí)現(xiàn)H.264/AVC視頻編碼標(biāo)準(zhǔn)

顯示了 H.264/AVC SD 視頻編解碼器系統(tǒng)級(jí)功能塊的典型分割。該解決方案基于針對(duì) TI公司的TMS320DM642 DSP 的 Spectrum Digital EVM DM642 評(píng)估模塊，結(jié)合 Xilinx XEVM642- 2VP20 Virtex-II Pro或XEVM642-4VSX25 Virtex-4子插件板實(shí)現(xiàn)。

發(fā)表于：1/11/2012

基于FPGA的FIR抽取濾波器設(shè)計(jì)

用FPGA實(shí)現(xiàn)抽取濾波器比較復(fù)雜，主要是因?yàn)樵贔PGA中缺乏實(shí)現(xiàn)乘法運(yùn)算的有效結(jié)構(gòu)，現(xiàn)在，F(xiàn)PGA中集成了硬件乘法器，使FPGA在數(shù)字信號(hào)處理方面有了長(zhǎng)足的進(jìn)步。本文介紹了一種采用Xilinx公司的XC2V1000實(shí)現(xiàn)FIR抽取濾波器的設(shè)計(jì)方法。

發(fā)表于：1/11/2012

基于OuartusⅡ和GW48EDA開(kāi)發(fā)工具的電子搶答器設(shè)計(jì)

本文以現(xiàn)場(chǎng)可編程邏輯器件(FPGA)為設(shè)計(jì)載體，以硬件描述語(yǔ)言VHDL為主要表達(dá)方式，以O(shè)uartusⅡ開(kāi)發(fā)軟件和GW48EDA開(kāi)發(fā)系統(tǒng)為設(shè)計(jì)工具設(shè)計(jì)的電子搶答器，具有搶答鑒別與鎖存功能以及60秒答題限時(shí)功能、對(duì)搶答犯規(guī)的小組進(jìn)行警告和對(duì)各搶答小組進(jìn)行相應(yīng)的成績(jī)加減操作等功能。

發(fā)表于：1/10/2012