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基于CompactPCI體系的高性能監(jiān)測測向處理平臺研究

基于CompactPCI體系的高性能監(jiān)測測向處理平臺研究[嵌入式技術(shù)][工業(yè)自動化]

提出一種新的高速并行采樣技術(shù)架構(gòu)以及基于可編程芯片技術(shù)和支持靈活配置的并行處理嵌入式硬件架構(gòu)。該平臺集多通道高速采集、大容量數(shù)據(jù)存儲、高性能DSP與大規(guī)模FPGA緊耦合實(shí)時(shí)處理等功能于一體,在綜合集成與應(yīng)用方面具有創(chuàng)新性,能夠保障對多模式、多速率、多頻段信號分析在信號層上頻域的寬闊全覆蓋和時(shí)域的連續(xù)性,同時(shí)又因其硬件上提供了豐富的資源裕量,因而可以滿足信息層上對多種標(biāo)準(zhǔn)和協(xié)議分析的需求及應(yīng)對其未來的演進(jìn)。

發(fā)表于:8/14/2018 1:49:18 PM

VIPVS加速7 nm工藝模擬版圖設(shè)計(jì)

VIPVS加速7 nm工藝模擬版圖設(shè)計(jì)[EDA與制造][工業(yè)自動化]

在格芯基于7 nm技術(shù)研發(fā)高速Serdes IP過程中,版圖設(shè)計(jì)的復(fù)雜度日益增加。其中復(fù)雜DRC(Design Rule Check)驗(yàn)證和復(fù)雜MPT(Multi Patterning)方法為整個(gè)設(shè)計(jì)流程帶來新的挑戰(zhàn)。因此,一個(gè)能夠應(yīng)對這些挑戰(zhàn)的版圖設(shè)計(jì)流程非常重要,尤其是對EDA工具新功能的應(yīng)用,例如: Cadence Virtuoso Interactive Physical Verification System(VIPVS)工具。VIPVS能夠?qū)崿F(xiàn)實(shí)時(shí)sign-off 規(guī)格的DRC 驗(yàn)證,縮短版圖驗(yàn)證迭代過程,為多重圖案上色提供高效的方法。介紹格芯高速Serdes 版圖團(tuán)隊(duì)如何使用VIPVS(主要討論高效DRC驗(yàn)證和多重圖案上色功能)進(jìn)行基于格芯7 nm Finfet工藝的高速Serdes芯片版圖設(shè)計(jì)。

發(fā)表于:8/14/2018 11:53:00 AM

基于VSDP-XcitePI的片上耦合干擾的快速驗(yàn)證方法

基于VSDP-XcitePI的片上耦合干擾的快速驗(yàn)證方法[嵌入式技術(shù)][工業(yè)自動化]

介紹了一種基于VSDP-XcitePI提取片上電源模型并仿真分析片上耦合干擾的快速驗(yàn)證流程,使用XcitePI基于芯片版圖對Die上金屬層寄生快速準(zhǔn)確地提取生成芯片級/宏模塊級的RLCK模型/S參數(shù)模型,對一款高性能混合信號前端芯片進(jìn)行數(shù)字-模擬間干擾分析,將Die上電源網(wǎng)絡(luò)及指定關(guān)鍵信號的金屬層寄生模型帶入全鏈路聯(lián)合仿真,較好地復(fù)現(xiàn)了測試現(xiàn)象。所分析芯片面積為1.44 mm2,分析精度達(dá)到支撐10 μV級的變化量,分析帶寬超過5 GHz。此外,介紹了VSDP平臺對S參數(shù)模型的后處理方法,確保全鏈路仿真的收斂性和高效率。

發(fā)表于:8/14/2018 11:41:00 AM

開槽圓環(huán)型無芯片射頻識別標(biāo)簽結(jié)構(gòu)的設(shè)計(jì)

開槽圓環(huán)型無芯片射頻識別標(biāo)簽結(jié)構(gòu)的設(shè)計(jì)[微波|射頻][安防電子]

設(shè)計(jì)分析了一種圓環(huán)開槽型的無芯片射頻識別RFID(Radio Frequency Identification)標(biāo)簽。這種圓環(huán)開槽型結(jié)構(gòu)具有高度的對稱性,無需考慮入射波的極化方式。對散射得到的時(shí)域信號進(jìn)行極點(diǎn)的提取。根據(jù)極點(diǎn)與標(biāo)簽結(jié)構(gòu)的對應(yīng)關(guān)系,主要極點(diǎn)提供了嵌入在標(biāo)簽結(jié)構(gòu)中的基本數(shù)據(jù),通過主要極點(diǎn)來對標(biāo)簽的結(jié)構(gòu)進(jìn)行識別。通過仿真分析可知,這種標(biāo)簽結(jié)構(gòu)可達(dá)到4 bit的編碼,可成為一種新型無芯片RFID標(biāo)簽結(jié)構(gòu)。

發(fā)表于:8/13/2018 5:04:00 PM

TD-LTE系統(tǒng)小區(qū)搜索定時(shí)同步的改進(jìn)算法

TD-LTE系統(tǒng)小區(qū)搜索定時(shí)同步的改進(jìn)算法[通信與網(wǎng)絡(luò)][通信網(wǎng)絡(luò)]

通過對TD-LTE系統(tǒng)小區(qū)搜索定時(shí)同步的研究,結(jié)合Zadoff-Chu序列自身的特性,給出了一種基于SSS的定時(shí)同步算法,利用SSS信號的時(shí)域共軛對稱性正確地估計(jì)定時(shí)同步點(diǎn)。理論分析和仿真結(jié)果表明,該算法性能良好,復(fù)雜度低,在存在頻偏的情況下也能夠準(zhǔn)確地估計(jì)SSS定時(shí)同步點(diǎn)的位置,較常規(guī)算法可靠性有了很大提高。

發(fā)表于:8/13/2018 5:01:00 PM

基于信道性能的頻譜分配算法

基于信道性能的頻譜分配算法[通信與網(wǎng)絡(luò)][通信網(wǎng)絡(luò)]

頻譜分配是認(rèn)知無線電的關(guān)鍵技術(shù)之一,各授權(quán)信道的可用概率與授權(quán)用戶的到達(dá)率以及次用戶業(yè)務(wù)量傳送時(shí)間有關(guān),并且實(shí)際效益還與該信道的衰落因子相關(guān)。提出了基于以上信道性能的CSGC頻譜分配算法,該算法通過優(yōu)先分配相對信道利用率高、信道衰落小的信道,達(dá)到最大化實(shí)際總效益的目的。仿真結(jié)果表明,該算法是有效的。

發(fā)表于:8/13/2018 4:54:00 PM

基于模糊控制的鋰電池恒流放電系統(tǒng)

基于模糊控制的鋰電池恒流放電系統(tǒng)[電源技術(shù)][工業(yè)自動化]

針對鋰電池恒流放電控制系統(tǒng)的大慣性、非線性和大滯后性等問題,設(shè)計(jì)了一種基于模糊控制算法的自動控制系統(tǒng)。該系統(tǒng)以單片機(jī)Mega128作為主控芯片,運(yùn)用PWM脈寬調(diào)制技術(shù)對鋰電池的放電電流進(jìn)行控制。實(shí)驗(yàn)證明,該系統(tǒng)可以迅速響應(yīng)電流變化,且運(yùn)行穩(wěn)定可靠,可廣泛地應(yīng)用于各類鋰電池的生產(chǎn)和容量檢測場合。

發(fā)表于:8/13/2018 4:41:00 PM

基于邊緣檢測的Retinex圖像增強(qiáng)算法

基于邊緣檢測的Retinex圖像增強(qiáng)算法[可編程邏輯][工業(yè)自動化]

針對消除背景光照對圖像的影響時(shí)出現(xiàn)的細(xì)節(jié)弱化、色彩失真的問題,提出了一種基于邊緣檢測的Retinex彩色圖像增強(qiáng)算法。根據(jù)人類視覺特性從圖像中提取亮度分量并檢測邊緣信息,在平滑點(diǎn)和邊緣點(diǎn)處采用不同的模板估計(jì)背景光照,以避免強(qiáng)邊緣處的光暈現(xiàn)象;通過調(diào)整圖像中的背景光照比例提升局部對比度,并根據(jù)反射圖像直方圖自適應(yīng)調(diào)整全局對比度;利用R、G、B通道及亮度分量的等價(jià)變換進(jìn)行色彩恢復(fù),以保證增強(qiáng)前后圖像色調(diào)一致。實(shí)驗(yàn)結(jié)果表明,增強(qiáng)后的圖像標(biāo)準(zhǔn)差提升了19.34%,信息熵增大了13.18%。

發(fā)表于:8/13/2018 4:11:00 PM

LTE系統(tǒng)中小區(qū)搜索定時(shí)同步的FPGA設(shè)計(jì)

LTE系統(tǒng)中小區(qū)搜索定時(shí)同步的FPGA設(shè)計(jì)[可編程邏輯][通信網(wǎng)絡(luò)]

對比于傳統(tǒng)DSP串行模式,基于FPGA提出了一種并行高效的小區(qū)搜索定時(shí)同步設(shè)計(jì)方案。從空中接口接收數(shù)據(jù)到FPGA的片內(nèi)存儲模塊,采用多路高速乘法器進(jìn)行序列互相關(guān)檢測和動態(tài)門限配置,實(shí)現(xiàn)了數(shù)據(jù)接收和處理的無縫銜接,大大縮短了主同步信號的檢測時(shí)間,降低了解碼復(fù)雜度,并以Virtex-6芯片為硬件平臺進(jìn)行了仿真、綜合、板級驗(yàn)證、聯(lián)機(jī)驗(yàn)證等工作。實(shí)現(xiàn)結(jié)果表明,該設(shè)計(jì)方案的處理速度和數(shù)據(jù)精度滿足LTE系統(tǒng)測試要求,已應(yīng)用于終端測試儀表的開發(fā)中。

發(fā)表于:8/13/2018 3:54:00 PM

RSA協(xié)處理器與F2812接口設(shè)計(jì)

RSA協(xié)處理器與F2812接口設(shè)計(jì)[嵌入式技術(shù)][信息安全]

采用RSA協(xié)處理器作為嵌入式VPN服務(wù)器中RSA運(yùn)算核心部件,給出了其與主控制器F2812間的硬件接口設(shè)計(jì)、供電電源系統(tǒng)的設(shè)計(jì),并進(jìn)行了與硬件接口相關(guān)的軟件模塊設(shè)計(jì)與實(shí)現(xiàn)。經(jīng)系統(tǒng)調(diào)試及測試,RSA運(yùn)算速度達(dá)到預(yù)期性能,可以滿足嵌入式VPN服務(wù)器的要求。

發(fā)表于:8/13/2018 3:46:13 PM

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