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開啟工業(yè)4.0：集成EtherCAT和萊迪思FPGA實(shí)現(xiàn)高級(jí)自動(dòng)化

開啟工業(yè)4.0：集成EtherCAT和萊迪思FPGA實(shí)現(xiàn)高級(jí)自動(dòng)化

　　隨著工業(yè)領(lǐng)域向?qū)崿F(xiàn)工業(yè)4.0的目標(biāo)不斷邁進(jìn)，市場對(duì)具備彈性連接、低功耗、高性能和強(qiáng)大安全性的系統(tǒng)需求與日俱增。　　然而，實(shí)施數(shù)字化轉(zhuǎn)型并非總是一帆風(fēng)順。企業(yè)必須在現(xiàn)有環(huán)境中集成這些先進(jìn)系統(tǒng)，同時(shí)應(yīng)對(duì)軟件孤島、互聯(lián)網(wǎng)時(shí)代前的老舊設(shè)備以及根深蒂固的工作流程等挑戰(zhàn)。它們需要能夠在這些限制條件下有針對(duì)性地應(yīng)用高性能軟硬件的解決方案。

京微雅格CME-C1的五大典型應(yīng)用介紹

CME-C1是京微雅格新近推出的高性能大容量“云”系列首顆產(chǎn)品，邏輯容量折合2000萬門級(jí)。CME-C1采用TSMC 40nm先進(jìn)工藝，采用全新的6輸入查找表架構(gòu)，獨(dú)創(chuàng)36x18的DSP單元，內(nèi)嵌大容量每塊18K位ram，高速串行接口可達(dá)6.5Gbps，通用差分I/O可達(dá)1.3Gbps，同時(shí)還內(nèi)置硬核PCIe支持5G速率Gen2、DDR3/2控制器以及PHY讀寫速率可達(dá)1333Mbps，各項(xiàng)指標(biāo)均達(dá)國內(nèi)領(lǐng)先水平。

發(fā)表于：1/20/2016

多核同時(shí)多線程處理器的線程調(diào)度器設(shè)計(jì)

多核同時(shí)多線程處理器（SMT_PAAG）是用于圖形、圖像及數(shù)字信號(hào)處理的一種多核處理器?；谶@種處理器提出了一種硬件線程調(diào)度器，該調(diào)度器采用同時(shí)多線程技術(shù)，最多可同時(shí)執(zhí)行四個(gè)線程，支持八個(gè)線程阻塞模式下的快速上下文切換。這樣避免了因阻塞帶來的等待問題，能夠有效提高處理器的工作效率和資源利用率。通過在處理器上運(yùn)行圖形處理算法進(jìn)行性能評(píng)測(cè)。結(jié)果表明，SMT-PAAG處理器通過挖掘指令級(jí)并行和線程級(jí)并行，將處理器的性能提高了69.25%。

發(fā)表于：1/18/2016

基于UVM和Matlab搭建的DVB-S編碼調(diào)制系統(tǒng)驗(yàn)證平臺(tái)

提出了一種用于測(cè)試一個(gè)DVB-S編碼調(diào)制系統(tǒng)的功能驗(yàn)證平臺(tái)。該平臺(tái)使用高級(jí)驗(yàn)證方法學(xué)（Universal Verification Methodology，UVM）搭建了驗(yàn)證平臺(tái)的主要結(jié)構(gòu)，并在驗(yàn)證平臺(tái)中使用外接Matlab作為復(fù)雜數(shù)字信號(hào)處理的參考模型。介紹了功能驗(yàn)證平臺(tái)的主要結(jié)構(gòu)和組件的設(shè)計(jì)，詳細(xì)介紹了UVM通過直接編程接口（Direct Programming Interface，DPI）以C++為橋梁與Matlab連接的設(shè)計(jì)方法。通過實(shí)際仿真驗(yàn)證比較，使用這種方法搭建的聯(lián)合平臺(tái)比純硬件語言Verilog語言搭建的仿真驗(yàn)證平臺(tái)在驗(yàn)證時(shí)間上縮短了近50%，避免了對(duì)復(fù)雜信號(hào)處理驗(yàn)證模型的硬件語言設(shè)計(jì)，提高了針對(duì)復(fù)雜信號(hào)處理系統(tǒng)驗(yàn)證平臺(tái)的搭建效率。

發(fā)表于：1/15/2016

艾睿電子和Microsemi推出全新Arrow-Built SF2+開發(fā)套件

2016年1月5日 - 香港，艾睿電子公司（NYSE：ARW）宣布，艾睿不斷增加的開發(fā)套件組合又增加了新的產(chǎn)品：Arrow-built SF2+開發(fā)套件，它采用Microsemi的SmartFusion?2片上系統(tǒng)（SoC）現(xiàn)場可編程門陣列（FPGA）、Microsemi的Timberwolf? 音頻處理器和Microsemi的LX系列功率器件。SF2+開發(fā)套件是期待提升至下一級(jí)集成設(shè)計(jì)的軟件和硬件工程師的理想選擇。

發(fā)表于：1/5/2016

一種改進(jìn)SOM的雙目視覺特征點(diǎn)快速匹配方法

針對(duì)未知非結(jié)構(gòu)化室內(nèi)環(huán)境中雙目視覺機(jī)器人路標(biāo)特征匹配的問題進(jìn)行了研究，提出了基于改進(jìn)自組織映射網(wǎng)絡(luò)（Self-Organizing Map，SOM）的雙目視覺特征點(diǎn)快速匹配方法。對(duì)雙目視覺獲取的環(huán)境圖像提取SIFT特征向量作為改進(jìn)SOM的輸入，利用獲勝者計(jì)算技術(shù)完成對(duì)輸入SIFT特征點(diǎn)的快速匹配，SOM競爭學(xué)習(xí)過程中用街區(qū)距離與棋盤距離的線性組合作為相似性度量函數(shù)。實(shí)驗(yàn)結(jié)果表明，所提方法在路標(biāo)特征匹配的時(shí)間和效果上優(yōu)于傳統(tǒng)SIFT和SURF特征匹配的方法，且能滿足實(shí)時(shí)性要求。

發(fā)表于：1/4/2016

英特爾完成對(duì)Altera的收購

2015年12月29日，加州圣克拉拉——英特爾公司今天宣布已完成對(duì)Altera公司的收購，Altera公司是FPGA（可編程邏輯陣列）技術(shù)的領(lǐng)先提供商。此次收購補(bǔ)充了英特爾具有領(lǐng)先優(yōu)勢(shì)的產(chǎn)品組合，并為高速增長的數(shù)據(jù)中心和物聯(lián)網(wǎng)細(xì)分市場提供了新類別的產(chǎn)品。

發(fā)表于：1/1/2016

基于FPGA的CPCI總線多功能通信卡的設(shè)計(jì)

為了提高航空航天領(lǐng)域?qū)π盘?hào)處理、傳輸?shù)膶?shí)時(shí)性及可靠性，以Cyclone III系列EP3C40F324I7為核心處理器，設(shè)計(jì)了一種基于CPCI總線的多功能通信卡。結(jié)合高效的FPGA算法，設(shè)計(jì)出一款實(shí)時(shí)性強(qiáng)、可靠性高的多功能通信卡。經(jīng)測(cè)試使用，該多功能通信卡各項(xiàng)性能指標(biāo)均達(dá)到要求，已投入實(shí)際應(yīng)用中。

發(fā)表于：12/30/2015

蘋果表勁敵？三星生物處理器開始生產(chǎn) 可量體脂率

加州圣克拉拉——英特爾公司今天宣布已完成對(duì)Altera公司的收購，Altera公司是FPGA（可編程邏輯陣列）技術(shù)的領(lǐng)先提供商。此次收購補(bǔ)充了英特爾具有領(lǐng)先優(yōu)勢(shì)的產(chǎn)品組合，并為高速增長的數(shù)據(jù)中心和物聯(lián)網(wǎng)細(xì)分市場提供了新類別的產(chǎn)品。

發(fā)表于：12/30/2015

基于PSO算法路徑規(guī)劃的研究

在實(shí)時(shí)的交通路況中，路徑規(guī)劃的核心問題是快速而有效地找到從起點(diǎn)到達(dá)終點(diǎn)的最優(yōu)路線。將PSO算法應(yīng)用到的路徑規(guī)劃中來，針對(duì)實(shí)時(shí)變化的交通路況，在適應(yīng)度函數(shù)中引入懲罰項(xiàng)來實(shí)現(xiàn)靜態(tài)和動(dòng)態(tài)下的路徑規(guī)劃，并通過引入變異算子的操作來避免該算法陷入局部最優(yōu)。實(shí)驗(yàn)表明，改進(jìn)后的PSO算法搜索效率高，時(shí)間開銷隨路網(wǎng)規(guī)模的擴(kuò)大增幅較小，適用于大規(guī)模路網(wǎng)和動(dòng)態(tài)路徑規(guī)劃。

發(fā)表于：12/29/2015

基于云計(jì)算的測(cè)試公共服務(wù)平臺(tái)設(shè)計(jì)技術(shù)

分析了國內(nèi)軟件質(zhì)檢行業(yè)資源聚合面臨的問題，提出了采用云計(jì)算技術(shù)聚合各軟件質(zhì)檢機(jī)構(gòu)資源的方案，設(shè)計(jì)并實(shí)現(xiàn)了基于云計(jì)算技術(shù)的公共測(cè)試服務(wù)平臺(tái)，該平臺(tái)通過測(cè)試云服務(wù)方式以統(tǒng)一的接口推動(dòng)國內(nèi)軟件質(zhì)檢資源共享，并為軟件質(zhì)檢機(jī)構(gòu)提供了一種新的業(yè)務(wù)模式。

發(fā)表于：12/29/2015