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Altera被曝將易主銀湖資本

Altera被曝將易主銀湖資本

2 月 19 日消息，彭博社今天（2 月 19 日）發(fā)布博文，報(bào)道稱私募巨頭銀湖資本（Silver Lake Management）正與英特爾進(jìn)行深入談判，計(jì)劃收購(gòu)其可編程芯片部門 Altera 的多數(shù)股權(quán)。

老兵新傳——“闖入”高性能計(jì)算領(lǐng)域的FPGA

自1985年首款FPGA誕生以來(lái)，F(xiàn)PGA已經(jīng)是一名在電子信息領(lǐng)域征戰(zhàn)了30年的老兵，這名戰(zhàn)功赫赫的老兵如今已經(jīng)正式開(kāi)赴了一個(gè)新的戰(zhàn)場(chǎng)。?從2011年Altera公司發(fā)布支持利用OpenCL來(lái)開(kāi)發(fā)FPGA的SDK工具以后，采用CPU+FPGA構(gòu)成異構(gòu)計(jì)算系統(tǒng)成為另一種具有競(jìng)爭(zhēng)力的解決方案。為了讓更多網(wǎng)友了解FPGA異構(gòu)計(jì)算系統(tǒng)的原理、架構(gòu)和開(kāi)發(fā)流程，《電子技術(shù)應(yīng)用》特別邀請(qǐng)了電子科技大學(xué)黃樂(lè)天博士和電子科技大學(xué)“成電杰出學(xué)生”蒲宇亮在電子技術(shù)應(yīng)用·云課堂進(jìn)行了一場(chǎng)公益演講。

發(fā)表于：10/9/2016

FPGA芯片配置方式詳解與選擇

廣義的來(lái)說(shuō)，F(xiàn)PGA的配置包括直接使用下載電纜對(duì)FPGA器件進(jìn)行編程、對(duì)外部EEPROM和FLASH進(jìn)行編程、使用MPU對(duì)FPGA器件進(jìn)行編程、外部EEPROM和FLASH對(duì)器件進(jìn)行編程等。

發(fā)表于：9/29/2016

賽靈思大學(xué)計(jì)劃項(xiàng)目十年磨一劍結(jié)碩果

[AET上海]日前，賽靈思“OpenHW 開(kāi)源硬件與全可編程論壇暨Xilinx中國(guó)大學(xué)合作十周年慶典” 在上海隆重舉行，來(lái)自中國(guó)大陸、香港及新加坡數(shù)百所高校的教授、開(kāi)源硬件大賽優(yōu)秀選手，以及來(lái)自教育部高等學(xué)校電子信息類專業(yè)教學(xué)指導(dǎo)委員會(huì)的領(lǐng)導(dǎo)、行業(yè)知名專家，在中國(guó)市場(chǎng)大學(xué)合作項(xiàng)目中攜手并進(jìn)的合作伙伴，以及賽靈思全球高級(jí)副總裁及 CTO, Ivo Bolsens，賽靈思大學(xué)計(jì)劃高級(jí)總監(jiān) Patrick Lysaght 等出席了此次盛會(huì)。

發(fā)表于：9/26/2016

大牛推薦 FPGA學(xué)習(xí)中的好書(shū)籍

學(xué)習(xí)FPGA不但要有好的學(xué)習(xí)方法，也要有好的書(shū)籍。好的書(shū)籍能對(duì)我們學(xué)好FPGA起到事半功倍的效果！那么，在學(xué)習(xí)FPGA的每個(gè)階段都有哪些好的書(shū)籍呢？點(diǎn)擊閱讀本期【圖說(shuō)新聞】一起了解一下吧！

發(fā)表于：9/23/2016

基于FPGA的GPS接收機(jī)基帶處理硬件在環(huán)系統(tǒng)

針對(duì)GPS跟蹤環(huán)路參數(shù)調(diào)試繁瑣復(fù)雜、FPGA反復(fù)編譯耗時(shí)多的問(wèn)題，設(shè)計(jì)了一種基于FPGA的GPS接收機(jī)基帶處理硬件在環(huán)系統(tǒng)。該系統(tǒng)以FPGA設(shè)計(jì)的GPS基帶處理為核心，完成衛(wèi)星信號(hào)的采集和基帶信號(hào)處理，并將處理結(jié)果通過(guò)以太網(wǎng)實(shí)時(shí)傳送到Simulink設(shè)計(jì)的跟蹤環(huán)路進(jìn)行處理，在處理完成后反饋到FPGA的基帶處理單元，完成衛(wèi)星信號(hào)的捕獲和跟蹤。經(jīng)測(cè)試，該系統(tǒng)實(shí)現(xiàn)了衛(wèi)星信號(hào)的捕獲和跟蹤，驗(yàn)證了該平臺(tái)的有效性和準(zhǔn)確性，提高了GPS跟蹤環(huán)路的設(shè)計(jì)、調(diào)試、驗(yàn)證、實(shí)現(xiàn)的效率,對(duì)快速開(kāi)發(fā)衛(wèi)星導(dǎo)航芯片和系統(tǒng)具有積極作用。

發(fā)表于：9/22/2016

FPGA學(xué)習(xí)中的好書(shū)推薦

回想起自己學(xué)FPGA，已經(jīng)有一段時(shí)間了，從開(kāi)始的茫然，到后來(lái)的瘋狂看書(shū)，設(shè)計(jì)開(kāi)發(fā)板，調(diào)電路，練習(xí)各種FPGA實(shí)例，到最后能獨(dú)立完成項(xiàng)目，一路走來(lái)，感受頗多，拿出來(lái)和大家分享，順便介紹下自己的一點(diǎn)經(jīng)驗(yàn)所得，希望對(duì)初學(xué)者有所幫助。

發(fā)表于：9/14/2016

基于5G無(wú)線通信的稀疏碼多址接入系統(tǒng)的FPGA實(shí)現(xiàn)

在理解無(wú)線通信多址接入的基礎(chǔ)之上，提出了一種低復(fù)雜度的基于5G無(wú)線通信的稀疏碼多址接入系統(tǒng)的FPGA實(shí)現(xiàn)方案，利用可綜合的Verilog語(yǔ)言在QuartusII及ModelSim平臺(tái)下完成了電路的設(shè)計(jì)綜合仿真及FPGA驗(yàn)證，結(jié)果證明該設(shè)計(jì)實(shí)現(xiàn)功能完備，可以實(shí)際應(yīng)用。

發(fā)表于：9/8/2016

Xilinx收購(gòu)Auviz FPGA與GPU要開(kāi)戰(zhàn)了

Auviz Systems專注于數(shù)據(jù)中心和嵌入式系統(tǒng)的加速應(yīng)用，在卷積神經(jīng)網(wǎng)絡(luò)方向有著一定的技術(shù)積累。其技術(shù)專長(zhǎng)是FPGA實(shí)現(xiàn)、機(jī)器學(xué)習(xí)、視覺(jué)算法等，為行業(yè)提供基于FPGA的中間件IP，以減少應(yīng)用程序的功耗。

發(fā)表于：9/8/2016

千萬(wàn)門級(jí)模塊魚(yú)骨型時(shí)鐘網(wǎng)絡(luò)的實(shí)現(xiàn)

在芯片規(guī)模越來(lái)越大的背景下，針對(duì)千萬(wàn)門級(jí)以上規(guī)模芯片模塊，提出一種基于單魚(yú)骨型時(shí)鐘網(wǎng)絡(luò)的改進(jìn)型時(shí)鐘結(jié)構(gòu)，并給出在后端設(shè)計(jì)過(guò)程中基于EDA工具的具體實(shí)現(xiàn)方法。

發(fā)表于：9/5/2016

高人詳解FPGA學(xué)習(xí)的四大要點(diǎn)！

FPGA為什么是可以編程的？恐怕很多菜鳥(niǎo)不知道，他們也不想知道。因?yàn)樗麄冇X(jué)得這是無(wú)關(guān)緊要的。他們潛意識(shí)的認(rèn)為可編程嘛，肯定就是像寫(xiě)軟件一樣啦。軟件編程的思想根深蒂固，看到Verilog或者VHDL就像看到C語(yǔ)言或者其它軟件編程語(yǔ)言一樣。一條條的讀，一條條的分析。如果這些菜鳥(niǎo)們始終拒絕去了解為什么FPGA是可以編程的，不去了解FPGA的內(nèi)部結(jié)構(gòu)，要想學(xué)會(huì)FPGA恐怕是天方夜譚。

發(fā)表于：9/2/2016