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Altera被曝將易主銀湖資本

Altera被曝將易主銀湖資本

2 月 19 日消息，彭博社今天（2 月 19 日）發(fā)布博文，報(bào)道稱私募巨頭銀湖資本（Silver Lake Management）正與英特爾進(jìn)行深入談判，計(jì)劃收購其可編程芯片部門 Altera 的多數(shù)股權(quán)。

GPT在異構(gòu)系統(tǒng)架構(gòu)（HSA）全球峰會(huì)上發(fā)布其最新進(jìn)展

中國北京，2016年8月21日 - 華夏芯公司的美國分部——通用處理器技術(shù)有限公司（GPT）是全球領(lǐng)先的異構(gòu)系統(tǒng)處理器IP授權(quán)商。GPT今日宣布，其IP核已經(jīng)在硅片上成功實(shí)現(xiàn)，并已通過HSA（異構(gòu)系統(tǒng)架構(gòu)）一致性測(cè)試。公司還宣布了新的機(jī)器學(xué)習(xí)和深層神經(jīng)網(wǎng)絡(luò)的開源項(xiàng)目，旨在進(jìn)一步推動(dòng)HSA技術(shù)的發(fā)展。

發(fā)表于：8/30/2016

HSA峰會(huì)召開在即，報(bào)名參會(huì)人員遠(yuǎn)超預(yù)期

2016年全球異構(gòu)計(jì)算HSA峰會(huì)將于8月22日在北京拉開帷幕，本次峰會(huì)為期兩天，由全球異構(gòu)系統(tǒng)架構(gòu)（HSA）聯(lián)盟和中國半導(dǎo)體行業(yè)協(xié)會(huì)（CSIA）共同主辦，并得到了網(wǎng)信辦、工信部和北京經(jīng)濟(jì)技術(shù)開發(fā)區(qū)的大力支持。本次峰會(huì)受到了中國半導(dǎo)體業(yè)界的高度關(guān)注，目前報(bào)名申請(qǐng)參會(huì)人數(shù)已經(jīng)遠(yuǎn)超出之前的預(yù)期。

發(fā)表于：8/22/2016

FPGA設(shè)計(jì)寶典之提高算法速度的六大絕招

面積和速度這兩個(gè)指標(biāo)貫穿著FPGA設(shè)計(jì)的始終,是設(shè)計(jì)質(zhì)量評(píng)價(jià)的終極標(biāo)準(zhǔn)?！懊娣e”：指一個(gè)設(shè)計(jì)所消耗的FPGA的邏輯資源數(shù)量。FPGA中的邏輯資源,也就是觸發(fā)器( FF)和查找表(LUT) ?！八俣取保菏侵冈O(shè)計(jì)結(jié)果在芯片上穩(wěn)定運(yùn)行時(shí)所能達(dá)到的最高頻率,這個(gè)頻率由設(shè)計(jì)的時(shí)序狀況決定。與設(shè)計(jì)滿足的時(shí)鐘周期、PAD to PAD Time、建立時(shí)間、保持時(shí)間和時(shí)鐘到輸出延時(shí)等眾多時(shí)序特征向量密切相關(guān)。

發(fā)表于：8/19/2016

基于FPGA的多節(jié)點(diǎn)1553B總線協(xié)議處理器的實(shí)現(xiàn)

研究設(shè)計(jì)了一種多節(jié)點(diǎn)的1553B總線協(xié)議處理器，可以模擬整套1553B總線系統(tǒng)，既可以作為測(cè)試設(shè)備，也可作為總線上的多個(gè)節(jié)點(diǎn)在實(shí)際應(yīng)用中使用。針對(duì)總線協(xié)議處理器邏輯與存儲(chǔ)資源占用高、難以單片實(shí)現(xiàn)的問題，提出了多核MIMD架構(gòu)的實(shí)現(xiàn)思路，有效地降低了邏輯資源的使用量，使其可以在單片F(xiàn)PGA上實(shí)現(xiàn)。基于軟硬件融合的理念，通過自定義專用指令集增加指令并行度來提高指令執(zhí)行的效率，增強(qiáng)了系統(tǒng)的實(shí)時(shí)性，使其可以在低頻時(shí)鐘下運(yùn)行，從而降低了系統(tǒng)的功耗。

發(fā)表于：8/19/2016

基于FPGA的線陣CCD圖像采集與顯示系統(tǒng)設(shè)計(jì)

色選機(jī)廣泛應(yīng)用于工農(nóng)業(yè)產(chǎn)品檢測(cè)中，其設(shè)計(jì)技術(shù)涉及圖像采集、處理與顯示，常見的設(shè)計(jì)方案為FPGA+DSP/ARM+PC。該方案結(jié)構(gòu)復(fù)雜，成本高昂。設(shè)計(jì)了一種在FPGA中實(shí)現(xiàn)線陣CCD圖像信號(hào)采集并顯示的系統(tǒng)。添加圖像處理算法后，色選機(jī)的主要設(shè)計(jì)技術(shù)將被集成在一片F(xiàn)PGA芯片中。詳細(xì)闡述了圖像采集與顯示的邏輯設(shè)計(jì)，并通過軟硬件調(diào)試驗(yàn)證了設(shè)計(jì)的正確性。該系統(tǒng)結(jié)構(gòu)簡單、成本低廉，經(jīng)過適當(dāng)移植，可應(yīng)用于安檢、醫(yī)療影像等領(lǐng)域。

發(fā)表于：8/11/2016

基于FPGA的LFSR異步加解密系統(tǒng)

線性反饋移位寄存器（LFSR）偽隨機(jī)序列作為流密碼的一種，具有原理清晰、不可預(yù)測(cè)性強(qiáng)的特點(diǎn)，被廣泛應(yīng)用于各種加解密場合。針對(duì)目前基于LFSR的加解密系統(tǒng)只能應(yīng)用于同步工作模式的局限性，設(shè)計(jì)了一種可配置的LFSR異步加解密系統(tǒng)，并對(duì)其進(jìn)行了基于FPGA的硬件實(shí)現(xiàn)。實(shí)驗(yàn)結(jié)果顯示，其既具備LFSR序列的優(yōu)秀性能，又可以實(shí)現(xiàn)異步加解密，具有一定的實(shí)際應(yīng)用價(jià)值。

發(fā)表于：8/11/2016

視頻縮放在FPGA中的應(yīng)用和實(shí)現(xiàn)

針對(duì)某顯示系統(tǒng)中監(jiān)控視頻控制器的實(shí)際需求，設(shè)計(jì)了一種可實(shí)現(xiàn)四路視頻信號(hào)實(shí)時(shí)縮放的電路架構(gòu)。通過權(quán)衡幾種常用圖像縮放算法的顯示質(zhì)量和硬件可行性，選擇用雙線性插值算法實(shí)現(xiàn)視頻的縮放，并在FPGA平臺(tái)上以雙口RAM資源構(gòu)建的線緩存作為算法硬件實(shí)現(xiàn)，該算法主要由視頻數(shù)據(jù)緩沖模塊、插值系數(shù)產(chǎn)生模塊以及整體控制模塊構(gòu)成。本設(shè)計(jì)在滿足視頻縮放質(zhì)量要求的基礎(chǔ)上，避免了采用過于復(fù)雜算法而消耗過多的FPGA資源，有效地解決了視頻縮放時(shí)原始圖像信息量丟失導(dǎo)致圖像失真的問題。結(jié)果表明，該設(shè)計(jì)能夠?qū)崿F(xiàn)任意比例的視頻縮放，實(shí)時(shí)性高，應(yīng)用靈活，縮放后顯示效果良好，能夠滿足實(shí)際工程的要求。

發(fā)表于：8/3/2016

Intel PSG除了數(shù)據(jù)中心還瞄準(zhǔn)自動(dòng)駕駛

7月28日，時(shí)隔7個(gè)月，Intel PSG首次召開媒體會(huì)，發(fā)布了整合后的Intel PSG的產(chǎn)品及市場策略。Altera與Intel聯(lián)姻后的三大關(guān)鍵詞——加大投入提高收益擴(kuò)展產(chǎn)品線

發(fā)表于：8/2/2016

基于4DSP+FPGA架構(gòu)數(shù)據(jù)處理板設(shè)計(jì)

為了滿足超高性能數(shù)據(jù)處理以及低功耗、簡單可編程性的應(yīng)用，設(shè)計(jì)了一款基于TI TMS320C6678芯片和Xilinx公司XC5VSX95T芯片的4DSP+FPGA架構(gòu)的數(shù)據(jù)處理板，同時(shí)設(shè)計(jì)了高帶寬的數(shù)據(jù)輸入輸出接口以及相關(guān)的時(shí)鐘、電源和復(fù)位電路，并通過具體的硬件電路實(shí)現(xiàn)。該數(shù)據(jù)處理板可廣泛應(yīng)用于航空設(shè)備、車載設(shè)備、惡劣條件下工作的特種設(shè)備，將有效提高設(shè)備的數(shù)據(jù)處理性能。

發(fā)表于：7/29/2016

基于FPGA加速機(jī)器學(xué)習(xí)算法

AI因?yàn)槠銫NN（卷積神經(jīng)網(wǎng)絡(luò)）算法出色的表現(xiàn)在圖像識(shí)別領(lǐng)域占有舉足輕重的地位?；镜腃NN算法需要大量的計(jì)算和數(shù)據(jù)重用，非常適合使用FPGA來實(shí)現(xiàn)。上個(gè)月，Ralph Wittig（Xilinx CTO Office的卓越工程師）在2016年OpenPower峰會(huì)上發(fā)表了約20分鐘時(shí)長的演講并討論了包括清華大學(xué)在內(nèi)的中國各大學(xué)研究CNN的一些成果。

發(fā)表于：7/29/2016