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基于FPGA的DSC高速譯碼器設(shè)計(jì)及實(shí)現(xiàn)[可編程邏輯][數(shù)據(jù)中心]

采用易于FPGA實(shí)現(xiàn)的歸一化最小和算法，通過選取合適的歸一化因子，將乘法轉(zhuǎn)化成移位和加法運(yùn)算。在高斯白噪聲信道下，仿真該譯碼算法得出最佳的譯碼迭代次數(shù)，并結(jié)合Xilinx XC7VX485T資源確定量化位數(shù)。然后基于該算法和這3個(gè)參數(shù)設(shè)計(jì)了一種全新的、高速部分并行的DSC譯碼器。該譯碼器最大限度地實(shí)現(xiàn)了譯碼效率、譯碼復(fù)雜度、FPGA資源利用率之間的平衡，并在Xilinx XC7VX485T芯片上實(shí)現(xiàn)了該譯碼器，其吞吐率可達(dá)197 Mb/s。

發(fā)表于：11/9/2016 2:45:00 PM

AD9957在射頻數(shù)字化短波發(fā)射機(jī)中的應(yīng)用和仿真分析[微波|射頻][航空航天]

首先簡(jiǎn)要介紹了射頻數(shù)字化短波發(fā)射機(jī)的基本原理以及AD9957芯片的主要功能，然后提出了一種利用AD9957芯片來(lái)實(shí)現(xiàn)射頻數(shù)字化短波發(fā)射機(jī)內(nèi)部數(shù)字上變頻模塊和數(shù)/模轉(zhuǎn)換模塊的方案，使用System View軟件對(duì)AD9957在短波發(fā)射機(jī)中的應(yīng)用進(jìn)行仿真分析，最后給出了短波發(fā)射機(jī)中數(shù)字化部分的完整仿真電路圖。

發(fā)表于：11/9/2016 2:28:00 PM

納米器件的散粒噪聲檢測(cè)方法研究[嵌入式技術(shù)][工業(yè)自動(dòng)化]

針對(duì)納米器件散粒噪聲信號(hào)去噪方法的不足，利用散粒噪聲信號(hào)在不同狀態(tài)下的方差特性，提出了一種改進(jìn)的經(jīng)驗(yàn)?zāi)B(tài)分解算法(EMD)。該算法根據(jù)信號(hào)固有模態(tài)函數(shù)(IMFs)方差最大值與對(duì)應(yīng)層數(shù)的關(guān)系自適應(yīng)地選擇需要處理的IMF層數(shù)，并與傳統(tǒng)平均算法相結(jié)合提取了散粒噪聲信號(hào)。實(shí)驗(yàn)結(jié)果表明：在不同程度(≥-3.92 dB)低頻噪聲環(huán)境下，與傳統(tǒng)的EMD硬性去噪等方法比較可知，其信噪比提高了5.4 dB～7.0 dB，均方誤差降低了36%以上，該方法有效地去除了低頻噪聲，提高了散粒噪聲檢測(cè)的有效性。

發(fā)表于：11/9/2016 2:02:00 PM

基于OLS碼的檢錯(cuò)糾錯(cuò)抗輻射加固設(shè)計(jì)[嵌入式技術(shù)][數(shù)據(jù)中心]

由輻射粒子引起的多單元翻轉(zhuǎn)（MCUs）已經(jīng)成為了影響存儲(chǔ)器可靠性的一個(gè)主要問題。而存儲(chǔ)器抗MCUs的加固方法一般是使用可以糾正多個(gè)錯(cuò)誤的錯(cuò)誤糾正碼（ECCs）。使用了正交拉丁方（OLS）碼的故障容錯(cuò)系統(tǒng)被構(gòu)造用以糾正存儲(chǔ)器中的多個(gè)錯(cuò)誤。OLS碼是一類一步大數(shù)邏輯可譯（OS-MLD）碼，可以使用非常簡(jiǎn)單的大數(shù)邏輯電路來(lái)進(jìn)行譯碼。由Verilog硬件描述語(yǔ)言實(shí)現(xiàn)設(shè)計(jì)，并且使用ModelSim進(jìn)行了功能驗(yàn)證。

發(fā)表于：11/8/2016 4:13:00 PM

基于軟硬件協(xié)同技術(shù)的AHB-PCI測(cè)試平臺(tái)[嵌入式技術(shù)][汽車電子]

針對(duì)AHB-PCI的橋接電路，搭建了一個(gè)測(cè)試其功能的平臺(tái)。該平臺(tái)主要由軟件和硬件協(xié)同完成。硬件部分實(shí)現(xiàn)了兩個(gè)符合AHB標(biāo)準(zhǔn)的RAM，一個(gè)作為主機(jī)，能夠請(qǐng)求總線；另一個(gè)作為從機(jī)，可以接收數(shù)據(jù)。軟件方面通過驅(qū)動(dòng)程序?qū)CI部分進(jìn)行相應(yīng)配置和讀寫。通過實(shí)際測(cè)試比較，使用該方法搭建的平臺(tái)比在modelsim上的仿真驗(yàn)證平臺(tái)在正確性驗(yàn)證上更有保障。

發(fā)表于：11/8/2016 3:58:00 PM

納米級(jí)MOSFET襯底電流的偏置依賴性建模[模擬設(shè)計(jì)][汽車電子]

襯底電流是納米級(jí)MOSFET電學(xué)性質(zhì)分析的重要基礎(chǔ)，也是集成電路設(shè)計(jì)的先決條件。建立精確的襯底電流模型是分析MOSFET器件及電路可靠性和進(jìn)行電路設(shè)計(jì)所必需的?；跓彷d流子效應(yīng)建立了一個(gè)常規(guī)結(jié)構(gòu)納米級(jí)MOSFET襯底電流的解析模型，并將模型的仿真結(jié)果與實(shí)驗(yàn)結(jié)果相比較，驗(yàn)證了模型的準(zhǔn)確性。同時(shí)對(duì)襯底電流與溝道長(zhǎng)度和偏置電壓的關(guān)系進(jìn)行了分析研究，結(jié)果表明，襯底電流具有顯著的溝道長(zhǎng)度與偏置依賴性。

發(fā)表于：11/7/2016 1:47:00 PM

面向能量收集的電源技術(shù)綜述[電源技術(shù)][汽車電子]

電源技術(shù)是能量收集技術(shù)的重要核心之一，它的任何突破性成果都將促使能量收集技術(shù)發(fā)生基礎(chǔ)性的變革。著重介紹了面向能量收集的電源技術(shù)的發(fā)展現(xiàn)狀，從電力電子電路與集成、電能管理控制方法與實(shí)現(xiàn)、多源能量收集管理系統(tǒng)整合與優(yōu)化這三大研究領(lǐng)域分支展開論述，具體內(nèi)容包括上述各研究分支的當(dāng)前研究工作重點(diǎn)以及代表性技術(shù)方案。最后，考慮產(chǎn)品化需求，進(jìn)一步指出今后面向能量收集的電源技術(shù)發(fā)展將繼續(xù)圍繞更低輸入電壓條件下更低功耗的電路啟動(dòng)、更低功耗地實(shí)現(xiàn)更精確跟蹤的最大功率點(diǎn)（MPP）控制方法、更有效地實(shí)現(xiàn)多源能量收集與管理系統(tǒng)內(nèi)部融合這三大關(guān)鍵科技難題展開。

發(fā)表于：11/7/2016 1:35:00 PM

基于GJB289A總線SoC芯片的1553模塊設(shè)計(jì)與實(shí)現(xiàn)[嵌入式技術(shù)][航空航天]

傳統(tǒng)的1553模塊主要采用DIP封裝的協(xié)議處理器、計(jì)時(shí)器、收發(fā)器設(shè)計(jì)，PCB板重量大、功耗高、可靠性及維護(hù)性差，難以滿足新型武器裝備的“小、低、輕”要求。提出了一種基于自主正向的高速GJB289A總線（1~10 Mb/s）SoC芯片的1553模塊設(shè)計(jì)方案，從硬件及軟件設(shè)計(jì)上闡述了基于GJB289A總線SoC芯片的1553模塊的設(shè)計(jì)與實(shí)現(xiàn)，并提出了該模塊的技術(shù)優(yōu)勢(shì)。該模塊是一款集成終端SoC芯片的GJB289A總線通信設(shè)備，實(shí)現(xiàn)了GJB289A總線中的BC、RT功能。該模塊功耗低，性能、功能穩(wěn)定可靠，可移植性強(qiáng)，集成度高，具有較高的成熟度，滿足機(jī)載航空電子系統(tǒng)總線設(shè)計(jì)要求，已成功應(yīng)用于多個(gè)項(xiàng)目中。

發(fā)表于：11/4/2016 2:39:00 PM

小型化GJB289A數(shù)據(jù)總線協(xié)議處理SoC芯片設(shè)計(jì)[嵌入式技術(shù)][航空航天]

傳統(tǒng)GJB289A總線節(jié)點(diǎn)采用分立器件實(shí)現(xiàn)其相應(yīng)的功能，存在器件種類多、可維護(hù)性低、體積大、功耗高等問題，本設(shè)計(jì)HKS1553BCRT芯片采用SoC技術(shù)將微處理器、協(xié)議處理器、存儲(chǔ)器等資源進(jìn)行片上集成，可大大降低系統(tǒng)功耗（降低為原來(lái)的1/8），減少體積（減少為原來(lái)的1/4），減輕重量（為原來(lái)的1/6），提高系統(tǒng)可靠性，傳輸速率為1~10 Mb/s，滿足機(jī)載/防務(wù)領(lǐng)域GJB289A總線BC/RT節(jié)點(diǎn)設(shè)計(jì)要求。詳細(xì)闡述了HKS1553BCRT芯片架構(gòu)、功能定義、工作原理和各個(gè)模塊的設(shè)計(jì)方法，通過多層次、多角度驗(yàn)證，證明芯片功能性能穩(wěn)定。該芯片已通過定型，成熟度高，集成度、可靠性顯著提高。

發(fā)表于：11/4/2016 2:32:00 PM

GJB289A數(shù)據(jù)總線系統(tǒng)設(shè)計(jì)研究[嵌入式技術(shù)][航空航天]

隨著數(shù)據(jù)總線技術(shù)的發(fā)展和廣泛應(yīng)用，系統(tǒng)設(shè)計(jì)過程中需要考慮的因素越來(lái)越多，不僅包括系統(tǒng)設(shè)計(jì)的成本及易用性，還包括系統(tǒng)應(yīng)用過程中的技術(shù)成熟度、穩(wěn)定性、可靠性、系統(tǒng)實(shí)時(shí)性及魯棒性等因素。針對(duì)一個(gè)高速GJB289A數(shù)據(jù)總線系統(tǒng)進(jìn)行研究，分析了拓?fù)湓O(shè)計(jì)、BC設(shè)計(jì)、RT設(shè)計(jì)和總線控制等設(shè)計(jì)的關(guān)鍵技術(shù)，涵蓋總線ICD設(shè)計(jì)、總線通信控制表配置、總線通信仿真、總線測(cè)試、總線監(jiān)控、遠(yuǎn)程終端、中繼器全套應(yīng)用解決方案。本系統(tǒng)技術(shù)成熟度高，已經(jīng)過某型號(hào)機(jī)載總線通信驗(yàn)證實(shí)驗(yàn)，穩(wěn)定、可靠、多功能且方便易操作，為用戶提供良好的人機(jī)界面接口，可實(shí)現(xiàn)高速GJB289A總線半物理配置/仿真/監(jiān)控/中繼/性能分析，可輔助完成機(jī)載航電系統(tǒng)總線設(shè)計(jì)、驗(yàn)證及綜合。

發(fā)表于：11/3/2016 2:17:00 PM