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如何使用Altium Designer內(nèi)CVS管理設(shè)計(jì)數(shù)據(jù)？

關(guān)于AltiumDesigner內(nèi)CVS版本控制系統(tǒng)的應(yīng)用：首先：調(diào)用菜單Projects&raquo;VersionControl命令，或在Projects面板內(nèi)，鼠標(biāo)右擊項(xiàng)目名；其次：選擇CreateRepository命令，然后彈出CreateCVSRepository對話框。您需要選定一個(gè)目錄作為新的數(shù)據(jù)倉庫

發(fā)表于：10/12/2011

富士電子使用Cadence Virtuoso加速并行仿真器將開發(fā)時(shí)間減少25%

全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計(jì)系統(tǒng)公司(NASDAQ: CDNS)，今天宣布富士電子公司采用Cadence Virtuoso加速并行仿真器將電源管理IC的開發(fā)時(shí)間和系統(tǒng)的驗(yàn)證時(shí)間都縮短了25%。這家日本電源管理IC公司在強(qiáng)大的Cadence Virtuoso模擬設(shè)計(jì)環(huán)境中使用該仿真器，實(shí)現(xiàn)時(shí)間的大幅縮短，同時(shí)有助于提高質(zhì)量。

發(fā)表于：10/11/2011

555定時(shí)器的應(yīng)用及OrCAD/PSpice仿真

本文以O(shè)rCAD／PSpice 10.5為工具，對555定時(shí)器構(gòu)成的三種典型電路進(jìn)行仿真分析，得出了一些有價(jià)值的結(jié)論。

發(fā)表于：10/11/2011

Monte Carlo方法與計(jì)算機(jī)模擬應(yīng)用研究

介紹了Monte Carlo方法，提出其在模擬Buffer問題時(shí)存在的一個(gè)問題，并給出改進(jìn)的方法；提出了用Monte Carlo方法產(chǎn)生任意分布隨機(jī)變量的原理及方法，并對Beta分布和標(biāo)準(zhǔn)正態(tài)分布隨機(jī)變量進(jìn)行了計(jì)算機(jī)模擬和效果檢驗(yàn)。

發(fā)表于：10/8/2011

開關(guān)電源PCB 電磁兼容性的建模分析

開關(guān)型變換器噪聲的干擾路徑為干擾源和被干擾設(shè)備提供了耦合條件，對其共模干擾和差模干擾的研究尤為重要。主要分析了電路主要元器件的高頻模型以及共模和差模噪聲的電路模型，為開關(guān)電源PCB的EMC優(yōu)化設(shè)計(jì)提供有益的幫助。

發(fā)表于：9/29/2011

全加器功能及應(yīng)用的仿真設(shè)計(jì)分析

加法運(yùn)算是數(shù)字系統(tǒng)中最基本的算術(shù)運(yùn)算。為了能更好地利用加法器實(shí)現(xiàn)減法、乘法、除法、碼制轉(zhuǎn)換等運(yùn)算，提出用Multisim虛擬仿真軟件中的邏輯轉(zhuǎn)換儀、字信號(hào)發(fā)生器、邏輯分析儀，對全加器進(jìn)行功能仿真設(shè)計(jì)、轉(zhuǎn)

發(fā)表于：9/28/2011

富士通采用Cadence DFM技術(shù)為標(biāo)準(zhǔn)用于其28納米ASIC與混合信號(hào)設(shè)計(jì)

全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計(jì)系統(tǒng)公司 (NASDAQ: CDNS)，今天宣布富士通半導(dǎo)體有限公司已經(jīng)采用Cadence® 簽收可制造性設(shè)計(jì) (DFM) 技術(shù)，用于其復(fù)雜的28納米ASIC及系統(tǒng)級(jí)芯片（SoC）混合信號(hào)設(shè)計(jì)。通過采用Cadence DFM技術(shù)幫助富士通半導(dǎo)體工程師在開發(fā)其高端消費(fèi)電子產(chǎn)品新一代核心芯片中，確保高良品率、可預(yù)測性與更快的硅實(shí)現(xiàn)。Cadence的硅實(shí)現(xiàn)端到端數(shù)字與模擬流程在Virtuoso定制/模擬與Encounter數(shù)字流程中提供了DFM in-design技術(shù)。

發(fā)表于：9/27/2011

基于Multisim的汽車尾燈控制系統(tǒng)設(shè)計(jì)

本文設(shè)計(jì)一種基于Multisim的汽車尾燈控制設(shè)計(jì)，要求實(shí)現(xiàn)汽車左轉(zhuǎn)彎、右轉(zhuǎn)彎、停止等條件下尾燈的點(diǎn)亮與熄滅情況。Multisim具有電腦模擬各種電路功能，其運(yùn)用各種仿真器件可達(dá)到現(xiàn)實(shí)器件同樣的功能效果。

發(fā)表于：9/24/2011

應(yīng)用于TPMS的PCB螺旋天線的設(shè)計(jì)與實(shí)現(xiàn)

針對TPMS中發(fā)射天線安裝空間有限這一難點(diǎn)，提出了一種PCB螺旋天線。采用將螺旋天線加工于PCB上的結(jié)構(gòu)，極大地減小了天線尺寸。設(shè)計(jì)出的天線具有良好的全向性，加入匹配網(wǎng)絡(luò)后，在工作頻率433.92 MHz 處的回波損耗值約為-40 dB，滿足TPMS發(fā)射天線的性能要求。根據(jù)優(yōu)化結(jié)果制作了該天線，測試結(jié)果與仿真結(jié)果基本吻合，實(shí)物尺寸為20 mm×16.7 mm×10 mm，實(shí)現(xiàn)了小型化。

發(fā)表于：9/23/2011

一種三次均勻B樣條曲線快速反算的方法

提出了均勻三次B-spline曲線反算的快速算法。在Matlab中編程實(shí)現(xiàn)，大大降低了程序的復(fù)雜性，提高了運(yùn)算效率，并使重構(gòu)所得曲線的兩個(gè)端點(diǎn)處曲率不為零，滿足了一階連續(xù)，并給出了應(yīng)用實(shí)例。

發(fā)表于：9/23/2011

Micro/sys采用賽靈思Spartan-6 FPGA推出單板計(jì)算機(jī)

賽靈思公司近日宣布，Micro/sys 公司采用集成了MicroBlaze™ 處理器子系統(tǒng)的Spartan®-6 FPGA 和 ARM Cortex-A8 處理器推出了一款小型低功耗高穩(wěn)健型計(jì)算機(jī)板。該最新商用 Micro/sys SBC1651 單板計(jì)算機(jī) (SBC) 使嵌入式用戶不僅能夠用一個(gè)單板處理各種應(yīng)用的不同 I/O(輸入/輸出)配置任務(wù)，同時(shí)還可降低生產(chǎn)成本，縮短產(chǎn)品上市時(shí)間。

發(fā)表于：9/23/2011

基于HFSS的雙脊喇叭天線的設(shè)計(jì)與仿真

引言對喇叭天線而言，最常用的展寬頻帶的方法是在波導(dǎo)部分及喇叭張開部分加入脊形結(jié)構(gòu)。雖然該天線已應(yīng)用于某些工程實(shí)際中，但是此類天線在頻率大于12GHz時(shí)，增益下降，方向圖主瓣出現(xiàn)分裂，并且隨著頻率的升高，主

發(fā)表于：9/22/2011

Giantec Semiconductor改用Cadence技術(shù)，采用Virtuoso流程實(shí)現(xiàn)了30%的效率提升

全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計(jì)系統(tǒng)公司(NASDAQ: CDNS)，今日宣布Giantec Semiconductor Corp.已采用Cadence® Virtuoso®統(tǒng)一定制/模擬（IC6.1）以及Encounter®統(tǒng)一數(shù)字流程生產(chǎn)其混合信號(hào)芯片。Giantec最近采用Cadence軟件設(shè)計(jì)并成功流片了一款用于低功耗微控制器的存儲(chǔ)器產(chǎn)品，這款低功耗微控制器應(yīng)用于智能卡、智能電表和消費(fèi)電子產(chǎn)品。使用Cadence Virtuoso統(tǒng)一定制/模擬流程開發(fā)其混合信號(hào)設(shè)計(jì)，Giantec實(shí)現(xiàn)了30%的效率提升。

發(fā)表于：9/21/2011

基于VBA的AutoCAD二次開發(fā)及應(yīng)用實(shí)例

本文介紹了VBA二次開發(fā)AUTOCAD的技術(shù)特點(diǎn)，并以實(shí)例說明VBA應(yīng)用程序的編寫要點(diǎn)。進(jìn)一步驗(yàn)證了AUTOCAD與VBA以ActivexAutomation自動(dòng)化接口技術(shù)實(shí)現(xiàn)連接，利用VB的可視化編程設(shè)計(jì)實(shí)現(xiàn)CAD系統(tǒng)設(shè)計(jì)的實(shí)際價(jià)值。

發(fā)表于：9/21/2011

實(shí)行單獨(dú)環(huán)保標(biāo)準(zhǔn) PCB行業(yè)自我救贖

目前，我國印制電路板（PCB）產(chǎn)量位居世界第一，產(chǎn)品質(zhì)量及技術(shù)水平也得到很大提升。然而要使PCB行業(yè)實(shí)現(xiàn)可持續(xù)發(fā)展，企業(yè)必須在節(jié)能減排、清潔生產(chǎn)上下工夫。日前在江蘇大豐召開的“2011年環(huán)保技術(shù)研討會(huì)”上，業(yè)內(nèi)專家從技術(shù)、標(biāo)準(zhǔn)等角度對治理PCB行業(yè)的“三廢”給出了建議。

發(fā)表于：9/21/2011