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聯(lián)合隨機性策略的深度強化學習探索方法

聯(lián)合隨機性策略的深度強化學習探索方法[其他][其他]

目前深度強化學習算法已經(jīng)可以解決許多復雜的任務,然而如何平衡探索和利用的關系仍然是強化學習領域的一個基本的難題,為此提出一種聯(lián)合隨機性策略的深度強化學習探索方法。該方法利用隨機性策略具有探索能力的特點,用隨機性策略生成的經(jīng)驗樣本訓練確定性策略,鼓勵確定性策略在保持自身優(yōu)勢的前提下學會探索。通過結合確定性策略算法DDPG和提出的探索方法,得到基于隨機性策略指導的確定性策略梯度算法(SGDPG)。在多個復雜環(huán)境下的實驗表明,面對探索問題,SGDPG的探索效率和樣本利用率要優(yōu)于DDPG算法。

發(fā)表于:6/10/2021 3:15:53 PM

基于浮柵器件的低位寬卷積神經(jīng)網(wǎng)絡研究

基于浮柵器件的低位寬卷積神經(jīng)網(wǎng)絡研究[其他][其他]

浮柵器件(Flash)能夠將存儲和計算的特性相結合,實現(xiàn)存算一體化,但是單個浮柵單元最多只能存儲位寬為4 bit的數(shù)據(jù)。面向Nor Flash,研究了卷積神經(jīng)網(wǎng)絡參數(shù)的低位寬量化,對經(jīng)典的AlexNet、VGGNet以及ResNet通過量化感知訓練。采用非對稱量化,將模型參數(shù)從32位浮點數(shù)量化至4位定點數(shù),模型大小變?yōu)樵瓉淼?/8,針對Cifar10數(shù)據(jù)集,4位量化模型的準確率相對于全精度網(wǎng)絡僅下降不到2%。最后將量化完成的卷積神經(jīng)網(wǎng)絡模型使用Nor Flash陣列加速。Hspice仿真結果表明,相對于全精度模型,部署在Nor Flash陣列中的量化模型精度僅下降2.25%,驗證了卷積神經(jīng)網(wǎng)絡部署在Nor Flash上的可行性。

發(fā)表于:6/10/2021 3:08:15 PM

融合外觀特征的行人重識別方法

融合外觀特征的行人重識別方法[其他][其他]

針對行人重識別中由于姿勢變化、視角改變、遮擋等引起的識別率不高的問題,提出了融合外觀特征的行人重識別方法。該方法通過兩個網(wǎng)絡分支的設計,分別提取行人的全局特征和局部特征,二者融合后得到行人的外觀特征。同時結合分類損失和度量學習損失,通過多任務學習策略對兩個網(wǎng)絡分支進行模型優(yōu)化。此外,該模型設計了隨機擦除算法,在數(shù)據(jù)集中加入噪聲,增強模型的魯棒性。實驗結果表明:融合外觀特征的行人重識別方法大大提高了行人重識別的準確率,在Market-1501數(shù)據(jù)集上rank1達到了92.82%、mAP 達到了80.51%,在DukeMTMC-reID數(shù)據(jù)集上rank1達到了85.06%、mAP達到了72.72%。

發(fā)表于:6/10/2021 3:04:00 PM

基于深度學習的車輛檢測算法研究

基于深度學習的車輛檢測算法研究[其他][其他]

針對目前車輛實時檢測中存在定位不準確、檢測精度低等問題,采用了一種以Darknet-53為骨架網(wǎng)絡的YOLOv3車輛檢測算法,將該算法模型在標準數(shù)據(jù)集Pascal-VOC2012上進行訓練,以拍攝的西安南二環(huán)路的圖片作為測試集進行測試。實驗結果表明,YOLOv3算法的檢測精度達到84.9%,相比于SSD算法,其檢測精度提高了11.3%,檢測速度提高了3.8 f/s。因此YOLOv3算法檢測精度更好,檢測速度更快,能準確地檢測出圖像中的車輛信息,滿足車輛實時檢測的要求。

發(fā)表于:6/10/2021 2:50:00 PM

函數(shù)級別的復用開源代碼檢測方法

函數(shù)級別的復用開源代碼檢測方法[其他][其他]

軟件開發(fā)中對開源代碼的復用會帶來開源代碼漏洞和違反開源許可等問題。傳統(tǒng)復用代碼檢測方法常常檢出較多偶然克隆代碼,影響了復用代碼的檢測準確性。為此,提出了一種基于復用度量指標的函數(shù)級別復用開源代碼檢測方法。該方法對被測代碼和開源代碼庫,先使用克隆檢測工具獲取克隆函數(shù),然后使用依據(jù)克隆代碼行和共用標識符在開源代碼庫中的出現(xiàn)頻率的復用度量指標,判定每對克隆函數(shù)是否為復用。在公開有標注數(shù)據(jù)集和真實數(shù)據(jù)集上的實驗結果均表明所提方法優(yōu)于基于逆文檔頻率的方法。

發(fā)表于:6/10/2021 2:44:00 PM

面向工控現(xiàn)場應用的邊緣網(wǎng)關架構設計和性能評估

面向工控現(xiàn)場應用的邊緣網(wǎng)關架構設計和性能評估[通信與網(wǎng)絡][物聯(lián)網(wǎng)]

工業(yè)現(xiàn)場控制作為邊緣網(wǎng)關的典型應用場景,是物聯(lián)網(wǎng)與人工智能交叉學科的研究熱點。在場景中,傳感器的數(shù)據(jù)經(jīng)過高速無線網(wǎng)絡匯集至邊緣網(wǎng)關,算法模塊根據(jù)傳感器數(shù)據(jù)向設備發(fā)送控制指令,完成控制閉環(huán)。與傳統(tǒng)網(wǎng)關僅僅收集和轉發(fā)數(shù)據(jù)相比,邊緣計算網(wǎng)關還承擔了數(shù)據(jù)加工和控制生成的重要功能,所以其安全與性能顯得尤為重要。針對邊緣網(wǎng)關中的安全與性能要求,提出了一種工業(yè)邊緣網(wǎng)關架構,該架構在基于X86的Linux平臺上進行了模擬仿真和實機測試,結果表明該邊緣網(wǎng)關可以滿足工業(yè)現(xiàn)場控制的典型應用場景,并滿足了傳統(tǒng)網(wǎng)關的基準性能。

發(fā)表于:6/10/2021 2:24:06 PM

一種利用類別顯著性映射生成對抗樣本的方法

一種利用類別顯著性映射生成對抗樣本的方法[其他][其他]

如果對抗樣本的遷移性越強,則其攻擊結構未知的深度神經(jīng)網(wǎng)絡模型的效果越好,所以設計對抗樣本生成方法的一個關鍵在于提升對抗樣本的遷移性。然而現(xiàn)有方法所生成的對抗樣本,與模型的結構和參數(shù)高度耦合,從而難以對結構未知的模型進行有效攻擊。類別顯著性映射能夠提取出樣本的關鍵特征信息,而且在不同網(wǎng)絡模型中有較高的相似度。基于顯著性映射的這一特點,在樣本生成過程中,引入類別顯著性映射進行約束,實驗結果表明,該方法生成的對抗樣本具有較好的遷移性。

發(fā)表于:6/10/2021 1:55:43 PM

域名畫像系統(tǒng)的設計與實現(xiàn)

域名畫像系統(tǒng)的設計與實現(xiàn)[通信與網(wǎng)絡][通信網(wǎng)絡]

網(wǎng)絡空間逐漸成為人類生產(chǎn)活動的第二空間,網(wǎng)絡空間測繪對人們了解認識網(wǎng)絡空間資源分布、網(wǎng)絡關系和威脅情況等具有重要意義。當前對域名這一網(wǎng)絡空間重要資產(chǎn)的測繪研究相對較少,因此針對域名資產(chǎn)進行探測分析,結合多源域名數(shù)據(jù)對域名的基礎屬性、譜系關系、規(guī)模狀況和時空變化等情況進行分析,形成域名畫像。該研究有助于用戶掌握互聯(lián)網(wǎng)域名整體發(fā)展情況,可對網(wǎng)絡流量過濾和惡意域名檢測、網(wǎng)絡空間資產(chǎn)屬性識別等提供支撐。

發(fā)表于:6/10/2021 1:48:19 PM

亞皮秒級激光回波半實物仿真系統(tǒng)關鍵技術研究

亞皮秒級激光回波半實物仿真系統(tǒng)關鍵技術研究[模擬設計][工業(yè)自動化]

激光回波仿真系統(tǒng)能夠根據(jù)所模擬的目標生成高頻高精度模擬回波信號。提出一種激光回波仿真系統(tǒng)設計方案,系統(tǒng)中采用FPGA生成延時信號,可以對回波信號實現(xiàn)亞皮秒級的延時精度;對光纖通信協(xié)議進行了優(yōu)化,用FPGA實現(xiàn)基于該協(xié)議的回波信號傳輸系統(tǒng),擺脫了現(xiàn)有方案中對反射內存卡的依賴性,提升了數(shù)據(jù)的刷新頻率。仿真結果表明,所設計的仿真系統(tǒng)數(shù)據(jù)傳輸速度達到1.6 Gb/s,回波精度達到125 ps,距離分辨率達到0.05 m。為基于激光陣列的高精度激光制導半實物仿真系統(tǒng)的研制奠定了基礎。

發(fā)表于:6/2/2021 11:50:00 AM

一種G比特可變編碼調制的解調方法設計與實現(xiàn)

一種G比特可變編碼調制的解調方法設計與實現(xiàn)[微波|射頻][通信網(wǎng)絡]

隨著衛(wèi)星通信技術的發(fā)展,寬帶頻譜越來越少,提高頻譜利用率就愈來愈重要,可變編碼調制技術(VCM)就是一種解決方案。根據(jù)DVB-S2標準中對調制信號的格式的定義,當調制方式在QPSK、8PSK、16APSK、32APSK中切換時,幀頭和導頻仍然采用π/2BPSK進行調制,基于此提出了對導頻和幀頭部分進行高碼率可變編碼的載波同步和均衡處理,實現(xiàn)結果表明,能正常對不同調制方式進行解調,同時保證在不同調制方式進行切換時仍能穩(wěn)定完成解調,測試結果表明解調性能偏離理論值小于3 dB,由于只采用了一種載波同步方法和均衡方法,實現(xiàn)方法簡單,節(jié)省了FPGA資源。

發(fā)表于:6/2/2021 9:54:00 AM

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