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銀湖資本完成對Altera的51%股權(quán)收購

銀湖資本完成對Altera的51%股權(quán)收購

北京時(shí)間9月15日晚間，全球 FPGA 創(chuàng)新技術(shù)領(lǐng)導(dǎo)者 Altera 宣布，全球技術(shù)投資巨頭銀湖資本（Silver Lake）已完成對 Altera 51% 股權(quán)的收購，該股權(quán)原由英特爾公司持有。同時(shí)，英特爾將保留 Altera 49% 的股權(quán)，此舉也彰顯了雙方對 Altera 未來良好發(fā)展充滿信心。

超高速數(shù)據(jù)采集系統(tǒng)設(shè)計(jì)與優(yōu)化策略研究

為滿足雷達(dá)信號高速采集實(shí)時(shí)存儲的需求，設(shè)計(jì)了一個(gè)12 bit、200 MS/s的高速采集存儲系統(tǒng)?；贑PCI總線解決高速數(shù)據(jù)傳輸?shù)男枨?，并利用雷達(dá)信號的特點(diǎn)，提出了采樣時(shí)間窗的概念，有效降低了采集數(shù)據(jù)量和數(shù)據(jù)傳輸壓力。設(shè)計(jì)了一種二級緩存機(jī)制以提高DMA傳輸效率，并通過數(shù)據(jù)格式的組合來匹配總線寬度，提高CPCI總線帶寬利用率。采用千兆以太網(wǎng)磁盤陣列，解決了海量數(shù)據(jù)的高速存儲問題。系統(tǒng)最終實(shí)現(xiàn)的采樣速率是200 MS/s，量化精度12 bit，連續(xù)采集。

發(fā)表于：2/28/2011

FPGA電路動態(tài)老化技術(shù)研究

1引言FPGA是現(xiàn)場可編程門陣列（FieldProgrammingGateArray）的縮寫，用戶可以編寫程序?qū)PGA內(nèi)部的邏輯模塊和I/O模塊重新配置，以實(shí)現(xiàn)芯片的邏輯功能。近年來，F(xiàn)PGA芯片以其大規(guī)模、高集成度、高可靠性、投資

發(fā)表于：2/28/2011

基于可重構(gòu)的可信SOPC平臺的WSN安全系統(tǒng)

　針對無線傳感器網(wǎng)絡(luò)存在的上述安全問題，本系統(tǒng)在Xilinx的開發(fā)板上，首先利用無線模塊組成一個(gè)無線傳感器網(wǎng)絡(luò)，并基于SPINS協(xié)議框架實(shí)現(xiàn)了網(wǎng)絡(luò)內(nèi)的密鑰管理，在系統(tǒng)內(nèi)部的安全模塊內(nèi)實(shí)現(xiàn)了RC5,MD5等算法，保證網(wǎng)絡(luò)的通信安全;其次為了保證傳感器網(wǎng)絡(luò)中節(jié)點(diǎn)本身的安全可信，增加了防篡改檢測電路，從硬件級保證節(jié)點(diǎn)的安全性和完整性;最后針對于WSN網(wǎng)絡(luò)的拓?fù)浣Y(jié)構(gòu)易變的特點(diǎn)，利用基于FPGA的可重構(gòu)計(jì)算技術(shù)，使得網(wǎng)絡(luò)內(nèi)的某些節(jié)點(diǎn)在需要時(shí)可以發(fā)生重構(gòu)，代替失效的基站繼續(xù)工作，從而保證整個(gè)網(wǎng)絡(luò)安全可靠地運(yùn)行。

發(fā)表于：2/28/2011

基于FPGA的多級小波逆變換實(shí)時(shí)系統(tǒng)設(shè)計(jì)

針對JPEG2000解碼系統(tǒng)中核心處理模塊——離散小波逆變換(IDWT)，采用提升小波算法，提出了一種雙路并行的實(shí)現(xiàn)結(jié)構(gòu)，并基于Xilinx公司低功耗的xc2v3000-4-fg676芯片進(jìn)行布局布線仿真驗(yàn)證表明，該方案是一種高速、實(shí)時(shí)的硬件解決方案，能較好地解決JPEG200 0解碼系統(tǒng)中對于小波逆變換實(shí)時(shí)處理的瓶頸。

發(fā)表于：2/28/2011

基于SOPC的SPWM脈沖發(fā)生器的實(shí)現(xiàn)

SOPC具有可靠性高、功耗低、保密性強(qiáng)、程序設(shè)計(jì)靈活等特點(diǎn)，在電子產(chǎn)品設(shè)計(jì)中得到廣泛的應(yīng)用。在系統(tǒng)中，利用數(shù)字化自然采樣法實(shí)現(xiàn)SPWM脈沖。文中利用DDS(直接數(shù)字式頻率合成器)技術(shù)，產(chǎn)生正弦調(diào)制波，然后與三角載波比較產(chǎn)生SPWM脈沖波。

發(fā)表于：2/28/2011

基于循環(huán)前綴的OFDM同步算法研究與FPGA實(shí)現(xiàn)

提出了一種基于循環(huán)前綴的符號同步算法。此算法在最大似然估計(jì)的基礎(chǔ)上加以改進(jìn)，簡化了符號同步中相關(guān)運(yùn)算的判決方法，在保持同步效率的同時(shí)，極大地節(jié)約了硬件資源，使算法更易于硬件實(shí)現(xiàn)。改進(jìn)算法基于IEEE 802.11a的標(biāo)準(zhǔn)提出，通過Matlab仿真分析其性能，并在FPGA硬件平臺上實(shí)現(xiàn)，利用ChipScope觀測得到波形。實(shí)驗(yàn)結(jié)果表明，電路系統(tǒng)工作可靠，滿足設(shè)計(jì)要求。

發(fā)表于：2/25/2011

基于SOPC的嵌入式數(shù)字音頻AGC系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn)

本設(shè)計(jì)采用SOPC技術(shù)，利用FPGA實(shí)現(xiàn)SDI接口邏輯，移植μC／OS-Ⅱ?qū)崟r(shí)操作系統(tǒng)為嵌入式應(yīng)用軟件運(yùn)行平臺，可以實(shí)現(xiàn)與廣電設(shè)備的無縫接合。通過設(shè)計(jì)采用一種適于實(shí)時(shí)性的多參數(shù)融合的AGC算法對數(shù)字音頻信號進(jìn)行AGC處理，實(shí)現(xiàn)了具有抑制一定噪聲能力的嵌入式數(shù)字音頻AGC系統(tǒng)。測試表明該系統(tǒng)達(dá)到設(shè)計(jì)預(yù)期目標(biāo)，改善了傳統(tǒng)音頻AGC處理中的一些缺陷，輸出音頻穩(wěn)定平衡，完全滿足實(shí)際需要，可廣泛應(yīng)用在數(shù)字演播室中的數(shù)字音頻實(shí)時(shí)AGC處理上。

發(fā)表于：2/25/2011

Lattice獨(dú)辟蹊徑，收獲頗豐

2010年，Lattice的總收入為2.978億美元，比2009年增加了1億美元。值得一提的是，在2009年，Lattice是唯一收入增長的公司。在Lattice的三大產(chǎn)品（中端FPGA，低密度PLD以及混合信號產(chǎn)品）中，低密度PLD占Lattice總收入的65%，其增長也是最快的，中端FPGA占25%~30%，混合信號產(chǎn)品占了5%。

發(fā)表于：2/24/2011

適用于LatticeECP3 FPGA系列的HDR攝像機(jī)開發(fā)套件和評估參考設(shè)計(jì)

萊迪思半導(dǎo)體公司（NASDAQ: LSCC）今日發(fā)布了萊迪思HDR-60攝像機(jī)開發(fā)套件，這是一款基于LatticeECP3? FPGA系列可量產(chǎn)的高清（HD）攝像機(jī)開發(fā)系統(tǒng)。預(yù)載入了萊迪思合作伙伴Helion GmbH帶有即插即用的評估版圖像信號處理（ISP）流水線的IP核，該開發(fā)套件開箱即可使用。該IP可實(shí)現(xiàn)每秒60幀的1080p，帶有2D降噪和高動態(tài)范圍（HDR）。開發(fā)套件外形大小符合市售攝像機(jī)外殼尺寸并能夠同時(shí)支持兩個(gè)傳感器，開發(fā)套件可實(shí)現(xiàn)快速評估和高清HDR攝像機(jī)樣機(jī)的設(shè)計(jì)，適用于安防、交通控制、視頻會議和汽車應(yīng)用。所有購買的客戶可免費(fèi)獲得原理圖和布線文件，有助于進(jìn)一步加快產(chǎn)品上市時(shí)間。萊迪思HDR-60攝像機(jī)開發(fā)套件的售價(jià)為399美元。

發(fā)表于：2/24/2011

基于CPLD的多路數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)

摘要：隨著數(shù)字化生活的到來，數(shù)據(jù)采集系統(tǒng)在日常生活中的應(yīng)用越來越顯著。模擬信號和數(shù)字信號之間的轉(zhuǎn)換已成為計(jì)算機(jī)控制系統(tǒng)中不可缺少的環(huán)節(jié)。較傳統(tǒng)數(shù)據(jù)采集系統(tǒng)，以可編程邏輯器件實(shí)現(xiàn)的數(shù)據(jù)采集系統(tǒng)具有時(shí)鐘頻率高，內(nèi)部延時(shí)小，速度快，效率高，組成形式靈活等特點(diǎn)。

發(fā)表于：2/24/2011