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veriloghdl 相關(guān)文章(21篇)
ANT系列分組密碼算法的FPGA高速實現(xiàn)
發(fā)表于:2021/4/22 9:38:00
基于FPGA的PPM調(diào)制解調(diào)系統(tǒng)設(shè)計
發(fā)表于:2021/3/3 9:19:00
NoC資源網(wǎng)絡(luò)接口設(shè)計
發(fā)表于:2019/8/21 13:40:00
基于FPGA的猝發(fā)多脈沖產(chǎn)生系統(tǒng)設(shè)計與實現(xiàn)
發(fā)表于:2018/9/25 11:55:00
基于FPGA的測試控制板卡的設(shè)計與實現(xiàn)
發(fā)表于:2018/8/24 14:55:34
基于USB3.0的多相位幀同步電路設(shè)計
發(fā)表于:2016/2/22 14:35:00
基于多相位技術(shù)的USB3.0發(fā)送電路設(shè)計
發(fā)表于:2016/2/19 20:31:00
C程序的Verilog HDL實現(xiàn)
發(fā)表于:2015/12/9 20:28:00
基于PCI數(shù)據(jù)采集卡的高速多通道數(shù)據(jù)采集系統(tǒng)
發(fā)表于:2015/8/2 20:10:00
基于FPGA的靜態(tài)實時光譜采集與處理系統(tǒng)
發(fā)表于:2012/9/21 16:18:00
Xilinx PCI-Express核總線接口設(shè)計與實現(xiàn)
發(fā)表于:2011/10/17 13:42:00
基于FPGA的電力諧波分析儀的研制
發(fā)表于:2011/9/16 15:06:00
基于VerilogHDL濾波器的設(shè)計
發(fā)表于:2011/8/24 10:56:00
基于CPLD的位同步時鐘提取電路設(shè)計
發(fā)表于:2011/8/5 14:35:00
基于FPGA的微流控芯片電泳控制系統(tǒng)設(shè)計
發(fā)表于:2011/7/14 16:37:36
基于FPGA的紅外遙控信號接收模塊的設(shè)計
發(fā)表于:2011/6/30 0:00:00
基于FPGA的精密離心機光柵信號細(xì)分系統(tǒng)
發(fā)表于:2011/5/5 15:24:22
基于FPGA的∑-Δ D/A轉(zhuǎn)換器的設(shè)計與實現(xiàn)
發(fā)表于:2011/1/16 0:00:00
基于FPGA的多路視頻通道控制
發(fā)表于:2010/7/8 0:00:00
基于SPCE061A和CPLD的電動自行車充電系統(tǒng)研制
發(fā)表于:2008/4/11 13:44:24
DRM系統(tǒng)的SHA256算法設(shè)計及FPGA實現(xiàn)
發(fā)表于:2007/11/19 16:00:26
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