FIR數字濾波器設計及其FPGA實現
所屬分類：參考設計
上傳者：aet
文檔大小：523 K
標簽： FPGA
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文檔介紹：以FPGA為硬件平臺，利用FPGA的DSP開發(fā)工具DSP Builder對數字濾波器進行建模設計及系統模型仿真，生成VHDL工程文件，編制相應頂層文件，使其符合濾波器硬件系統。利用QuartusⅡ對項目進行綜合、編譯和調試，生成原理圖模塊和RTL電路圖。通過對5 kHz方波信號進行仿真濾波，并將VHDL下載到硬件系統中進行硬件實現，有效地提取到5 kHz的正弦信號。實驗結果表明，該設計很好地達到了FIR濾波器的性能，為數字濾波器的設計與實現提供了新的途徑和方法。
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