互连线延迟对测试时间的影响研究
所屬分類：技术论文
上傳者：wwei
文檔大小：4139 K
標(biāo)簽： 互连线 FPGA 传输延迟
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文檔介紹：FPGA器件在量产测试过程中，其内部的互连资源占据了大量测试时间，如何降低测试时间、节约测试成本一直是困扰量产的难题。针对上述问题，以XCKU5P型FPGA为验证代表，通过Vivado对其被测互连线路径进行时序仿真，并基于ATE实际测量得出互连线传输延迟，与仿真结果基本一致。同时，进一步研究了不同测试温度下的互连线延迟，找到了ATE对FPGA互连功能测试过程中合理且稳定的延迟等待时间。经验证，在满足低温功能测试要求设置的最低延迟等待基础上再加100 ns，即可满足三温测试稳定性要求，有效减少了凭借经验设置的非必要冗余等待时间，提高了测试效率、降低了测试成本。
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