信號發(fā)生延遲器申請報(bào)告及軟件流程——第二屆OpenHW開放源碼硬件與嵌入式大賽優(yōu)勝獎
所屬分類：調(diào)研報(bào)告
上傳者：chenyy
文檔大小：30 K
標(biāo)簽： FPGA
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文檔介紹：在工業(yè)控制領(lǐng)域中，我們需要比較精確的定時(shí)信號。比如在現(xiàn)代大型加速器中，觸發(fā)信號，是由中央控制室的一個500MHz的時(shí)鐘源，經(jīng)過不同的分頻和延時(shí)處理后，提供給其他器件作為觸發(fā)源使用。采用這樣的方式，可以做到統(tǒng)一管理觸發(fā)，并且各個延時(shí)觸發(fā)信號之間具有相關(guān)性，彼此間的晃動比較小。本次設(shè)計(jì)計(jì)劃實(shí)現(xiàn)一個扇出比是4的小型觸發(fā)延時(shí)系統(tǒng)，主要包括兩部分功能：一是對于已知的系統(tǒng)外部信號進(jìn)行延時(shí)；二是系統(tǒng)根據(jù)要求產(chǎn)生一些觸發(fā)信號，并根據(jù)要求進(jìn)行延時(shí)。系統(tǒng)的延時(shí)時(shí)間，觸發(fā)信號的頻率和脈沖寬度能夠根據(jù)實(shí)際需要通過遠(yuǎn)端的PC進(jìn)行實(shí)時(shí)調(diào)整。
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