基于Web服務(wù)器的可重構(gòu)硬件測(cè)控平臺(tái)源代碼（西安電子科技大學(xué)）——第一屆OpenHW開(kāi)放源碼硬件與嵌入式大賽二等獎(jiǎng)
所屬分類(lèi)：源代碼
上傳者：chenyy
文檔大?。?span>5931 K
標(biāo)簽： FPGA
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文檔介紹：首先，本系統(tǒng)基本構(gòu)架為一WEB服務(wù)器。我們利用開(kāi)發(fā)板上的板級(jí)10/100以太網(wǎng)物理層接口芯片與客戶(hù)端用經(jīng)過(guò)特殊處理的網(wǎng)線(xiàn)連接。利用專(zhuān)門(mén)為嵌入式系統(tǒng)設(shè)計(jì)的精簡(jiǎn)的TCP/IP協(xié)議?！猯wip協(xié)議棧，再加上HTTP協(xié)議，使客戶(hù)端和服務(wù)器實(shí)現(xiàn)Internet通信，實(shí)現(xiàn)遠(yuǎn)端命令操作和數(shù)據(jù)傳輸。其次，本系統(tǒng)的另一大特色是系統(tǒng)的可重構(gòu)功能。利用System ACE?這一新的配置技術(shù)，實(shí)現(xiàn)系統(tǒng)從硬件到軟件的重新配置。而且重配置的操作也是基于網(wǎng)絡(luò)遠(yuǎn)端傳輸。從而使系統(tǒng)兼具靈活、簡(jiǎn)捷、硬件資源可復(fù)用、易于升級(jí)等多種優(yōu)良性能。另外，本系統(tǒng)具有較高的數(shù)據(jù)吞吐帶寬。系統(tǒng)中SDRAM和PLB總線(xiàn)同步工作于100MHz，所以對(duì)于64bit的DDR SDRAM內(nèi)存條來(lái)說(shuō)最大訪(fǎng)問(wèn)帶寬可以達(dá)到1.6GB/s，可以滿(mǎn)足一般數(shù)據(jù)傳送對(duì)高速接口的要求。
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