FPGA設(shè)計的驗證技術(shù)及其應(yīng)用原則
所屬分類：技術(shù)論文
上傳者：serena
文檔大?。?span>295 K
標(biāo)簽： FPGA
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文檔介紹：FPGA設(shè)計和驗證工程師當(dāng)今面臨的最大挑戰(zhàn)之一是時間和資源制約。隨著FPGA在速度、密度和復(fù)雜性方面的增加，完成一個完整時序驗證對人力和計算機(jī)處理器、存儲器提出了更多更高的要求。
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