基于FPGA的?？臻g管理器的研究和設(shè)計
所屬分類：技術(shù)論文
上傳者：aet
文檔大?。?span>325 K
標簽： FPGA
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文檔介紹：提出了一種將堆?？臻g劃分為任務(wù)棧和中斷嵌套棧的設(shè)計結(jié)構(gòu)，使堆?？臻g最小化。采用VHDL硬件語言，在FPGA設(shè)備上模擬實現(xiàn)了具有自動檢驗功能的棧空間管理器。棧空間管理器由不同功能的邏輯模塊組成，主要闡述了狀態(tài)控制邏輯模塊和地址產(chǎn)生邏輯模塊的設(shè)計方法。
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