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英特爾正式宣布出售Altera 51%股份

英特爾正式宣布出售Altera 51%股份

4 月 14 日消息，英特爾北京時間 20:30 正式宣布同私募股權(quán)企業(yè) Silver Lake 銀湖資本達(dá)成 FPGA 子公司 Altera 股份出售協(xié)議。Silver Lake 將以 87.5 億美元的估值買下 Altera 51% 的股份，英特爾繼續(xù)持有剩余 49% 股份。

基于SoPC的嵌入式文字識別系統(tǒng)設(shè)計

設(shè)計了一種基于SoPC的嵌入式文字識別系統(tǒng)。在FPGA平臺下，基于SoPC框架搭建軟硬件協(xié)同系統(tǒng)，設(shè)計硬件電路完成文字圖像的采集和預(yù)處理，嵌入Linux系統(tǒng)，使用其下的識別引擎完成文字圖像的識別。采用Altera公司的SoPC builder構(gòu)建系統(tǒng)框架，Quartus II完成硬件電路的設(shè)計，在宿主機(jī)Linux環(huán)境下完成了軟件部分的交叉編譯并嵌入到FPGA平臺。整體設(shè)計在DE2-70開發(fā)板上完成了系統(tǒng)驗證。

發(fā)表于：11/7/2011

【圖集】Altera 2011全國大學(xué)教師會議——學(xué)術(shù)交流的好平臺

Altera中國區(qū)大學(xué)項目經(jīng)理徐平波先生首先致開幕詞，感謝各高校教師長期以來對Altera大學(xué)計劃的支持。隨后，重慶大學(xué)副校長孟衛(wèi)東致歡迎詞，并介紹了重慶市以及重慶大學(xué)在科研方面的成就。重慶大學(xué)通信工程學(xué)院院長曾孝平教授介紹了重慶大學(xué)依托Altera聯(lián)合實驗室培養(yǎng)創(chuàng)新人才的情況，杭州電子科技大學(xué)教授潘松從FPGA技術(shù)與模擬電子教學(xué)談了創(chuàng)新培養(yǎng)的經(jīng)驗，臺灣國立陽明大學(xué)教授張寅淺談了FPGA在醫(yī)學(xué)上的應(yīng)用暨醫(yī)學(xué)工程在臺灣的現(xiàn)狀，清華大學(xué)副教授羅嶸向與會老師報告了其最新研究成果，北京航天航空大學(xué)教授夏宇聞則分享了多年來開展Altera FPGA培訓(xùn)的心得體會，清華大學(xué)教授周祖成介紹了由Altera等公司贊助的2012年中國研究生電子設(shè)計競賽的相關(guān)情況。除了教授們關(guān)于學(xué)術(shù)和教學(xué)經(jīng)驗的演講之外，Altera亞太區(qū)FAE總監(jiān)羅煒亮先生、Altera資深應(yīng)用工程師陳燕女士、Altera專家級應(yīng)用工程師王欣先生分別重點介紹了Altera的最新FPGA——基于ARM Cortex-A9的SoC FPGA以及用來代替SoPC Builder的Qsys系統(tǒng)級集成工具。Altera合作伙伴友晶科技總經(jīng)理彭顯恩介紹了其28 nm新平

發(fā)表于：11/7/2011

【圖集】Altera亞太區(qū)FAE總監(jiān)羅煒亮、友晶科技彭顯恩及高校教師送上祝福和禮品

【圖集】Altera亞太區(qū)FAE總監(jiān)羅煒亮、友晶科技彭顯恩及高校教師送上祝福和禮品

發(fā)表于：11/7/2011

【圖集】Altera 2011亞洲創(chuàng)新設(shè)計大賽及電子設(shè)計文章競賽頒獎頒獎

2011亞洲創(chuàng)新設(shè)計大賽及電子設(shè)計文章競賽頒獎頒獎

發(fā)表于：11/7/2011

萊迪思發(fā)布新款ispLEVER CLASSIC設(shè)計工具套件

萊迪思半導(dǎo)體公司（NASDAQ: LSCC）今日發(fā)布ispLEVER® Classic 1.5版設(shè)計工具套件。現(xiàn)在這個基于Windows的新版本可以免費從萊迪思網(wǎng)站下載并申請許可證，www.latticesemi.com/ispleverclassic。功能豐富的ispLEVER Classic 1.5設(shè)計軟件將繼續(xù)支持超低功耗的ispMACH® 4000ZE CPLD系列，以及所有萊迪思成熟的可編程器件，包括GAL®和ispGAL?簡單PLD（SPLD）；ispLSI®、MACH®、ispMACH和ispXPLD®復(fù)雜PLD （CPLD）；ORCA?、FPSC和ispXPGA®現(xiàn)場可編程門陣列（FPGA）；以及ispGDX®/ispGDX2?交叉點器件。

發(fā)表于：11/7/2011

【圖集】Altera亞洲創(chuàng)新設(shè)計大賽兩岸總決賽作品

Altera亞洲創(chuàng)新設(shè)計大賽兩岸總決賽作品

發(fā)表于：11/7/2011

基于DSP Builder的回波抵消器設(shè)計與實現(xiàn)

采用DSP Builder進(jìn)行設(shè)計，使用圖形界面，用模塊化設(shè)計代替以往的VHDL語言編程，并綜合多種設(shè)計工具，便于研究者迅速地將算法級的構(gòu)思應(yīng)用于系統(tǒng)設(shè)計中，從而可以專注于系統(tǒng)算法的設(shè)計，避免了繁瑣的語言編程和電路設(shè)計，提高了設(shè)計速度，縮短設(shè)計周期，為產(chǎn)品開發(fā)節(jié)約了研發(fā)時間。

發(fā)表于：11/5/2011

Xilinx與Cadence推出可擴(kuò)展虛擬平臺用于嵌入式軟件開發(fā)

Xilinx, Inc. (NASDAQ: XLNX)與 Cadence 設(shè)計系統(tǒng)公司 (NASDAQ: CDNS) 今天宣布共同合作開發(fā)了業(yè)界首個用于在硬件成型之前對基于Xilinx Zynq?-7000可擴(kuò)展式處理平臺(EPP)系統(tǒng)進(jìn)行系統(tǒng)設(shè)計、軟件開發(fā)與測試的虛擬平臺。該方案進(jìn)一步改善了Xilinx的基于ARM®處理器平臺的開發(fā)環(huán)境，為嵌入式軟件設(shè)計師改善了開發(fā)流程，讓軟件內(nèi)容能夠驅(qū)動硬件設(shè)計。參加ARM TechCon的與會者可以在Xilinx的207號展臺看到這種可擴(kuò)展式虛擬平臺的演示。

發(fā)表于：11/3/2011

基于DSP的LED大屏幕顯示系統(tǒng)

目前采用的LED大屏幕顯示系統(tǒng)的控制電路，大多由單個或多個CPU及復(fù)雜的外圍電路組成，這種電路設(shè)計，單片機(jī)編程比較復(fù)雜，整個電路的調(diào)試比較麻煩，可靠性和實時性很難得到保證。針對這種情況，提出一種SD卡存儲顯示文件，由TMS320LF2407A和EPM240配合完成的大屏幕設(shè)計方案，使得動畫的變換和處理與屏幕的顯示控制完全分離，各模塊任務(wù)分明，功能完善，充分發(fā)揮了DSP以及CPLD各自的優(yōu)點，實現(xiàn)高性能的無閃爍顯示。

發(fā)表于：11/2/2011

針對BGA封裝可編程邏輯器件設(shè)計的低成本布板技術(shù)

隨著可編程邏輯器件的演變，BGA封裝向著引腳數(shù)增加，引腳間距減小的方向發(fā)展。引腳間距或焊球間距是指兩個相鄰引腳中心或焊球中心之間的距離。引腳間距對從PLD引出I/O的布線產(chǎn)生重大影響。更高引腳數(shù)和更小引腳間距的發(fā)展趨勢使得系統(tǒng)設(shè)計師面臨巨大挑戰(zhàn)，他們必須使用更激進(jìn)的設(shè)計規(guī)則，通過先進(jìn)的疊層和過孔技術(shù)以滿足設(shè)計要求。

發(fā)表于：11/2/2011