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Synopsys推出用于早期RTL探測的DC Explorer

通過容忍不完整數(shù)據(jù)的早期探測加速了設(shè)計實現(xiàn)進程解決方案
2011-04-06
作者:Synopsys

  全球領(lǐng)先的半導(dǎo)體設(shè)計、驗證和制造軟件及知識產(chǎn)權(quán)(IP)供應(yīng)商新思科技有限公司(Synopsys, Inc., 納斯達克股票市場代碼:SNPS)日前宣布:其Galaxy™設(shè)計實現(xiàn)平臺上又增加最新的工具DC Explorer,以顯著加快高質(zhì)量設(shè)計數(shù)據(jù)的開發(fā)速度。為了滿足當前那些大規(guī)模集成的、擁有數(shù)百萬實例的、“千兆級”的設(shè)計所面臨的極具挑戰(zhàn)性的進度要求,工程師們需要一種RTL探測解決方案,以確保他們能快速而高效地對不同的設(shè)計配置進行假設(shè)分析—甚至在設(shè)計數(shù)據(jù)完成之前就可進行 — 同時為實現(xiàn)流程創(chuàng)建一個更好的起始點。DC Explorer通過提供快出5倍的運行時間,以及與DC Ultra™ RTL綜合10%的時序和面積關(guān)聯(lián)度來解決了這個挑戰(zhàn)。它也容忍不完整的設(shè)計數(shù)據(jù),因此在設(shè)計流程的很早期就能指導(dǎo)高質(zhì)量的RTL和約束條件開發(fā),從而確保了一個高度融合的設(shè)計流程。不久前,在加利福尼亞圣何塞舉行的Synopsys 用戶大會 (SNUG™)上,用戶們已概況介紹了DC Explorer在提升生產(chǎn)效率所帶來的各種新的好處。
 
  “在設(shè)計開發(fā)早期階段的提升生產(chǎn)效率能夠顯著加速我們的IC實現(xiàn)流程。”意法半導(dǎo)體中央CAD和設(shè)計解決方案機構(gòu)數(shù)字解決方案和先導(dǎo)項目組副經(jīng)理Giancarlo Sada說:“我們在多個設(shè)計的不同開發(fā)階段運行了DC Explorer,并見證了至少快出4倍的運行時間和與DC Ultra10%的關(guān)聯(lián)度。這將使我們的設(shè)計師在流程的早期就能有效地評估各種不同的實現(xiàn)方案,調(diào)整設(shè)計數(shù)據(jù),并創(chuàng)建一個高度融合和更快速的設(shè)計流程。”
 
  在當前的龐大而復(fù)雜IC的早期RTL設(shè)計開發(fā)階段,設(shè)計數(shù)據(jù)有多個來源,并且一致性和完整性程度各有不同。工程師們?nèi)鄙僖环N快速而有效的方式來試探和完善數(shù)據(jù)、修復(fù)設(shè)計問題和為RTL綜合創(chuàng)建一個更好的起始點,進而形成一個高度融合的實現(xiàn)流程。DC Explorer為設(shè)計師們提供了他們所需要的RTL探測功能,幫助他們在實現(xiàn)之前就能有效地識別潛在的設(shè)計問題和需改進之處。另外,當輸入RTL、約束條件和現(xiàn)有的庫模型不完整時,DC Explorer就會生成一個關(guān)于哪些需要完成和修復(fù)的綜合報告,從而加速了設(shè)計創(chuàng)建過程。最后,DC Explorer與Design Compiler® RTL綜合器語句兼容,這使得它非常容易使用,并能很容易地部署到現(xiàn)有的客戶流程中。
 
  “Synopsys不斷致力于幫助我們的客戶提高其生產(chǎn)能力和為他們的千兆級系統(tǒng)級芯片器件縮短設(shè)計周期。”Synopsys高級副總裁和實現(xiàn)方案事業(yè)部總經(jīng)理Antun Domic說:“DC Explorer為IC設(shè)計師們提供了另一個重要的產(chǎn)能提升工具,使他們能夠在設(shè)計流程的很早期就能執(zhí)行RTL探測,從而提升了設(shè)計數(shù)據(jù)的質(zhì)量和顯著加速了設(shè)計進程。”
 
供貨
  DC Explorer現(xiàn)只針對有限的客戶供貨
 

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