基于DSP Builder的插值濾波器的設計及FPGA實現
所屬分類：參考設計
上傳者：aet
文檔大小：387 K
標簽： SoPC
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文檔介紹：在數字接收機中，通常需要對采樣的數據進行一定倍數的插值。采用Altera公司的DSP Builder設計工具，在MATLAB/Simulink中建立相應的算法模型并仿真。通過引入回路硬件模塊，將硬件平臺接入由Simulink構建的仿真測試回路中進行軟硬件協同仿真，最后可以直接生成FPGA的下載文件。該方法簡化了設計流程，降低了開發(fā)成本和周期，具有廣闊的應用前景。
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