一種低峰均功率比的數字梳狀譜模塊設計
所屬分類:技術論文
上傳者:wwei
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標簽: 梳狀譜 遺傳算法 峰均功率比
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文檔介紹:為了提高多通道接收機的通道間誤差校準效率,設計并實現了一種低峰均功率比的數字梳狀譜校準源模塊。該模塊基于FPGA+DAC的硬件結構,采用軟件DDS原理方式來產生梳狀譜信號。為了降低梳狀譜信號的峰均功率比,利用遺傳算法對信號的各個子載波的初始相位進行了優(yōu)化,計算出一組優(yōu)于代數次優(yōu)解的初始相位組合,將峰均功率比從次優(yōu)解的4.98 dB降低到了3.98 dB,同時提高了梳狀譜信號的子載波功率和帶外雜散抑制,優(yōu)化了梳狀譜模塊的信號質量。該模塊在梳狀譜信號輸出范圍170 MHz~230 MHz,頻譜間隔1 MHz情況下,子載波功率為-35.5 dBm,帶外雜散抑制為64 dBc,完全滿足校準源指標要求。
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