數(shù)據(jù)采集在現(xiàn)代工業(yè)生產(chǎn)及科學(xué)研究中的重要地位日益突出，對(duì)實(shí)時(shí)高速數(shù)據(jù)采集的要求也不斷提高。在信號(hào)測(cè)量、圖像處理、音頻信號(hào)處理等一些高速、高精度的測(cè)量中，都要求進(jìn)行高速、高精度的數(shù)據(jù)采集。這就對(duì)數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)提出兩個(gè)方面的要求：一方面，要求接口簡(jiǎn)單靈活且有較高的數(shù)據(jù)傳輸率；另一方面，由于數(shù)據(jù)量通常都較大，要求主機(jī)能夠?qū)?shù)據(jù)做出快速反應(yīng)，并及時(shí)分析和處理。
實(shí)現(xiàn)數(shù)據(jù)采集與傳輸，可選擇如下3種方法：
①使用傳統(tǒng)的串／并口。傳統(tǒng)的串口(如RS232)，其傳輸速率為幾十kb／s到100 kb／s，而系統(tǒng)所要求的數(shù)據(jù)傳輸速率很高，而且還要實(shí)現(xiàn)數(shù)據(jù)的采集與傳輸同步進(jìn)行，串口的速率遠(yuǎn)遠(yuǎn)達(dá)不到實(shí)時(shí)要求；對(duì)于并口，雖然它的傳輸速率可達(dá)到1 Mb／s以上，但由于探測(cè)器與主機(jī)相距較遠(yuǎn)，因此走線比較復(fù)雜。
②采用通用的高速數(shù)據(jù)采集卡。高速數(shù)據(jù)采集卡(如ISA或PCI卡)雖然在數(shù)據(jù)存取速度上可滿足系統(tǒng)要求，但仍然存在很多缺點(diǎn)，比如安裝復(fù)雜，價(jià)格昂貴，兼容性不好，受計(jì)算機(jī)插槽數(shù)量、地址和中斷資源的限制，可擴(kuò)展性較差等。
③使用USB2．0通用串行接口總線。USB接口是一種重要的計(jì)算機(jī)外設(shè)接口，它支持熱插拔和即插即用，使用非常方便。USB2．0支持高達(dá)480 Mbps的數(shù)據(jù)傳輸速率。USB接口可實(shí)現(xiàn)計(jì)算機(jī)與多個(gè)外圍設(shè)備的簡(jiǎn)單、高速互聯(lián)，將USB技術(shù)應(yīng)用于數(shù)據(jù)采集是非常適合的。經(jīng)綜合考慮，本文選擇采用USB2．0接口來完成對(duì)數(shù)據(jù)的采集與傳輸。
1 數(shù)據(jù)采集和傳輸系統(tǒng)方案設(shè)計(jì)
數(shù)據(jù)采集和傳輸系統(tǒng)主要由3部分組成，USB2．0通道、FPGA和A／D轉(zhuǎn)換器組成，如圖1所示。
CY7C68013是Cypress公司推出的EZ-USB FX2系列智能USB接口芯片。其作用是將主機(jī)所發(fā)送的命令序列經(jīng)USB2．0端口輸出，實(shí)現(xiàn)對(duì)數(shù)據(jù)采集系統(tǒng)的控制；同時(shí)把A／D轉(zhuǎn)換器采集的數(shù)據(jù)以高速的數(shù)據(jù)序列形式發(fā)送到主機(jī)。其中，USB2．0端口提供一個(gè)能和計(jì)算機(jī)連接的數(shù)據(jù)傳輸接口。
FPGA利用內(nèi)部的SRAM提供數(shù)據(jù)輸入／輸出的雙緩沖功能。采用雙緩沖的原因同USB中的大端點(diǎn)所配置的雙緩沖類似，均是防止數(shù)據(jù)的溢出和保證數(shù)據(jù)傳輸?shù)倪B續(xù)性。本文選用Altera公司的CycIone系列芯片EP1C3T144。
A／D轉(zhuǎn)換器將所要采集的模擬量轉(zhuǎn)換成數(shù)字量，通過濾波和放大后，由FPGA接收、緩沖、存儲(chǔ)，經(jīng)USB2．0端口傳回至主機(jī)工作站。高速A／D轉(zhuǎn)換器采用轉(zhuǎn)換速率為20 MHz的MAX1425。
系統(tǒng)工作過程為：主機(jī)通過CY7C68013給數(shù)據(jù)采集系統(tǒng)一個(gè)采樣控制命令，存入FPGA的控制寄存器中。FPGA根據(jù)該命令向A／D轉(zhuǎn)換器發(fā)出相應(yīng)控制信號(hào)。由于ADC采樣頻率為10 MHz，為和PC運(yùn)行速度相匹配，在FPGA內(nèi)部生成一個(gè)FIFO緩存器。A／D轉(zhuǎn)換器在FPGA的ADC接口控制電路控制下，把模擬信號(hào)轉(zhuǎn)換成數(shù)字信號(hào)，并將指定通道的采樣數(shù)據(jù)存入FPGA內(nèi)部FIFO緩存。同時(shí)，F(xiàn)PGA的USB接口控制邏輯查詢CY7C68013是否空閑，如果空閑，那么由FPGA的USB接口控制邏輯將指定通道的采樣結(jié)果，從FPGA內(nèi)部FIFO緩存送入CY7C68013的內(nèi)部FIFO。當(dāng)內(nèi)部的FIFO容量達(dá)到一定程度后，CY7C68013自動(dòng)將數(shù)據(jù)打包傳送到PC機(jī)。由于固件程序把CY7C68013設(shè)置為特定的自動(dòng)模式，因此CY7C68013把數(shù)據(jù)送往PC機(jī)期間的所有操作無需CY7C68013中CPU的干預(yù)，從而保證足夠的數(shù)據(jù)傳輸速率。采樣過程中FPGA的USB接口控制邏輯依次取走批量數(shù)據(jù)，在USB接口打包傳送時(shí)A／D轉(zhuǎn)換持續(xù)進(jìn)行，F(xiàn)PGA內(nèi)部FIFO也被持續(xù)寫入轉(zhuǎn)換結(jié)果。
2 硬件設(shè)計(jì)
系統(tǒng)的硬件由A／D轉(zhuǎn)換電路、數(shù)據(jù)采集與傳輸控制電路和接口電路構(gòu)成。
2．1 A／D轉(zhuǎn)換電路
A／D轉(zhuǎn)換電路是整個(gè)系統(tǒng)的重要組成部分。由低通濾波器、多路選擇開關(guān)和A／D轉(zhuǎn)換器構(gòu)成，如圖2所示。本文選用Maxim公司的A／D轉(zhuǎn)換芯片MAX1425。
8路模擬輸入信號(hào)分別經(jīng)過由運(yùn)放THS4052構(gòu)成的抗混疊低通濾波器去除高頻成分，防止信號(hào)產(chǎn)生“混疊現(xiàn)象”。1／8模擬信號(hào)選擇器根據(jù)來自FPGA板的地址碼，控制模擬信號(hào)選擇器74HC4051選通8路輸入中的1路到輸出端，送到A／D轉(zhuǎn)換器MAX1425將模擬信號(hào)轉(zhuǎn)換為數(shù)字信號(hào)。MAX1425的控制信號(hào)由FPGA板提供，在控制信號(hào)的作用下以適當(dāng)?shù)臅r(shí)序完成轉(zhuǎn)換工作。
2．2 數(shù)據(jù)采集與傳輸控制電路
數(shù)據(jù)采集與傳輸控制電路的開發(fā)工作主要集中在FPGA上。FPGA負(fù)責(zé)CY7C68013與ADC芯片之間的緩沖與控制，一邊與ADC接口，另一邊與USB接口，產(chǎn)生數(shù)據(jù)采集、通道切換、A／D轉(zhuǎn)換、FIFO所需的全部控制信號(hào)；實(shí)現(xiàn)對(duì)傳輸數(shù)據(jù)的緩存、讀／寫控制、時(shí)鐘、輸出使能、端點(diǎn)的選擇，以及對(duì)ADC的控制等功能。
如圖3所示，數(shù)據(jù)采集與傳輸控制電路由FIFO、USB接口控制狀態(tài)機(jī)、ADC接口控制狀態(tài)機(jī)、三態(tài)門緩沖器、控制寄存器組幾部分構(gòu)成。圖中，由右向左的寬箭頭表示數(shù)據(jù)流；FD[9：0]是與USB接口芯片連接的雙向數(shù)據(jù)總線；由左向右的寬箭頭表示傳送來自PC機(jī)的控制信號(hào)；單線箭頭表示輸入／輸出，以及FPGA內(nèi)部各個(gè)模塊間的控制信號(hào)線。
從數(shù)據(jù)流向看，數(shù)據(jù)在ADC接口控制狀態(tài)機(jī)的協(xié)調(diào)下通過ADC接口送入FPGA的FIFO中。經(jīng)過FIFO的緩沖后，在USB接口控制狀態(tài)機(jī)的協(xié)調(diào)下，當(dāng)USB接口控制狀態(tài)機(jī)對(duì)三態(tài)門的輸出為高時(shí)，三態(tài)門開啟，數(shù)據(jù)通過三態(tài)門傳輸?shù)紽PGA外部的USB接口；當(dāng)對(duì)三態(tài)門的輸出為低時(shí)，三態(tài)門呈現(xiàn)高阻態(tài)，F(xiàn)PGA的這幾個(gè)引腳作為輸入引腳。此狀態(tài)下，來自PC機(jī)的控制信號(hào)通過CY7C68013從FD[15：0]送人FPGA中。在USB接口控制狀態(tài)機(jī)的控制下，來自PC機(jī)的控制信息存人控制寄存器組，并由ADC接口控制狀態(tài)機(jī)來控制送往FPGA外的ADC接口，作為對(duì)ADC的控制(如通道的選擇)。
2．3 接口電路
2．3．1 FPGA內(nèi)的ADC接口模塊
MAX1425和74HC4051的控制信號(hào)都由FPGA產(chǎn)生，接口電路如圖4所示。
FPGA的工作時(shí)鐘為60 MHz，該時(shí)鐘經(jīng)過分頻后，提供20 MHz給MAX1425作為工作時(shí)鐘，同時(shí)也作為FP-GA內(nèi)其他邏輯的工作時(shí)鐘。由FPGA內(nèi)狀態(tài)機(jī)控制，當(dāng)CS為低和ADC_Convst為高時(shí)，MAX1425進(jìn)入采樣保持狀態(tài)。當(dāng)Clock的第一個(gè)上升沿到來，MAX1425開始轉(zhuǎn)換。RD輸出為低時(shí)，MAX1425把轉(zhuǎn)換結(jié)果放到數(shù)據(jù)總線上，F(xiàn)PGA開始讀入10位數(shù)據(jù)(FD[15：0]中的10～15六位數(shù)據(jù)線懸空，使數(shù)據(jù)線和A／D的位數(shù)匹配)。FPGA控制寄存器的Sel[2：O]信號(hào)作為74Hc4051的通道選擇信號(hào)，從8路模擬輸入入信號(hào)中選擇1路作為MAX1425的輸入。完成一次轉(zhuǎn)換后，當(dāng)ADC_Convst：再次為高時(shí)，開始下一輪轉(zhuǎn)換。
2．3．2 FPGA內(nèi)的USB接口模塊
圖5是Slave模式下CY7C68013與FPGA的連接示意圖。中間是FPGA中USB接口模塊部分對(duì)應(yīng)的信號(hào)。
2．3．3 FPGA內(nèi)的USB接口控制狀態(tài)機(jī)
FPGA內(nèi)USB接口控制狀態(tài)機(jī)的狀態(tài)轉(zhuǎn)移圖如圖6所示。共有6個(gè)狀態(tài)，復(fù)位信號(hào)的模式設(shè)置為異步復(fù)位。狀態(tài)機(jī)主要分為讀、寫兩部分：讀取EP2中所包含的命令，存到FPGA的控制寄存器組中；將FPGA的FIFO中的數(shù)據(jù)讀出，寫入EP6端點(diǎn)緩沖區(qū)。
該狀態(tài)機(jī)工作過程為：
?、傧到y(tǒng)加電或復(fù)位后，狀態(tài)機(jī)進(jìn)入空閑狀態(tài)(idle)。
?、谠诳臻e狀態(tài)下，當(dāng)EP2不為空時(shí)進(jìn)入read_0狀態(tài)，從EP2中讀出PC機(jī)傳來的控制命令。隨后進(jìn)入read_1狀態(tài)，把命令存到FPGA內(nèi)控制寄存器中，并把FPGA內(nèi)的FIFO清空(fifo_ach1='1')，以準(zhǔn)備存儲(chǔ)采樣數(shù)據(jù)。之后再回到idle狀態(tài)。
③在空閑狀態(tài)下，當(dāng)EP2為空(FX2_empty='0')，而FPGA的FIFO不為空(empty='0')，且EP6不滿時(shí)，進(jìn)入write_0狀態(tài)。之所以要看EP2是否為空，是想優(yōu)先處理PC機(jī)通過EP2傳來的命令。在write_0狀態(tài)下，選中對(duì)CY7C68013的EP6操作(ADDR=2'h2)，同時(shí)從FPGA內(nèi)部的FIFO中讀出一個(gè)數(shù)據(jù)。之后進(jìn)入write_1狀態(tài)，把數(shù)據(jù)寫入CY7C68013。然后進(jìn)入write_2狀態(tài)，write_2狀態(tài)的輸出與idle狀態(tài)相同，目的是提供一個(gè)時(shí)鐘周期的延遲。因?yàn)镕PGA工作于60 MHz的時(shí)鐘下，比CY7C68013快，所以加入一個(gè)延遲以保證可靠的數(shù)據(jù)傳輸。
3 軟件設(shè)計(jì)
如圖7所示，數(shù)據(jù)采集系統(tǒng)的軟件設(shè)計(jì)包括3部分；CY7C68013的固件程序、Windows平臺(tái)上USB設(shè)備驅(qū)動(dòng)程序和應(yīng)用程序。在Windows操作平臺(tái)下，當(dāng)有新的設(shè)備接入時(shí)，操作系統(tǒng)就會(huì)依據(jù)設(shè)備回送的有關(guān)信息自動(dòng)地調(diào)用相應(yīng)的設(shè)備驅(qū)動(dòng)程序。當(dāng)USB設(shè)備的設(shè)備驅(qū)動(dòng)程序裝載后，主機(jī)應(yīng)用程序通過USB設(shè)備驅(qū)動(dòng)程序與系統(tǒng)USBDI(USB Device Inte
固件架構(gòu)實(shí)現(xiàn)了與USB兼容的外圍設(shè)備所需的基本功能。經(jīng)過鏈接(Iink)最小的描述符表文件，并對(duì)該架構(gòu)作適當(dāng)?shù)男薷幕蛱砑硬糠执涂梢詷?gòu)建出完全兼容的設(shè)備固件架構(gòu)。通過鏈接Cypress公司所提供的子程序，就有可能逐漸地構(gòu)建出完全兼容功能的設(shè)備。固件程序的流程如圖8所示。
4 結(jié) 論
基于FPGA和USB2．0的高速實(shí)時(shí)數(shù)據(jù)采集系統(tǒng)，采用計(jì)算機(jī)的USB接口作為數(shù)據(jù)傳輸接口。軟件設(shè)計(jì)工作包括MCU的固件程序設(shè)計(jì)、計(jì)算機(jī)上USB接口驅(qū)動(dòng)程序設(shè)計(jì)、計(jì)算機(jī)上應(yīng)用程序設(shè)計(jì)等幾部分。MCU在FPGA和計(jì)算機(jī)之間起橋梁的作用，既要對(duì)USB接口進(jìn)行控制，實(shí)現(xiàn)與計(jì)算機(jī)的通信，接受計(jì)算機(jī)的控制，又要對(duì)它與FPGA的接口進(jìn)行設(shè)置和控制，還會(huì)與FPGA進(jìn)行對(duì)話以實(shí)現(xiàn)對(duì)FPGA的工作模式進(jìn)行設(shè)置。