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基于FPGA的梳狀譜通信干擾信號(hào)設(shè)計(jì)與研究
  • 基于FPGA的梳狀譜通信干擾信號(hào)設(shè)計(jì)與研究

    為了有效測(cè)試通信電臺(tái)的實(shí)際抗干擾性能,提出了一種基于FPGA的高斯白噪聲梳狀譜干擾信號(hào)設(shè)計(jì)方案,相比傳統(tǒng)隨機(jī)相位調(diào)頻梳狀譜干擾,在對(duì)抗寬帶通信系統(tǒng)時(shí)干擾效果更強(qiáng)。該方案以FPGA為核心,通過(guò)改進(jìn)Ziggurat算法和DDS技術(shù)實(shí)現(xiàn)梳狀譜干擾信號(hào)的生成,在滿(mǎn)足高速、高性能的同時(shí),具有較強(qiáng)的靈活性。并通過(guò)DA芯片輸出,實(shí)現(xiàn)了3~11個(gè)梳狀譜信號(hào)的生成。實(shí)驗(yàn)結(jié)果表明:生成的梳狀譜干擾信號(hào)頻率控制誤差小于0.001%,干擾效果量化一個(gè)指標(biāo)。

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