基于邊界控制的安全SoC芯片硬件結(jié)構(gòu)設(shè)計(jì)
所屬分類：參考設(shè)計(jì)
上傳者：aet
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標(biāo)簽： 異構(gòu)多核 片上總線 硬件隔離
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文檔介紹：為滿足大批量數(shù)據(jù)處理和信息安全的需要，基于通用處理器與專用密碼協(xié)處理器設(shè)計(jì)了一款異構(gòu)多核安全SoC芯片。在分析了高性能SoC主要結(jié)構(gòu)和安全問(wèn)題的基礎(chǔ)上，融合安全硬件結(jié)構(gòu)及邊界控制思想，設(shè)計(jì)了密碼服務(wù)區(qū)和應(yīng)用開(kāi)發(fā)區(qū)分離的多層安全SoC芯片硬件架構(gòu)。對(duì)比不同權(quán)限電路設(shè)計(jì)方案后，采用真值表方法設(shè)計(jì)專用安全控制單元來(lái)實(shí)現(xiàn)兩個(gè)區(qū)域的硬件隔離，并根據(jù)SoC芯片受到的安全威脅設(shè)定安全攔截規(guī)則。采用EDA工具進(jìn)行仿真實(shí)驗(yàn)，結(jié)果表明安全控制單元能夠有效攔截應(yīng)用開(kāi)發(fā)區(qū)對(duì)密碼服務(wù)區(qū)的非法訪問(wèn)，保護(hù)芯片的安全而且產(chǎn)生的延遲較小。
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