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英偉達(dá)攜手聯(lián)發(fā)科發(fā)力ASIC市場

打造NVLink IP、長距離224G Serdes
2025-03-25
來源:芯智訊

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聯(lián)發(fā)科英偉達(dá)的合持續(xù)深化,除了硬件之外,在半導(dǎo)體IP方面,雙方也將攜手打造NVLink IP、長距離224G Serdes、車規(guī)AEC。業(yè)界分析,英偉達(dá)欲跨入ASIC領(lǐng)域,然由于品牌包袱,所以藉由聯(lián)發(fā)科將更能快速擴(kuò)展。

未來將有更多CSP業(yè)者尋求與聯(lián)發(fā)科合作,而一旦客戶采用NVLink IP,也能增加英偉達(dá)Switch解決方案之客戶采購意愿、達(dá)到雙贏局面。

在近期的英偉達(dá)GTC大會上,聯(lián)發(fā)科介紹了其Premiun ASIC設(shè)計服務(wù),顯示聯(lián)發(fā)科與英偉達(dá)的合作擴(kuò)展至IP領(lǐng)域,更彈性的商業(yè)模式,能提供各式客制化芯片/HBM4E等,并具有豐富的Cell Library,以及先進(jìn)制程、先進(jìn)封裝經(jīng)驗,提供定制化芯片完整解決方案。

聯(lián)發(fā)科指出,其SerDes技術(shù)為ASIC核心優(yōu)勢,涵蓋芯片互連、高速I/O、先進(jìn)封裝與內(nèi)存整合;攜手全球主要代工廠,于尖端制程節(jié)點深化合作,透過「設(shè)計技術(shù)協(xié)同優(yōu)化(DTCO)」,在性能、功耗與面積(PPA)間取得最佳平衡。

其中,112Gb/s DSP(數(shù)位信號處理器)-based之PAM-4接收器,于4奈米FinFET制程打造,實現(xiàn)超過52dB損耗補(bǔ)償,意謂更低信號衰減、更強(qiáng)捍之抗干擾特性;該技術(shù)不僅適用于以太網(wǎng)路、光纖長距傳輸?,F(xiàn)在聯(lián)發(fā)科更推出專為數(shù)據(jù)中心使用的224G Serdes、并已經(jīng)完成硅驗證。

根據(jù)調(diào)研機(jī)構(gòu)指出,部分CSP(云端服務(wù)供應(yīng)商)已在評價英偉達(dá)及聯(lián)發(fā)科之IP組合的定制化設(shè)計芯片。盡管谷歌TPU(張量處理器)進(jìn)度稍微遞延,第七代TPU預(yù)計會在明年第三季投入量產(chǎn),但采用3nm打造仍有望為聯(lián)發(fā)科增加超過20億美元之貢獻(xiàn)。

供應(yīng)鏈也透露,谷歌進(jìn)階到第八代的TPU,將會開始采用臺積電2nm制程,持續(xù)在先進(jìn)制程領(lǐng)域維持領(lǐng)先地位。業(yè)界也看好聯(lián)發(fā)科成為中小企業(yè)AI需求的主要受益者。

分析指出,英偉達(dá)與聯(lián)發(fā)科合作的GB10芯片基于Arm價格打造的CPU,以及市場期待已久的N1x WoA芯片即將發(fā)表,都能為聯(lián)發(fā)科營運(yùn)增色不少。


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