本電路可對(duì)5 MSPS、12位SAR型ADC AD7356的輸入信號(hào)進(jìn) 行單端轉(zhuǎn)差分轉(zhuǎn)換。該電路能夠提供充足的建立時(shí)間和 低阻抗，從而確保AD7356實(shí)現(xiàn)最高性能。對(duì)AD7356進(jìn)行 差分驅(qū)動(dòng)的理想方法是采用AD8138之類的差分放大器。 該器件可以用作單端轉(zhuǎn)差分放大器或差分轉(zhuǎn)差分放大 器。AD8138還能提供共模電平轉(zhuǎn)換。欲查看本電路筆 記，請(qǐng)?jiān)L問(wèn):www.analog.com/zh/CN-0041。

緩沖器增強(qiáng)時(shí)鐘完整性，幫助高性能、高速ADC實(shí)現(xiàn)額定性能

設(shè)計(jì)人員借助高性能、高速模數(shù)轉(zhuǎn)換器(ADC)，使系統(tǒng)具備高速度、高精度和高分辨率優(yōu)勢(shì)。選擇ADC的主要標(biāo)準(zhǔn)之 一是信噪比(SNR)。輔助設(shè)計(jì)要素會(huì)影響轉(zhuǎn)換器的性能，其中一項(xiàng)重要考慮因素是時(shí)鐘完整性。ADC輸入時(shí)鐘的抖動(dòng) 會(huì)降低信噪比性能，因此讓整個(gè)系統(tǒng)時(shí)鐘樹保持良好的低噪聲、低抖動(dòng)時(shí)鐘信號(hào)，的確是個(gè)大難題。

解決方案

ADI公司擁有種類豐富的時(shí)鐘緩沖器，旨在幫助設(shè)計(jì)人員應(yīng)對(duì)時(shí)鐘完整性挑戰(zhàn)。將時(shí)鐘緩沖器插在轉(zhuǎn)換器與系統(tǒng)時(shí) 鐘樹之間，LVPECL扇出緩沖器可輕松實(shí)現(xiàn)75 fs級(jí)的抖動(dòng)性能，并且偏斜極低，約為9 ps。這些緩沖器IC還能提供多達(dá) 12通道的低抖動(dòng)時(shí)鐘扇出，并且可以使受PCB上的長(zhǎng)走線影響而變得平緩的時(shí)鐘信號(hào)邊沿陡峭起來(lái)。 

用于數(shù)據(jù)轉(zhuǎn)換器的理想時(shí)鐘信號(hào)不僅應(yīng)具有低相位噪聲和低抖動(dòng)特性，而且要有非常陡峭的上升沿和下降沿。如果 只有一兩個(gè)轉(zhuǎn)換器需要非常陡峭的邊沿，將時(shí)鐘緩沖器ADCLK905、ADCLK907、 ADCLK914 和 ADCLK925 緊挨著轉(zhuǎn)換器， 便可提供極快的邊沿，且對(duì)時(shí)鐘信號(hào)噪聲的影響極小。除了提供陡峭的邊沿外，ADCLK914等器件還能提供高差分電 壓擺幅，可起到限制ADC耦合噪聲的作用。 

ADI公司可提供從1路輸出到12路輸出、采用不同邏輯系列的各種低抖動(dòng)時(shí)鐘緩沖器產(chǎn)品，以滿足高性能、高速ADC 的時(shí)鐘要求。