高速CMOS輸入DAC中的建立和保持時間測量
所屬分類：技術(shù)論文
上傳者：ADI
文檔大?。?span>236 K
標(biāo)簽： 數(shù)據(jù)轉(zhuǎn)換
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文檔介紹：為實現(xiàn)高速DAC的最佳性能，必須滿足一定的建立和保持時間要求。在200 MSPS至250 MSPS的時鐘速率下，F(xiàn)PGA/ASIC/DAC的全部時序預(yù)算并不是一件小事?？蛻羧粢瓿蓵r序驗證，必須清楚列出并明確定義數(shù)據(jù)手冊中的時序規(guī)格。
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