專為可編程邏輯設計師提供的節(jié)能方案
所屬分類：技術論文
上傳者：aet
文檔大小：234 K
標簽： CPLD
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文檔介紹：隨著政府實行更為嚴格的功耗規(guī)定，如何進一步降低待機功耗成為工程師設計過程中需要考慮的一個重要因素?，F(xiàn)代可編程邏輯器件動態(tài)電流要求極低，并能在集成了一個低成本晶振后實現(xiàn)門控時鐘網絡，對降低電子產品的系統(tǒng)功耗有很大的使用價值。
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