JPEG-LS多路并行譯碼的FPGA實現(xiàn)
所屬分類：技術論文
上傳者：aet
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文檔介紹：提出了一種基于FPGA的JPEG-LS的多路并行譯碼系統(tǒng),運用VHDL語言實現(xiàn),以提高圖像的譯碼速度.系統(tǒng)主要分為檢測模塊,譯碼模塊和碼流分配模塊三部分.在檢測模塊中提取和去除頭文件的圖像信息,譯碼模塊則根據(jù)算法對圖像數(shù)據(jù)進行恢復,碼流分配模塊為多路并行算法的關鍵,利用流水線結(jié)構(gòu)的思路采用乒乓操作將碼流從檢測模塊傳送到外部RAM.在譯碼時采用同樣的方法將數(shù)據(jù)送入多個譯碼模塊進行譯碼.
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