一種基于VHDL的通用全數(shù)字電路人工神經(jīng)網(wǎng)絡(luò)的設(shè)計(jì)
所屬分類：技術(shù)論文
上傳者：aet
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文檔介紹：從分析人工神經(jīng)網(wǎng)絡(luò)的設(shè)計(jì)原理入手，闡述了全數(shù)字電路人工神經(jīng)網(wǎng)絡(luò)的設(shè)計(jì)方法。通過一個小規(guī)模前饋人工神經(jīng)網(wǎng)絡(luò)的設(shè)計(jì)實(shí)例，簡要說明了利用VHDL語言及編譯平臺，完成一種可調(diào)整權(quán)值的通用人工神經(jīng)網(wǎng)絡(luò)的設(shè)計(jì)算法和流程。
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