《電子技術(shù)應(yīng)用》
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基于FPGA的自定义CPU架构设计
2020年电子技术应用第5期
李 俊1，任连新2，廖振雄3
1.深圳市合信自动化技术有限公司，广东 深圳518055； 2.华南理工大学 自动化科学与工程学院，广东 广州510640；3.深圳市科创思科技有限公司，广东 深圳518055
摘要： 为满足当前工业应用下越来越多的分布式计算的需求，提出了一种在FPGA芯片中构建自定义指令集的CPU的方式，以此来使FPGA具有类似于单片机的处理指令的能力。并且，这种能力的前提是复用计算单元，因此资源消耗有限，不会随着计算量的增加而增大。在自定义指令集CPU的改进型架构中，使用了并行计算的结构，使得运算速度大幅提升。最后，结合实际应用案例，移植电流环计算中的FOC算法到自定义CPU中运算。并用ModelSim软件进行仿真，测试其计算时间仅需7.48 μs。
中圖分類號(hào)： TN402
文獻(xiàn)標(biāo)識(shí)碼： A
DOI：10.16157/j.issn.0258-7998.200011
中文引用格式： 李俊，任連新，廖振雄. 基于FPGA的自定義CPU架構(gòu)設(shè)計(jì)[J].電子技術(shù)應(yīng)用，2020，46(5)：40-43，49.
英文引用格式： Li Jun，Ren Lianxin，Liao Zhenxiong. Design of custom CPU architecture based on FPGA[J]. Application of Electronic Technique，2020，46(5)：40-43，49.
Design of custom CPU architecture based on FPGA
Li Jun1，Ren Lianxin2，Liao Zhenxiong3
1.Shenzhen Co-trust Technology Limited Company，Shenzhen 518055，China； 2.College of Automation Science and Engineering，South China University of Technology，Guangzhou 510640，China； 3.Shenzhen Kechuangsi Technology Limited Company，Shenzhen 518055，China
Abstract： In order to meet the needs of more and more distributed computing in current industrial applications, this article proposes a way to build a custom instruction set CPU in an FPGA chip. In this way, the FPGA has the ability to process instructions similar to a microcontroller. Moreover, the premise of this capability is the reuse of computing units, so resource consumption is limited and will not increase as the amount of calculation increases. In the improved architecture of the custom instruction set CPU, a parallel computing structure is used, which greatly improves the operation speed. Finally, combining the actual application case, the FOC algorithm in the current loop calculation is transplanted to the operation in the custom CPU. And ModelSim software is used to simulate, its calculation time is only 7.48 μs.
Key words : custom instruction set；CPU architecture；FPGA；parallel computing structure；FOC

0 引言

    在目前的工業(yè)應(yīng)用環(huán)境下，許多的工業(yè)設(shè)備控制器中都包含有相當(dāng)復(fù)雜程度的算法。例如：狀態(tài)觀測(cè)器、卡爾曼濾波器、模糊控制算法、甚至是神經(jīng)網(wǎng)絡(luò)算法，不一而足。其中有些算法計(jì)算步驟復(fù)雜，同時(shí)又對(duì)控制帶寬有一定的要求，所以對(duì)設(shè)備的處理器芯片的運(yùn)算能力要求很高。因此，有些設(shè)備中可能會(huì)同時(shí)存在2個(gè)甚至多個(gè)處理器，分別完成不同的功能算法。這樣多個(gè)處理器分布式地處理不同的算法，完成不同的控制功能，無(wú)疑是一個(gè)解決思路。但是這又會(huì)帶來(lái)IC數(shù)量增加，成本上升的問(wèn)題。同時(shí)，現(xiàn)在的工業(yè)設(shè)備控制器的主控PCB上的集成度越來(lái)越高，在上面增加IC對(duì)硬件設(shè)計(jì)也是一種挑戰(zhàn)。

    現(xiàn)在許多設(shè)備控制主板上都會(huì)使用FPGA芯片來(lái)對(duì)外部信號(hào)做預(yù)處理。本文旨在提供一種在FPGA內(nèi)構(gòu)建精簡(jiǎn)架構(gòu)的CPU，使其可以具備算法處理能力的方法。這樣，在不額外增加處理器的前提下，可以讓FPGA也承擔(dān)一部分的計(jì)算任務(wù)[1]。




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作者信息:

李  俊1，任連新2，廖振雄3

(1.深圳市合信自動(dòng)化技術(shù)有限公司，廣東 深圳518055；

2.華南理工大學(xué) 自動(dòng)化科學(xué)與工程學(xué)院，廣東 廣州510640；3.深圳市科創(chuàng)思科技有限公司，廣東 深圳518055)

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