《電子技術應用》
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面向物聯(lián)網(wǎng)的SM4算法輕量級實現(xiàn)
2016年電子技術應用12期
朱坤崧1，戴紫彬1，張立朝1，李 偉1，2，朱偉民3
1.解放軍信息工程大學，河南 鄭州450001；2.復旦大學 專用集成電路與系統(tǒng)國家重點實驗室，上海201203； 3.江西省瑞金市廣播電影電視新聞中心，江西 瑞金342500
摘要： SM4算法是我國公布的第一個商用分組密碼算法，目前已經(jīng)得到了廣泛的應用。為更好地適應物聯(lián)網(wǎng)中資源受限設備處理能力低、存儲空間小等特點，設計并實現(xiàn)了基于資源重用的SM4算法輕量級處理架構。子密鑰擴展和輪函數(shù)交替使用核心電路完成子密鑰生成及加/解密運算，無需額外存儲32輪迭代所需子密鑰。密鑰存儲和檢測電路以及可正/逆序生成固定參數(shù)的實時生成電路，可大幅提高解密處理效率。實驗結果表明，所設計的輕量級處理架構資源占用小、品質因數(shù)高，非常適合于在物聯(lián)網(wǎng)中資源受限設備上使用，具有廣闊的應用前景。
中圖分類號： TN918；TP302
文獻標識碼： A
DOI：10.16157/j.issn.0258-7998.2016.12.006
中文引用格式： 朱坤崧，戴紫彬，張立朝，等. 面向物聯(lián)網(wǎng)的SM4算法輕量級實現(xiàn)[J].電子技術應用，2016，42(12)：27-30.
英文引用格式： Zhu Kunsong，Dai Zibin，Zhang Lichao，et al. Lightweight implementation of SM4 for Internet of things[J].Application of Electronic Technique，2016，42(12)：27-30.
Lightweight implementation of SM4 for Internet of things
Zhu Kunsong1，Dai Zibin1，Zhang Lichao1，Li Wei1，2，Zhu Weimin3
1.PLA Information Engineering University，Zhengzhou 450001，China； 2.State Key Laboratory of Special Integrated Circuit and System，F(xiàn)udan University，Shanghai 201203，China； 3.Center of Radio，F(xiàn)ilm，Television and News of Ruijin，Jiangxi Province，Ruijin 342500，China
Abstract： SM4 is the first commercial block cipher published in China, which has been widely used. The resource-constrained devices in IoT(Internet of Things) are limited by low processing power and small storage space，in order to solve this problem, designed and implemented a SM4 lightweight structure based on reutilizing resources and rescheduling procedures. Key expansion and the round function used the core module to generate round key and encrypt/decrypt by turns, and there is no need to store all the round keys required for the 32 round of iteration. Key store & detect module and real-time CK generate module, which can generating CK in positive or inverted sequence, can significantly improve the decoding efficiency. The results shows that with the advantages of occupying less resources and has higher FOM, the lightweight structure proposed in this paper is quiet suitable for the use of resource-constrained devices in IoT, and has broad application prospects.
Key words : SM4；lightweight；resource reutilization；composite field；barrel shifter

0 引言

    隨著物聯(lián)網(wǎng)應用越來越廣泛，人們對于物聯(lián)網(wǎng)的安全越來越重視。密碼算法在智能卡、射頻識別、無線傳感網(wǎng)等資源受限設備中的應用越來越多，以SM4算法為代表的密碼算法輕量級實現(xiàn)的研究具有重要的現(xiàn)實意義和實用價值。

    SM4算法是國家商用密碼管理辦公室于2006年1月公布的一種分組密碼算法[2]?？紤]到SM4算法輪函數(shù)及子密鑰擴展結構的相似性，其輕量級實現(xiàn)主要通過資源重用方式進行實現(xiàn)[3-6]。文獻[3]采用32輪全循環(huán)迭代結構，輪函數(shù)實現(xiàn)結構與密鑰擴展模塊采用分離式設計，并沒有充分利用SM4算法輪函數(shù)和子密鑰擴展結構基本相同的特點；文獻[4]采取每輪加密前先計算子密鑰的方式工作，但其中線性變換單元沒有實現(xiàn)復用；文獻[5]將FK和CK兩個參數(shù)組合一個新的參數(shù)并將密鑰初始化放入迭代操作中，但采用RAM存儲子密鑰的方式仍然會增加電路面積；文獻[6]采用串行的設計方式，加密操作和密鑰擴展共享數(shù)據(jù)通路，但是固定參數(shù)生成電路只適合于加密，并且線性變換模塊仍有優(yōu)化空間。

    針對以上問題，本文基于資源重用的方式設計了SM4算法的輕量級處理架構，可較好地滿足物聯(lián)網(wǎng)中資源受限設備的安全需求。

1 SM4算法概述

    SM4算法的分組長度為128 bit，密鑰長度為128 bit。加密算法與密鑰擴展算法都采用32輪非線性迭代結構。

1.1 加/解密算法

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    SM4算法的加密流程及輪函數(shù)運算過程如圖1所示。

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1.2 密鑰擴展算法

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2 SM4算法輕量級處理研究

2.1 SM4算法輕量級處理架構

    針對SM4算法實際應用的物聯(lián)網(wǎng)環(huán)境中設備計算能力較低、存儲空間小等特點，通過對SM4算法加解密流程的分析，本文針對現(xiàn)有問題基于資源重用的方式設計了面向資源受限設備的SM4算法輕量級實現(xiàn)處理架構，如圖2所示。

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    輕量級處理架構主要包括核心電路、密鑰存儲及檢測單元、固定參數(shù)生成電路和控制單元。加解密運算和密鑰擴展共享數(shù)據(jù)通路，通過模式選擇實現(xiàn)核心電路的分時復用，可同時滿足輪函數(shù)和子密鑰生成的需求。核心電路中只使用一個8×8的S盒以節(jié)省面積并采用桶形移位器實現(xiàn)線性變換。在數(shù)據(jù)加/解密過程之前，先檢測當前使用密鑰是否與上一分組相同，若相同則可直接使用存儲的生成加/解運算所需正序或逆序子密鑰。固定參數(shù)生成電路在模式控制下，可生成正序或逆序固定參數(shù)?？刂齐娐穼Ω髂K進行控制，實現(xiàn)加密輪函數(shù)、解密輪函數(shù)和密鑰擴展3種模式的變換，并控制核心電路的輪數(shù)和加/解密數(shù)據(jù)的輸入輸出。

2.2 輕量級處理架構運算單元設計

2.2.1 核心電路

    由于SM4算法的輪函數(shù)與子密鑰生成算法有極高的相似度，因此共享數(shù)據(jù)通路能夠大大節(jié)省算法實現(xiàn)所需電路面積。核心電路結構如圖3所示。

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    其中，核心電路主要包括：移位異或電路、S盒以及線性移位單元。

    （1）移位異或電路

    核心電路的輸入都為32 bit數(shù)據(jù)，并且核心電路中僅有一個8×8的S盒。因此，異或電路采用8 bit為基本位寬對數(shù)據(jù)進行處理。

    首先將明文輸入(X0，X1，X2，X3)或密鑰與系統(tǒng)參數(shù)異或結果(K0，K1，K2，K3)的4個32 bit子塊根據(jù)當前核心電路不同的模式輸入到數(shù)據(jù)緩存器中，同時輸入的還有輪函數(shù)使用的子密鑰rk或子密鑰生成時所需的固定參數(shù)CK。模式控制信息控制核心電路交替實現(xiàn)輪運算與子密鑰生成功能，每個周期對8 bit數(shù)據(jù)進行異或操作，然后將所有數(shù)據(jù)左移8 bit供下一周期使用。

    （2）S盒

    為節(jié)省面積，本文只使用一個8×8的S盒，采用分時復用的方式實現(xiàn)S盒替換操作。S盒的實現(xiàn)方式主要有查找表[3，5，6]以及基于復合域[4，7，8]的方法。相比于查找表的方式，基于復合域的實現(xiàn)方法采用代數(shù)運算的方式實現(xiàn)，計算更加簡單并且效率更高，因此，本文采用復合域方式對S盒進行實現(xiàn)。

    基于復合域求逆實現(xiàn)的S盒由仿射變換和有限域求逆兩種操作組成，其代數(shù)表達式為：S(x)=I(x·A1+C1)·A2+C2。式中，A1和A2為8×8矩陣，C1和C2為行向量：

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    I(x)表示為GF(28)有限域上的求逆運算，乘法求逆的8次不可約多項式為f(x)=x8+x7+x6+x5+x4+x2+1。S盒輸入經(jīng)仿射變換后，將GF(28)上的元素通過同構映射矩陣映射到GF(((22)2)2)上，并在GF(((22)2)2)上進行求逆運算，求逆的結果經(jīng)同構映射逆矩陣映射回GF(28)，再經(jīng)仿射變換得到S盒輸出。

    （3）線性移位單元

    本文通過桶形移位器實現(xiàn)線性移位操作可減少硬件電路的冗余。桶形移位器的實現(xiàn)方式主要有全譯碼、全編碼、部分譯碼和基于三值邏輯控制的方式等。其中，部分譯碼方式與全譯碼方式相比面積減小一半，而全編碼方式內(nèi)部由數(shù)據(jù)選擇器串聯(lián)而成，延時較大。因此，本文采用部分譯碼方式的桶形移位器對線性移位單元進行實現(xiàn)，如圖4所示。

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    部分譯碼方式將移位操作分為兩部分，每部分的移位位數(shù)由譯碼值決定。由于SM4算法中只有循環(huán)左移操作，所以本文中移位網(wǎng)絡只實現(xiàn)這一種操作。移位網(wǎng)絡1可實現(xiàn)移位位數(shù)為0、4、8、12、16、20、24、28的移位操作；移位網(wǎng)絡2可實現(xiàn)移位位數(shù)為0、1、2、3的移位操作。在兩個移位網(wǎng)絡的配合下，可以實現(xiàn)任意位數(shù)的循環(huán)左移操作，其中循環(huán)左移0位操作不經(jīng)過移位網(wǎng)絡。線性變換完成后，核心電路在模式控制信號的選擇下，將線性變換結果分別與輪函數(shù)中第一分組或子密鑰生成的第一個分組異或，并將異或結果存于第四分組中。

2.2.2 固定參數(shù)CK生成電路

    SM4算法中使用的固定參數(shù)CK可采用RAM直接存儲的方式，也可以通過電路實時產(chǎn)生。直接存儲會因為接口電路[6]使得CK生成電路面積增大，因此，本文采用實時生成的方式得到固定參數(shù)CK。

    由上一節(jié)可知，加密時cki，j=(4i+j)×7(mod256)。因此，cki，j+1=((4i+j)×7+7)(mod256)=(cki，j+7)(mod256)。也即：ck0，1=ck0，0+7，…，ck1，0=ck0，3+7，…，ck31，3=ck31，2+7。同理，解密時，cki，j-1=((4i+j)×7-7)(mod256)=(cki，j-7)(mod256)。也即：ck31，2=ck31，3-7，…，ck30，3=ck31，0-7，…，ck0，0=ck0，1-7。

    生成加密子密鑰時，每8 bit固定參數(shù)CK通過加0x7操作得到；生成解密子密鑰時，每8 bit固定參數(shù)CK通過減0x7操作得到，而減0x7操作可轉換為加0xF9得到，模256則通過直接截取低8位得到。固定參數(shù)CK實時生成電路如圖5所示。其中，Mode為加/解密模式控制信號。

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2.2.3 密鑰存儲及檢測單元

    由于SM4算法解密時使用的子密鑰是加密時的逆序，不存儲子密鑰的方式導致在解密時需要先進行密鑰初始化的過程，通過32輪迭代產(chǎn)生(rk28，rk29，rk30，rk31)，然后根據(jù)(rk28，rk29，rk30，rk31)進行迭代依次產(chǎn)生rk27-rk0[3]。根據(jù)文獻[3]，含有密鑰初始化的解密比不含密鑰初始化的解密所需時鐘周期增加了一倍，而吞吐率下降了50%。因此，本文增加密鑰存儲及檢測單元，檢測當前使用密鑰與所存儲的上一分組密鑰是否一致，若一致則直接使用所存儲的(rk0，rk1，rk2，rk3)或(rk28，rk29，rk30，rk31)進行加/解密運算，不一致則將生成的(K0，K1，K2，K3)發(fā)送給核心電路。該方法縮短了解密時所需時鐘周期并提高了解密速度，需存儲的密鑰相關數(shù)據(jù)也僅為原來的1/3。

3 實驗結果及分析

    本文分別在FPGA和ASIC平臺對所設計的SM4算法輕量級處理架構進行實現(xiàn)。

    在FPGA平臺，本文基于Altera Cyclone II EP2C35F672C6對本設計進行了綜合，綜合結果如表1所示。

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    在ASIC平臺，通過綜合工具對本設計進行了綜合，綜合結果以及與其他文獻的對比如表2所示。為實現(xiàn)不同工藝下實現(xiàn)結果的可比性，本文采用等效門（GE）為單位進行對比，并引入品質因數(shù)[9]（Figure of Merit，F(xiàn)OM）對各設計進行比較，以評估各電路的實現(xiàn)性能。FOM的定義為吞吐率（Mbps）與面積平方（GE2）的比，在不考慮翻轉率的情況下，相同吞吐率下面積越小則功耗越低。因此，在比較密碼算法輕量級實現(xiàn)性能時，F(xiàn)OM的值越高越好。

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    從表2中可以看出，本文的設計與文獻[6]相比，面積降低了27.92%；比文獻[4]中的設計面積下降了53.29%。雖然本文采用桶形移位器，使得加密周期有所增加，但本文設計采用復合域S盒，并且無需存儲32輪子密鑰，與文獻[5]將密鑰存儲于RAM中的方式相比，本文所需等效門數(shù)減少了304 GE，在面積上仍有優(yōu)勢。綜合來看，本設計的FOM值也比文獻[5]高，具有較好的品質因數(shù)。

4 總結

    本文基于資源重用的方式設計并實現(xiàn)了SM4算法的輕量級處理架構，子密鑰擴展和輪函數(shù)交替使用核心電路完成數(shù)據(jù)加/解密運算，密鑰存儲及檢測電路及固定參數(shù)實時生成電路可提高解密處理效率。具有資源占用少、吞吐率/面積比高等特點，非常適合應用于物聯(lián)網(wǎng)應用資源受限設備中。在此基礎上，將考慮采用低功耗設計技術來進一步降低電路功耗。

參考文獻

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