AVS视频解码中帧内预测模块的硬件化设计及SoPC验证
作者：刘家良 任怀鲁 指导教师：
摘要： 本文通过研究AVS标准中帧内预测的实现算法，对帧内预测模块进行了划分，并根据各个模块的实现方法分别对其进行了硬件化设计。其中，在预测值计算模块设计中，提出了一种关键路径更短、占用资源更少的可重构运算单元，利于流水线设计，可以提高运行频率。并且，在参考样本管理方案中采用了一种环形Ram预加载方案，可以有效地提高了预测速度。借助于基于Nios II 的SoPC系统，通过在Altera公司的Cyclone II FPGA平台上进行验证和测试，证明本设计的帧内预测模块可以正常工作在100Mhz，解码速度提高了19.4%。
Abstract：
Key words :
摘 要：本文通過研究AVS標(biāo)準(zhǔn)中幀內(nèi)預(yù)測的實現(xiàn)算法，對幀內(nèi)預(yù)測模塊進(jìn)行了劃分，并根據(jù)各個模塊的實現(xiàn)方法分別對其進(jìn)行了硬件化設(shè)計。其中，在預(yù)測值計算模塊設(shè)計中，提出了一種關(guān)鍵路徑更短、占用資源更少的可重構(gòu)運算單元，利于流水線設(shè)計，可以提高運行頻率。并且，在參考樣本管理方案中采用了一種環(huán)形Ram預(yù)加載方案，可以有效地提高了預(yù)測速度。借助于基于Nios II 的SoPC系統(tǒng)，通過在Altera公司的Cyclone II FPGA平臺上進(jìn)行驗證和測試，證明本設(shè)計的幀內(nèi)預(yù)測模塊可以正常工作在100Mhz，解碼速度提高了19.4%。
關(guān)鍵字：幀內(nèi)預(yù)測 AVS視頻編碼標(biāo)準(zhǔn) 硬件加速 SoPC
AVS視頻解碼中幀內(nèi)預(yù)測模塊的硬件化設(shè)計及SoPC驗證-山東科技大學(xué)-劉家良.pdf
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