混合型判決反饋均衡器設計與FPGA實現
所屬分類：技術論文
上傳者：aet
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文檔介紹：針對1000BASE-T中的均衡解碼結構，從信噪比與誤碼率、速度及硬件復雜度等方面比較了該判決反饋均衡解碼器的幾種形式，并設計了一種滿足速度與誤碼率要求而硬件復雜度更低的混合型結構，該結構將部分殘留后饋干擾級數移除，同時應用流水線及重定時技術優(yōu)化其性能。
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