基于H.264幀間預(yù)測解碼的研究及高效VLSI實現(xiàn)
所屬分類：技術(shù)論文
上傳者：aet
文檔大?。?span>320 K
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文檔介紹：在深入研究H.264幀間預(yù)測技術(shù)的基礎(chǔ)上，采用三級流水線實現(xiàn)幀間預(yù)測解碼的VLSI設(shè)計，并詳細介紹了基于宏塊分割的變塊自適應(yīng)循環(huán)控制單元，針對存儲器的讀寫問題提出了一種交織存取方式，針對分像素插值提出了一種基于H.264標準的插值運算電路。通過仿真及在H.264解碼器中的實際應(yīng)用和測試，證明該設(shè)計工作穩(wěn)定，能夠滿足H.264標準基本框架下4CIF格式圖片30fps（幀/秒）實時解碼的要求。
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